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一多处理器系统中至少有三处理器连接一系统总线相连，在源和目标处理器之间交换系统总线数据和源和目标处理器识别编号。按传输数据中检测的误差，传输误差毕特存贮在一传输误差毕特寄存器；按接收数据中检测的误差，接收误差毕特存贮在接收误差毕特寄存器。按...
该专利属于日本电气株式会社所有，仅供学习研究参考，未经过日本电气株式会社授权不得商用。

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