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本发明涉及一种FPGA/IP核逻辑代码安全规则检测方法，涉及FPGA/IP核验证技术领域。本发明根据所设计的自定义安全规则检测条款和现有商业条款相结合，在自定义安全规则检测条款增加并实现了FPGA状态机死锁、内部三态等规则条款，提高了FPG...
该专利属于北京计算机技术及应用研究所所有，仅供学习研究参考，未经过北京计算机技术及应用研究所授权不得商用。

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