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为了不增大处理时间、处理电路以及插补用数据等地提高对缺陷元件的输出信号的插补精度并且简单地抑制伪影，本发明具备：检测部，将包含多个检测元件的检测元件组与一个像素对应地排列多个；相加率决定部，决定检测元件的输出信号的相加率；相加部，通过根据相...
该专利属于株式会社日立制作所所有，仅供学习研究参考，未经过株式会社日立制作所授权不得商用。

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