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本公开涉及调节数字锁相回路的相位。本公开的方面涉及布置以使用相位调节信号调节输出相位的数字锁相回路(DPLL)。在某些实施方案中，相位调节信号可以从DPLL的时数转换器的输出到DPLL的数控振荡器的输入在信号路径中接收。一些实施方案涉及调节...
该专利属于亚德诺半导体集团所有，仅供学习研究参考，未经过亚德诺半导体集团授权不得商用。

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