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一种基于测控数传一体化应答机统一时钟域实现方法，在FPGA中实现，采用全数字同源设计，利用指令识别及控制、复位控制、整数分频计数器、高精度的累加寄存器与定时清零、不定时清零相结合的方式，产生了扩频传输模式时钟clkkp，高速数据传输模式时钟...
该专利属于西安空间无线电技术研究所所有，仅供学习研究参考，未经过西安空间无线电技术研究所授权不得商用。

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