本发明专利技术公开了一种栅极驱动电路结构，栅极驱动电路结构布设在显示面板上，包括：控制区块电路，具有至少一时序输入端、第一电压输入端、第二电压输入端及至少一输出节点；及与一该输出节点电性连接的第一输出电路，而该第一输出电路并具有第一电压下拉薄膜晶体管，至少一时序输入端的时序讯号提供给第一输出电路；其中，提供第一输出电路的该输出节点的控制讯号周期大于时序讯号的周期，且小于一帧时间；藉此，利用控制该电压下拉薄膜晶体管的控制讯号周期大于时序讯号周期而产生抑制涟波能力，同时减缓临界电压位移的速度，进而提升可靠度。
【技术实现步骤摘要】
栅极驱动电路结构及其显示装置
本专利技术与驱动电路有关，特别是关于一种栅极驱动电路结构及其显示装置。
技术介绍
在一般液晶显示器(IXD)中，驱动电路(Driving Circuit)为液晶显示的重要的驱动元件，在传统面板技术上，多以驱动集成电路(Driver IC)作为面板的驱动电路。请参考图1，为表示传统显示面板及GOA技术的显示面板的示意图。至今，在降低成本、提升品质及缩短生产周期的考量下，发展出一非晶硅整合型闸级驱动电路(A-SiIntegrated Gate Driver)，简称 ASG，其中，ASG 是应用在非晶娃(amorphous silicon)工艺中，实现于将栅极驱动电路(Gate Driver)在Array工艺(Array Process)中整合在面板，此技术亦统称为 Gate Driver On Array (GOA)或 Gate Driver On Panel (GOP)。请再参考图2及图3，其中，图2表示现有GOA技术的显示装置的GOA电路结构示意图，以及图3表示图2的输出波形图。GOA的电路结构包括起始讯号输入端(STV、CLKl、CLK3、CLK5)、控制区块(controlblock)电路、控制区块电路输出端(P、Z)、薄膜晶体管(M1-M5)、电压(VGL)、扫瞄讯号输出节点Gate以及电容(Cb);因6(^输出电路结构中，薄膜晶体管Ml为主要输出的元件，且尺寸较大(因为电容Cgd及Cg s较大)，导致时序输入端CLKl的时序讯号在上升与下降时间的时候与该薄膜晶体管Ml的电容产生耦合(coupling)，使输出至扫瞄讯号输出节点的波形因而产生链波(ripple),其中，链波(ripple)更进一步分为向正(上)与向负(下)两种。请再参考图4，表示现有GOA技术的显示面板的栅极驱动电路结构其移位暂存器的向正涟波对画素电压的影响说明示意图。扫瞄讯号输出节点Gatel电性连接画素单元的画素薄膜晶体管(pixel TFT)的扫瞄讯号线(如图4所示)，再利用控制该画素薄膜晶体管的栅极(Gateelectoode)以决定画素薄膜晶体管的开启与关闭。其中，每一画素单元于周期Tn时，会将该资料电压Vdata写入该画素单元，于该画素薄膜晶体管导通时，该画素电压Vpixel在周期Tn中会上升到电压Vd再下降至电压Vp，而画素单元的画素薄膜晶体管的栅极受控于所电性电接的该移位暂存器其扫瞄讯号输出节点的控制讯号，且因为当栅极驱动电路提供该扫瞄讯号线为低电压时，该画素单元的画素薄膜晶体管(Pixel TFT)理想状态为关闭状态，但因为GOA输出电路该薄膜晶体管Ml会因为其连接的时脉讯号所产生的涟波会被耦合到所电性连接的该列扫瞄讯号线，进而使该画素单元的画素薄膜晶体管其栅极会有该涟波电压的偏压影响，而产生一 1ff电流，该1ff电流会由Vpixel朝Vdata方向产生，而造成有一漏电路径，使该等画素单元的画素薄膜晶体管因此具有无法完全关闭，且该栅极驱动电路于每一周期Tn均会对该列扫瞄讯号线产生此一链波(ripple)。在面板显示区内向正的涟波(ripple)对画面上会有影响，当向正的涟波(ripple)的最大值(peak值)越大且时间越长的话，则会使显示区内的画素薄膜晶体管(TFT)的画素电压Vpixel漏电，导致黑画面的亮度不够暗，而由于对比度(CR)为白画面的亮度与黑画面的亮度的比值，进而造成对比度的下降。请同时参考图5到图7，其中，图5表示现有GOA技术的3.5吋QVGA显示器的模拟电路输出波形图，图6表不图5的长时间测试的电流-电压图，以及图7表不图5的实际量测电路输出波形图。当下拉薄膜晶体管(pull-down TFT)(如薄膜晶体管M3)于高温(以摄氏80度C为例说明，但不以此为限)受时脉讯号CLK偏压影响后，临界电压Vth(threshold voltage)的位移(shift)(如图6所示)，而严重导致其电压下拉(pull down)能力减弱，使得输出电压(output voltage)出现多脉冲(mult1-pulse)(如图5及图7所示)，进而造成显示画面出现闪烁现象。基于上述问题，专利技术人提出了一种驱动电路结构及其显示装置，以克服现有技术的缺陷。
技术实现思路
本专利技术目的在于提供一种利用降低GOA输出电路中下拉薄膜晶体管(pull-downTFT)的控制讯号频率，使控制该下拉薄膜晶体管的控制讯号周期变大而来降低涟波(ripple)与减缓临界电压(threshold voltage)位移的速度,进而提升显示画面品质及可靠度(reliability)的栅极驱动电路结构及其显示装置。为达上述目的，本专利技术提供一种栅极驱动电路结构，该电路结构布设在一显示面板上，每一移位暂存器用以接收至少一时脉信脉与一起始信号并输出一扫瞄信号至该扫瞄讯号输出节点以驱动一画素列，每一移位暂存器包括:一控制区块电路，具有至少一时序输入端、一第一电压输入端、一第二电压输入端以及至少一输出节点；以及与一该输出节点电性连接的该第一输出电路，该第一输出电路具有一第一电压下拉薄膜晶体管，该至少一时序输入端的一时序讯号提供给该第一输出电路；其中，提供该第一输出电路的该输出节点的控制讯号周期大于时序讯号的周期，且小于一帧(Frame)的时间。所述的驱动电路结构，更包括一第二输出电路，且该控制区块电路更包括一第二输出节点，该第二输出电路与该第二输出端电性连接，该第二输出电路具有一第二电压下拉薄膜晶体管，该至少一时序输入端的一时序讯号提供给该第二输出电路，该第二输出电路的一输出电压周期大于该时序讯号的周期，且小于一巾贞(Frame)的时间,其中，该第一电压输入端接收一第一电压讯号及该第二电压输入端接收一第二电压讯号，经该控制单元的逻辑运算后依序提供控制该第一输出节点与该第二输出节点的控制讯号，进而依序控制该第一输出电路的该第一电压下拉薄膜晶体管及该第二输出电路的该第二电压下拉薄膜晶体管彼此间交互开启与关闭的时间。为达上述目的，本专利技术提供一种显示装置，包括:一显示面板，具有一显示区、一布线区以及一贴合区，该贴合区贴合有若干源极驱动集成电路以及一电路板结构；上述的栅极驱动电路结构；以及一背光模块，设置在该显示面板下方。与现有技术相比，本专利技术的栅极驱动电路结构利用电压下拉薄膜晶体管的控制讯号持续为High的时间拉长成为低频的AC讯号，则抑制涟波的能力较佳，同时可减缓临界电压位移的速度，进而提升可靠度。【附图说明】图1表示传统显示面板及GOA技术的显示面板的示意图。图2表示现有GOA技术的显示装置的GOA电路结构示意图。图3表示图2的输出波形图图4表示现有GOA技术的显示面板的的栅极驱动电路结构其移位暂存器的向正涟波对画素电压的影响说明示意图。图5表示现有GOA技术的3.5吋QVGA显示器的模拟电路输出波形图。图6表示图5的长时间测试的电流-电压图。图7表示图5的实际量测电路输出波形图。图8表示本专利技术各级输出电路的方块示意图。图9表示本专利技术栅极驱动电路结构的电路示意图。图10表示本专利技术的电压下拉薄膜晶体管控制讯号为High准位波形与现有的电压下拉薄膜晶体管控制讯号为High准位波形比较图。图1lA表示本专利技术栅极驱本文档来自技高网...
【技术保护点】
一种栅极驱动电路结构，其特征在于，包括多个移位暂存器串联布设在一显示面板上，每一移位暂存器用以接收至少一时脉信脉与一起始信号并输出一栅极信号以驱动一画素列，每一移位暂存器包括：一控制单元，具有至少一时序输入端、一第一电压输入端、一第二电压输入端、一第一输出节点；以及一第一输出电路，与该第一输出节点电性连接，其中，该第一输出电路具有一第一电压下拉薄膜晶体管连接该第一输出节点，及一栅极驱动电压输出节点输出该栅极信号，且至少一该时序输入端的一时序讯号提供给该第一输出电路；其中，该第一输出节点的一控制讯号周期大于该时序讯号的周期，且小于一帧的时间。
【技术特征摘要】
1.一种栅极驱动电路结构，其特征在于，包括多个移位暂存器串联布设在一显示面板上，每一移位暂存器用以接收至少一时脉信脉与一起始信号并输出一栅极信号以驱动一趣素列，每一移位暂存器包括: 一控制单兀，具有至少一时序输入端、一第一电压输入端、一第二电压输入端、一第一输出节点；以及 一第一输出电路，与该第一输出节点电性连接，其中，该第一输出电路具有一第一电压下拉薄膜晶体管连接该第一输出节点，及一栅极驱动电压输出节点输出该栅极信号，且至少一该时序输入端的一时序讯号提供给该第一输出电路； 其中，该第一输出节点的一控制讯号周期大于该时序讯号的周期，且小于一帧的时间。2.如权利要求1所述的栅极驱动电路结构，其特征在于，该控制单元更包括一第二输出节点，以及与该第二输出节点电性连接的一第二输出电路，而该第二输出电路具有一第二电压下拉薄膜晶体管，且该第二输出电路与该第一输出电路连接相同的该栅极驱动电压输出节点，并至少一该时序输入端的一时序讯号提供给该第二输出电路，而该第二输出节点的一控制讯号周期大于该时序讯号的周期，且小于一帧(Frame)的时间。3.如权利要求2所述的栅极驱动电路结构，其特征在于，该第一电压输入端接收一第一电压讯号及该第二电压输入端接收一第二电压讯号，经该控制单元的逻辑运算后依序提供控制该第一输出节点与该第二输出节点的控制讯号，进而依序控制该第一输出电路的该第一电压下拉薄膜晶体管及该第二输出电路的该第二电压下拉薄膜晶体管彼此间交互开启与关闭的时间。4.如权利要求2所述的栅 极驱动电路结构，其特征在于，该第一输出节点的该控制讯号周期与该第二输出节点的该控制讯...
【专利技术属性】
技术研发人员：许文财，江建学，
申请(专利权)人：群康科技深圳有限公司，奇美电子股份有限公司，
类型：发明
国别省市：
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