同步存储器与动态致能同步存储器中地址接收器的方法技术

一种用来动态致能一同步存储器中地址接收器的方法，包含有：控制全部的地址接收器于一开始时处于一关闭状态；产生一命令讯号与一地址讯号；延迟该地址讯号以使该命令讯号与该地址讯号之间有一时间延迟；以及当该同步存储器接收到该命令讯号时，选择性地开启对应于该地址讯号的一地址接收器。

【技术实现步骤摘要】

本专利技术涉及一种同步存储器，特别是涉及一种可动态致能地址接收器 的同步存储器。
技术介绍
相较于异步(asynchronous)存储器，同步(synchronous)存储器具 有较简单的时序(timing)需求，其中异步存储器必须每次于一写入操作 发生时产生一脉沖讯号。同步存储器具有操作于时钟边缘的讯号，因此相 较于异步存储器，可操作于较快的时钟之下。于具有一共享地址机制的多 存储库存储器(multiple bank memory)中，输入一特定存储库的地址讯 号可产生一瞬时(transient)电流给其它的存储库。传统方法因此利用译 码逻辑电路来选择性地锁存或释放地址予一内部地址总线(address bus )。请参阅图l,图1为已知同步存储器100的示意图。如图所示，同步存 储器IOO具有一时钟接收器130、一命令接收器l20以及一地址接收器110, 其中时钟接收器130用来接收一时钟讯号，命令接收器用来接收一命 令讯号，以及地址接收器110用来接收一地址讯号。为了简明起见，图中 仅显示出一组接收器。如图l所示的时序图，命令讯号CMD1、 CMD2与地址 讯号ADD1、 ADD2于一相同时钟周期(clock cycle)中分别被命令接收器 120与地址接收器110所接收，其中命令讯号被译码来产生一命令时钟 CMD—CLK以锁存(latch)或释放(release)地址讯号给内部地址总线。由于地址讯号与命令讯号是于相同的时钟周期中被接收，地址接收器 需一直被开启，如此一来，便会消耗相当大的功率，因此亟需一种可于地 址接收器有需要使用时才选择性地开启地址接收器的系统。
技术实现思路
本专利技术的目的之一在于提供一种依据所接收的命令来动态开启地址接 收器的系统及其相关方法。4一种用来动态致能一同步存储器中地址接收器的方法，包含有控制 全部的地址接收器于一开始时处于一关闭状态；产生一命令讯号与 一地址 讯号；延迟该地址讯号以使该命令讯号与该地址讯号之间具有一时间延迟； 以及当该同步存储器接收到该命令讯号时，选择性地开启对应于该地址讯 号的一地址接收器。该方法还包含提供一系统时钟；依据该系统时钟来 选择性地产生一地址接收器致能讯号来译码该命令讯号，以及依据该地址 接收器致能讯号来开启该地址接收器。本专利技术还提供一种同步存储器，其包含 一命令接收器，用来接收一 命令讯号； 一地址接收器，用来接收对应于该命令讯号的一地址讯号，其 中该地址讯号相对于该命令讯号而被加以延迟，以及该地址4妄收器于一开 始时处于一关闭状态；以及一译码器，耦接至该命令接收器与该地址接收 器，用来译码该命令讯号以选择性地产生一地址接收器致能讯号来开启该 地址接收器。附图说明图1为已知同步存储器的操作的示意图。图2为本专利技术同步存储器的一实施例的示意图。图3为图2所示的同步存储器的操作的流程图。附图符号说明<table>table see original document page 5</column></row><table>具体实施方式本专利技术提供一种用来于一 同步存储器中动态致能地址接收器的方法。请参阅图2，图2为本专利技术同步存储器200的一实施例的示意图。为了 筒明起见，图2仅显示单一组的接收器，同步存储器200包含 一地址接 收器210,用来接收一地址讯号； 一命令接收器220，用来接收一命令讯号； 以及一时钟接收器230,用来接收一时钟讯号，其中该时钟讯号是由一系统 时钟所产生。地址接收器210、命令接收器220与时钟接收器230耦接于一 译码器(decoder) 240，而{斧码器240与地址接收器210耦接至一内部地 址总线。由图2所示的时序图可知，地址讯号ADD1 、 ADD2、 ADD3较命令讯号CMD1 、 CMD2、 CMD3晚一时钟周期才被接收，这是主要藉由依据系统时钟来延迟地 址讯号所造成。请注意，此处仅延迟一时钟周期的地址讯号仅用以描述本 专利技术的特征，并非作为本专利技术的一限制条件。地址讯号可藉由利用该系统 时钟来锁存地址讯号、緩冲地址讯号或输入地址讯号至一延迟电路等方式 而被加以延迟。所有可延迟地址讯号以使地址讯号与命令讯号之间产生时 间延迟(1 a t ency)的方法皆落在本专利技术的范畴内。首先，同步存储器200中全部的地址接收器初始被控制于一关闭状态， 而命令讯号与地址讯号被产生以及地址讯号依据系统时钟来^皮延迟以于命 令讯号与地址讯号之间产生一时间延迟。如同先前技术，命令讯号所具有 的逻辑信息会经由译码以产生一命令时钟CMD-CLK,但于本专利技术中，命令讯 号亦包含有关地址接收器210是否需要被致能的逻辑信息。命令讯号被输 入至译码器240，而i,码器240便产生命令时钟CMD-CLK与一地址接收器致 能讯号rcv-enable。若译码后的命令讯号指出地址接收器210不需被致能， 则没有地址接收器致能讯号rcv-enable会被产生。理想上，地址讯号与命令讯号之间的时间延迟是依据译码器240产生 地址接收器致能讯号rcv-enable以及开启地址接收器210所需的处理时间 而定，如此一来，开启地址接收器所造成的效能冲击可被降低。在地址讯号依据命令时钟CMD-CLK而释放予内部地址总线之后，若于 一段间歇时间中没有接收到任何命令讯号，则地址接收器21Q可再被关闭， 而接下来的命令讯号会被输入至译码器240来决定是否要再度开启地址接 收器210。一并参照图3，本专利技术方法将于后详细描述。图3是本专利技术方法的步骤的流程图。这些步骤如下所述步骤300:控制全部的地址接收器处于一关闭状态。步骤302:是否有一命令讯号与一地址讯号产生？若是，则进入步骤 304，否则，回到步骤302;步骤304:利用系统时钟来锁存地址讯号以使地址讯号^皮延迟至少一时钟周期于落于命令讯号之后。步骤306:利用系统时钟与控制讯号的^码逻辑电路来产生一地址接收 器致能讯号与一命令时钟。步骤3Q8:地址接收器致能讯号是否指出地址接收器需要被开启？若 是，则进入步骤310,否则，进入步骤314。步骤310:开启地址接收器。步骤312:利用命令时钟来释放地址给内部地址总线，接着回到步骤300。步骤314:控制地址接收器保持于一关闭状态，接着回到步骤302。 由于地址讯号被一相对应的命令讯号所延迟，因此地址接收器无需处于一永久开启状态，且可依据命令讯号所传递的逻辑信息来动态地开启，因此便可节省传统地址接收器的电流消耗。以上所述仅为本专利技术的较佳实施例，凡依本专利技术的权利要求所做的均等变化与修饰，皆应属本专利技术的涵盖范围。本文档来自技高网...

【技术保护点】
一种用来动态致能一同步存储器中地址接收器的方法，其特征在于包含有：　控制全部的地址接收器于一开始时处于一关闭状态；　产生一命令讯号与一地址讯号；　延迟该地址讯号以使于该命令讯号与该地址讯号之间具有一时间延迟；以及　当 该同步存储器接收到该命令讯号时，选择性地开启对应于该地址讯号的一地址接收器。

【技术特征摘要】
US 2008-3-19 12/050,9501.一种用来动态致能一同步存储器中地址接收器的方法，其特征在于包含有控制全部的地址接收器于一开始时处于一关闭状态；产生一命令讯号与一地址讯号；延迟该地址讯号以使于该命令讯号与该地址讯号之间具有一时间延迟；以及当该同步存储器接收到该命令讯号时，选择性地开启对应于该地址讯号的一地址接收器。2. 如权利要求l所述的方法，其特征在于其中选择性地开启对应于该 地址讯号的 一地址接收器的步骤包含有提供一系统时钟；依据该系统时钟来译码该命令讯号以选择性地产生一地址接收器致能 讯号；以及依据该地址接收器致能讯号来开启该地址接收器。3. 如权利要求2所述的方法，其特征在于其中若该译码后的命令讯号 指出该地址接收器必须被致能，则产生该地址接收器致能讯号，以及若该 译码后的命令讯号指出该地址接收器不须被致能，则不会产生该地址接收 器致能讯号。4. 如权利要求2所述的方法，其特征在于其中该地址讯号与该命令讯 号之间的该时间延迟是依据该命令讯号的一译码时间而定。5. 如权利要求l所述的方法，其特征在于其中延迟该地址讯号的步骤 包含有提供一系统时钟；以及锁存该地址讯号达到该系统时钟的至少 ...

【专利技术属性】
技术研发人员：张嘉仁，帕特特龙，
申请(专利权)人：南亚科技股份有限公司，
类型：发明
国别省市：71[中国|台湾]