【技术实现步骤摘要】
【国外来华专利技术】
技术介绍
1、本技术涉及用于管理预取事务的装置和方法。
2、通常，处理设备(例如处理器核心)具有一个或多个级别的本地高速缓存，其中数据可被临时保存，以便通过避免从存储器获得此类数据的需要来设法改善性能。在现代处理设备中，可提供预取机制以设法在预期处理设备对数据的后续使用的情况下将该数据预取到本地高速缓存中。虽然此类办法可在有用数据被预取到高速缓存中的情况下通过增加本地高速缓存中的命中率而显著地改善性能，但是为了将数据检索到高速缓存中而发出的各种预取事务可消耗系统的下游部件(诸如用于将处理设备与存储器耦合的互连件)内的显著带宽。
3、互连件可用于提供系统内的多个不同元件之间的连接，并且通过互连件的通信路径中的一个或多个内的拥塞可因此显著地影响系统性能。
技术实现思路
1、在一个示例布置中，提供了一种装置，包括：互连件，该互连件用于在耦合到该互连件的元件之间提供通信路径；其中耦合到互连件的元件至少包括用于通过互连件发起事务的请求器元件、以及多个完成器元件，该完成器元件中的每个完成器元件被布置成对由该完成器元件经由互连件接收的事务做出响应；该装置还包括：拥塞跟踪电路，该拥塞跟踪电路用于与请求器元件相关联地维护针对通过互连件的用于传播由请求器元件发起的事务的多个路由中的每个路由的拥塞指示，其中每个路由包括一个或多个通信路径，并且用于传播给定事务的路由取决于该给定事务的目标完成器元件；和预取节流电路，该预取节流电路：响应于对请求器元件为了在预期请求器元件对数据的后续
2、在另一个示例布置中，提供了一种管理预取事务的方法，包括：提供耦合到互连件的元件之间的通信路径，其中耦合到互连件的元件至少包括用于通过互连件发起事务的请求器元件、以及多个完成器元件，该多个完成器元件中的每个完成器元件被布置成对由该完成器元件经由互连件接收的事务做出响应；与请求器元件相关联地维护针对通过互连件的用于传播由请求器元件发起的事务的多个路由中的每个路由的拥塞指示，其中每个路由包括一个或多个通信路径，并且用于传播给定事务的路由取决于该给定事务的目标完成器元件；响应于对请求器元件为了在预期请求器元件对数据的后续使用的情况下推测性地检索该数据而希望发起的给定预取事务的指示，识别该给定预取事务将被发出到的该多个完成器元件中的目标完成器元件；以及在给定目标完成器元件的情况下，根据针对要用于传播该给定预取事务的路由的拥塞指示来确定是否发出给定预取事务。
3、在又一个示例布置中，提供一种用以存储用于制造装置的计算机可读代码的非暂时性计算机可读介质，该装置包括：互连件，该互连件用于提供耦合到互连件的元件之间的通信路径，其中耦合到互连件的元件至少包括用于通过互连件发起事务的请求器元件、以及多个完成器元件，该多个完成器元件中的每个完成器元件被布置成对由该完成器元件经由互连件接收的事务做出响应；拥塞跟踪电路，该拥塞跟踪电路用于与请求器元件相关联地维护针对通过互连件的用于传播由请求器元件发起的事务的多个路由中的每个路由的拥塞指示，其中每个路由包括一个或多个通信路径，并且用于传播给定事务的路由取决于该给定事务的目标完成器元件；和预取节流电路，该预取节流电路：响应于对请求器元件为了在预期请求器元件对数据的后续使用的情况下推测性地检索该数据而希望发起的给定预取事务的指示，识别该给定预取事务将被发出到的该多个完成器元件中的目标完成器元件，并且在给定目标完成器元件的情况下根据针对要用于传播该给定预取事务的路由的拥塞指示来确定是否发出该给定预取事务。
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1.一种装置，所述装置包括：
2.根据权利要求1所述的装置，其中：
3.根据权利要求1或权利要求2所述的装置，其中所述预取节流电路被布置成在确定不应当发出所述给定预取事务时向所述请求器元件发出信号，以识别所述给定预取事务已经被拒绝。
4.根据任一前述权利要求所述的装置，其中对所述请求器元件希望发起的所述给定预取事务的所述指示提供针对所述数据的存储器地址指示，并且所述预取节流电路被布置成基于所述存储器地址指示来识别所述目标完成器元件。
5.根据任一前述权利要求所述的装置，其中所述拥塞跟踪电路被布置成在接收到对由所述请求器元件发起的给定事务的响应时从所述响应中提取与用于所述给定事务的所述路由有关的拥塞信息，并且根据所提取的拥塞信息更新针对所述路由的所述拥塞指示。
6.根据权利要求5所述的装置，其中至少所述拥塞指示从多个可能的拥塞级别中识别拥塞级别。
7.根据权利要求5或权利要求6所述的装置，其中所述拥塞信息由下列中的一项提供：
8.根据权利要求7所述的装置，其中：
9.根据权利要求8所述的
10.根据权利要求9所述的装置，其中每个路由器节点考虑在确定的时间窗口内观察到的链路拥塞来维护所述链路的所述链路拥塞信息。
11.根据权利要求8至10中任一项所述的装置，其中：
12.根据权利要求8至11中任一项所述的装置，其中：
13.根据权利要求12所述的装置，其中在所述响应中由所述拥塞跟踪电路使用以确定所述无竞争时延值的所述足够的信息识别下列中的一项或多项：
14.根据权利要求5至13中任一项所述的装置，其中所述多个路由包括下列中的至少一者：
15.根据权利要求14所述的装置，其中：
16.根据权利要求15所述的装置，其中：
17.根据权利要求16所述的装置，其中所述拥塞跟踪电路被布置成维护针对第一往返路由和第二往返路由两者的拥塞指示，在所述第一往返路由中，所述给定事务由所述目标完成器元件处理，在所述第二往返路由中，所述给定事务由所述目标完成器元件转发到所述另外的完成器元件以供处理。
18.根据权利要求15至17中任一项所述的装置，其中：
19.根据权利要求14至18中任一项所述的装置，其中在所述响应中的所述拥塞信息提供至少一个单独通信路径的拥塞信息，并且所述拥塞跟踪电路被布置成更新针对包含所述单独通信路径的一个或多个路由的拥塞指示。
20.根据权利要求15至19中任一项所述的装置，其中形成所述目标完成器元件的所述中间元件被布置成提供用于高速缓存与所选存储器地址范围相关联的数据的系统高速缓存，并且所述另外的完成器元件是用于控制对所述所选存储器地址范围的至少一部分内的存储器的访问的存储器控制器。
21.根据任一前述权利要求所述的装置，其中：
22.根据任一前述权利要求所述的装置，其中：
23.根据任一前述权利要求所述的装置，还包括提供所述请求器元件与所述互连件之间的接口的接口电路，其中所述拥塞跟踪电路和所述预取节流电路中的至少一者设置在所述接口电路内。
24.根据权利要求23所述的装置，其中所述请求器元件包括本地高速缓存存储装置和与所述本地高速缓存存储装置相关联的预取电路，并且所述预取电路被布置成向所述接口电路发出对所述请求器元件希望发起的所述预取事务的所述指示。
25.根据任一前述权利要求所述的装置，其中：
26.一种管理预取事务的方法，所述方法包括：
27.一种非暂态计算机可读介质，所述非暂态计算机可读介质用于存储用于制造装置的计算机可读代码，所述装置包括：
...【技术特征摘要】
【国外来华专利技术】
1.一种装置，所述装置包括：
2.根据权利要求1所述的装置，其中：
3.根据权利要求1或权利要求2所述的装置，其中所述预取节流电路被布置成在确定不应当发出所述给定预取事务时向所述请求器元件发出信号，以识别所述给定预取事务已经被拒绝。
4.根据任一前述权利要求所述的装置，其中对所述请求器元件希望发起的所述给定预取事务的所述指示提供针对所述数据的存储器地址指示，并且所述预取节流电路被布置成基于所述存储器地址指示来识别所述目标完成器元件。
5.根据任一前述权利要求所述的装置，其中所述拥塞跟踪电路被布置成在接收到对由所述请求器元件发起的给定事务的响应时从所述响应中提取与用于所述给定事务的所述路由有关的拥塞信息，并且根据所提取的拥塞信息更新针对所述路由的所述拥塞指示。
6.根据权利要求5所述的装置，其中至少所述拥塞指示从多个可能的拥塞级别中识别拥塞级别。
7.根据权利要求5或权利要求6所述的装置，其中所述拥塞信息由下列中的一项提供：
8.根据权利要求7所述的装置，其中：
9.根据权利要求8所述的装置，其中：
10.根据权利要求9所述的装置，其中每个路由器节点考虑在确定的时间窗口内观察到的链路拥塞来维护所述链路的所述链路拥塞信息。
11.根据权利要求8至10中任一项所述的装置，其中：
12.根据权利要求8至11中任一项所述的装置，其中：
13.根据权利要求12所述的装置，其中在所述响应中由所述拥塞跟踪电路使用以确定所述无竞争时延值的所述足够的信息识别下列中的一项或多项：
14.根据权利要求5至13中任一项所述的装置，其中所述多个路由包括下列中的至少一者：
15.根据权利要求14所述的装置，其中：
16.根据权利要求15所...
【专利技术属性】
技术研发人员：乔舒亚·兰德尔，亚历山大·科尔·舒利亚克，何塞·阿尔贝托·乔奥，
申请(专利权)人：ARM有限公司，
类型：发明
国别省市：
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