一种DMA控制器及其控制方法、车规级芯片、存储介质。所述方法包括：响应于第一写操作控制信号，读取预先存储的设备身份标识信息，所述预先存储的设备身份标识信息与所述DMA控制器绑定；基于所述预先存储的设备身份标识信息，对执行第一写操作的设备进行身份验证；响应于身份验证通过，对所述DMA控制器中相应通道的寄存器执行第一写操作。采用上述方案，可以使得DMA控制器，从而满足信息保护要求。
1、在计算机系统中，当需要进行数据传输时，通常需要通过cpu来完成，数据从外部设备经过总线传输到cpu，再由cpu把数据存储至内存中，或者，cpu从内存中读取数据并发送到外部设备。由于需要cpu参与数据传输，会占用cpu的时间和资源，如果数据量较大或者频繁地进行数据传输，将会严重影响cpu的性能。
2、为了提高计算机系统和外部设备之间、或者计算机系统不同内存之间、或者外部设备和外部设备之间的数据传输速度，出现了直接内存访问（direct memory access，dma）技术。dma技术可以在不占用cpu的情况下将内存中的数据直接传输到外部设备中，或者将外部设备中的数据直接传输到内存中，由此可以达到提高数据传输效率，降低cpu负载。
3、dma控制器是负责管理和控制dma数据传输的硬件设备。dma控制器具有多个dma通道。当接收到dma请求时，dma控制器可以调用相应的dma通道来执行数据传输操作，而无需cpu参与。每个dma通道都有自己独立的寄存器集合，用于存储数据传输参数和状态信息。
>2、为解决上述问题，本专利技术实施例提供了一种dma控制器的控制方法，dma控制器包括锁定状态及未锁定状态；在锁定状态下，所述方法包括：3、响应于第一写操作控制信号，读取预先存储的设备身份标识信息，所述预先存储的设备身份标识信息与所述dma控制器绑定；
4、基于所述预先存储的设备身份标识信息，对执行第一写操作的设备进行身份验证；
5、响应于身份验证通过，对所述dma控制器中相应通道的寄存器执行第一写操作。
6、本专利技术实施例还提供了一种dma控制器，dma控制器包括锁定状态及未锁定状态；所述dma控制器包括：
7、身份验证单元，适于在锁定状态下，响应于第一写操作控制信号，读取预先存储的设备身份标识信息，所述预先存储的设备身份标识信息与所述dma控制器绑定；以及基于所述预先存储的设备身份标识信息，对执行第一写操作的设备进行身份验证；
8、以及总线从接口单元，适于响应于身份验证通过，对所述dma控制器中相应通道的寄存器执行第一写操作。
9、本专利技术实施例还提供了一种车规级芯片，所述车规级芯片包括上述任一实施例中的dma控制器。
10、本专利技术实施例还提供了一种计算机可读存储介质，其上存储有计算机程序，所述计算机程序被处理器执行，以实现权利要求上述任一实施例中所述方法的步骤。与现有技术相比，本专利技术实施例的技术方案具有以下优点：
11、应用本专利技术的方案，由于dma控制器包括锁定状态及未锁定状态，进而在锁定状态下，获取到第一写操作控制信号后，先读取预先存储的设备身份标识信息，再基于所述预先存储的设备身份标识信息，对执行第一写操作的设备进行身份验证，后续可以在身份验证通过后，才对所述dma控制器中相应通道的寄存器执行第一写操作。这样，只有身份验证通过的设备才允许对dma控制器进行写入，防止dma控制器被非法写入，从而可以使得dma控制器具有安全识别功能，满足信息保护要求。
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【技术保护点】
1.一种DMA控制器的控制方法，其特征在于，DMA控制器包括锁定状态及未锁定状态；在锁定状态下，所述方法包括：
2.如权利要求1所述的DMA控制器的控制方法，其特征在于，所述获取所述预先存储的设备身份标识信息并与所述DMA控制器进行绑定，包括：
3.如权利要求2所述的DMA控制器的控制方法，其特征在于，在锁定状态下，所述方法还包括：
4.如权利要求3所述的DMA控制器的控制方法，其特征在于，所述解锁指示信号，是基于所述安全配置寄存器中第一预设地址空间写入第一预设值且第三预设地址空间写入第三预设值所产生的。
5.如权利要求1所述的DMA控制器的控制方法，其特征在于，还包括：
6.如权利要求1至5任一项所述的DMA控制器的控制方法，其特征在于，所述第一写操作控制信号中携带传输地址模式配置信息；所述传输地址模式配置信息用于配置下一次数据传输的传输地址模式。
7.如权利要求6所述的DMA控制器的控制方法，其特征在于，所述传输地址模式包括：传输地址递增模式及交织模式；在所述传输地址递增模式下，每次数据传输地址按照预设大小递增；在交织模式下，数据存储空间划分为两段以上，每段数据存储空间内数据传输地址是连续的。
8.一种DMA控制器，其特征在于，DMA控制器包括锁定状态及未锁定状态；所述DMA控制器包括：
9.如权利要求8所述的DMA控制器，其特征在于，所述锁定单元，适于获取第二写操作控制信号，从所述第二写操作控制信号中得到所述预先存储的设备身份标识信息；以及将所述预先存储的设备身份标识信息存储至所述安全配置寄存器的第二预设地址空间内，实现与所述DMA控制器的绑定。
10.如权利要求8所述的DMA控制器，其特征在于，所述DMA控制器还包括：解锁单元，适于响应于解锁指示信号，将所述DMA控制器由锁定状态转换为未锁定状态，所述解锁指示信号是基于所述第一写操作所产生的。
11.如权利要求10所述的DMA控制器，其特征在于，所述总线从接口单元适于在所述安全配置寄存器中第一预设地址空间写入第一预设值且第三预设地址空间写入第三预设值时，产生所述解锁指示信号。
12.如权利要求8所述的DMA控制器，其特征在于，还包括：
13.如权利要求8至12任一项所述的DMA控制器，其特征在于，所述第一写操作控制信号中携带传输地址模式配置信息；所述传输地址模式配置信息用于配置下一次数据传输的传输地址模式。
14.如权利要求13所述的DMA控制器，其特征在于，所述传输地址模式包括：传输地址递增模式及交织模式；在所述传输地址递增模式下，每次数据传输地址按照预设大小递增；在交织模式下，数据存储空间划分为两段以上，每段数据存储空间内数据传输地址是连续的。
15.如权利要求14所述的DMA控制器，其特征在于，所述DMA控制器还包括：递增模式寄存器组及交织模式寄存器组；所述递增模式寄存器组适于存储传输地址递增模式的配置信息；所述交织使能寄存器组适于存储交织模式的配置信息。
16.如权利要求15所述的DMA控制器，其特征在于，所述递增模式寄存器组包括：单次请求内数据传输个数寄存器、本次数据传输总数据量寄存器以及通道控制寄存器；其中，所述通道控制寄存器适于指示递增子模式。
17.如权利要求16所述的DMA控制器，其特征在于，所述通道控制寄存器适于存储第一配置值、第二配置值及第三配置值，所述第一配置值适于指示相邻两次DMA请求的数据传输地址增量，所述第二配置值适于指示单次DMA请求内相邻两次数据传输地址增量，所述第三配置值适于指示数据传输地址连续模式；所述第一配置值、第二配置值及第三配置值共同确定所述递增子模式。
18.如权利要求15所述的DMA控制器，其特征在于，所述交织模式寄存器组，包括：交织使能寄存器、传输次数寄存器、交织模式段数寄存器以及颗粒度寄存器。
19.一种车规级芯片，其特征在于，包括权利要求8至18任一项所述的DMA控制器。
20.一种计算机可读存储介质，其上存储有计算机程序，其特征在于，所述计算机程序被处理器执行，以实现权利要求1至7任一项所述方法的步骤。
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【技术特征摘要】
1.一种dma控制器的控制方法，其特征在于，dma控制器包括锁定状态及未锁定状态；在锁定状态下，所述方法包括：
2.如权利要求1所述的dma控制器的控制方法，其特征在于，所述获取所述预先存储的设备身份标识信息并与所述dma控制器进行绑定，包括：
3.如权利要求2所述的dma控制器的控制方法，其特征在于，在锁定状态下，所述方法还包括：
4.如权利要求3所述的dma控制器的控制方法，其特征在于，所述解锁指示信号，是基于所述安全配置寄存器中第一预设地址空间写入第一预设值且第三预设地址空间写入第三预设值所产生的。
5.如权利要求1所述的dma控制器的控制方法，其特征在于，还包括：
6.如权利要求1至5任一项所述的dma控制器的控制方法，其特征在于，所述第一写操作控制信号中携带传输地址模式配置信息；所述传输地址模式配置信息用于配置下一次数据传输的传输地址模式。
7.如权利要求6所述的dma控制器的控制方法，其特征在于，所述传输地址模式包括：传输地址递增模式及交织模式；在所述传输地址递增模式下，每次数据传输地址按照预设大小递增；在交织模式下，数据存储空间划分为两段以上，每段数据存储空间内数据传输地址是连续的。
8.一种dma控制器，其特征在于，dma控制器包括锁定状态及未锁定状态；所述dma控制器包括：
9.如权利要求8所述的dma控制器，其特征在于，所述锁定单元，适于获取第二写操作控制信号，从所述第二写操作控制信号中得到所述预先存储的设备身份标识信息；以及将所述预先存储的设备身份标识信息存储至所述安全配置寄存器的第二预设地址空间内，实现与所述dma控制器的绑定。
10.如权利要求8所述的dma控制器，其特征在于，所述dma控制器还包括：解锁单元，适于响应于解锁指示信号，将所述dma控制器由锁定状态转换为未锁定状态，所述解锁指示信号是基于所述第一写操作所产生的。
11.如权利要求10所述的dma控制器，其特征在于，所述总线从接口单元适于在所述安全配置寄存器中第一预设...
【专利技术属性】
技术研发人员：邹阳，李哲盛，王端秀，周耀，于立明，郭璐，周牧川，
申请(专利权)人：上海朔集半导体科技有限公司，
类型：发明
国别省市：
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