System.ArgumentOutOfRangeException: 索引和长度必须引用该字符串内的位置。 参数名: length 在 System.String.Substring(Int32 startIndex, Int32 length) 在 zhuanliShow.Bind() 一种基于FPGA的关于IEEE1149.10标准的高带宽测试数据的CRC校验方法技术_技高网

一种基于FPGA的关于IEEE1149.10标准的高带宽测试数据的CRC校验方法技术

技术编号:40673385 阅读:5 留言:0更新日期:2024-03-18 19:10
本发明专利技术是一种基于FPGA的关于IEEE1149.10标准的高带宽测试数据的CRC校验方法,包括:三个存储模块,存储模块一和存储模块二用于交替接收待校验数据,在接收的同时进行CRC校验,校验正确则写入存储模块三,否则发送校验错误信息;CRC校验方式采用连续并行校验的思路,不受数据长短不一的影响。以上存储模块一和存储模块二交替接收数据,极大缓解了IEEE1149.10标准要求的高带宽测试数据传输压力,在第三存储模块中存放校验正确的数据,为后续数据的进一步处理提供了便利。

【技术实现步骤摘要】

本专利技术涉及数据通信,尤其涉及一种基于fpga的crc校验方法。


技术介绍

1、信息在传递过程中,可能因某种原因使传输的数据发生错误。为减少和避免这类错误的发生,除提高硬件的可靠性外,在数据的编码上也应提供检错和纠错的支持。具体做法是:在要传送的数据代码中加入若干个校验位,使之在传送过程中若发生错误则会生成非法代码而被发现,甚至能根据非法代码确定错误的位置而给予纠正,这种具有检错或纠错能力的编码即校验码。crc码也叫循环冗余校验码,它是一种高效能的检错和纠错码,它可以把99.997%以上的各种错误都检查出来,是数据通信领域中最常用的一种差错校验码;其特征是信息字段和校验字段的长度可以任意选定。

2、fpga作为一种可编程的硬件解决方案,为crc校验的实现提供了灵活性和性能优势。在通信领域,例如以太网、usb、pci express等协议中,crc校验被用于检测数据传输过程中可能发生的位翻转、噪声引入等问题。通过在fpga中实现硬件级别的crc逻辑,可以有效提高校验速度,减小通信延迟,同时降低对主处理器的负担。


技术实现思路

1、为解决现有校验技术在ieee1149.10标准中高带宽测试数据的校验准确性不足和效率低下的问题,本申请提供了一种基于fpga的关于ieee1149.10标准的高带宽测试数据的crc校验方法。

2、一种基于fpga的关于ieee1149.10标准的高带宽测试数据的crc校验方法,包括如下步骤:

3、步骤一:存储模块一和crc校验模块接收待校验数据,接收的同时校验数据;

4、步骤二:校验正确则存储模块一的数据写入存储模块三,校验错误则发送错误信息;

5、步骤三:存储模块二和crc校验模块接收下一个待校验数据,接收的同时校验数据;

6、步骤四:校验正确则存储模块二的数据写入存储模块三,校验错误则发送错误信息;到此,回到步骤一。

7、优选地,所述存储模块一和存储模块二为交替存储数据的两个存储模块,且两个存储模块由存储选择模块控制,包括:

8、存储模块在接收数据的同时,同步进行校验,接收完成,校验也随即完成,对于存储模块一,接受数据确认校验正确后,存储模块一的数据会立即写入到存储模块三中,并且在写入的过程中,由存储选择模块控制开启存储模块二开始接收数据,同样,存储模块二接收的同时crc校验模块同步校验数据,校验正确则存储模块二的数据也会立即写入存储模块三,并由存储选择模块控制存储模块一接收数据。

9、优选地,所述发送错误信息包括:

10、s1:将含有错误数据的存储模块的信息传输给cpu;

11、s2:cpu根据该信息,发送命令给逻辑控制模块,控制清除对应存储模块中的数据,逻辑控制模块同时将错误数据对应的id值返回给cpu,以此锁定需要重新发送的数据。

12、优选地,由于高带宽数据通常需要多个周期输入,因此crc校验采用并行连续校验的方式,在一周期数据输入的同时,crc校验结果立即被计算出来,计算结果作为下一周期输入数据的校验初始值返回给crc校验模块使用,下一周期的计算结果,同样会作为其下一周期的校验初始值,依次计算加传递,直到整个数据被校验完成。由此,每个周期的输入数据和校验得以同步,达到了数据边输入边校验的效果。

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【技术保护点】

1.一种基于FPGA的关于IEEE1149.10标准的高带宽测试数据的CRC校验方法,其特征在于,包括以下步骤:

2.如权利要求1所述的一种基于FPGA的关于IEEE1149.10标准的高带宽测试数据的CRC校验方法,其特征在于,所述步骤一和步骤三涉及的CRC校验包括:

3.如权利要求2所述的一种基于FPGA的关于IEEE1149.10标准的高带宽测试数据的CRC校验方法,其特征在于,所述CRC校验方式采用连续并行校验的方式包括:

4.如权利要求1所述的一种基于FPGA的关于IEEE1149.10标准的高带宽测试数据的CRC校验方法,其特征在于,所述步骤二和步骤四包括:

5.如权利要求3所述的一种基于FPGA的关于IEEE1149.10标准的高带宽测试数据的CRC校验方法,其特征在于,所述连续并行校验方式包括:

6.如权利要求4所述的一种基于FPGA的关于IEEE1149.10标准的高带宽测试数据的CRC校验方法,其特征在于,所述ID值依据IEEE1149.10标准要求附于有效数据的最前端,被最先接收和校验。

【技术特征摘要】

1.一种基于fpga的关于ieee1149.10标准的高带宽测试数据的crc校验方法,其特征在于,包括以下步骤:

2.如权利要求1所述的一种基于fpga的关于ieee1149.10标准的高带宽测试数据的crc校验方法,其特征在于,所述步骤一和步骤三涉及的crc校验包括:

3.如权利要求2所述的一种基于fpga的关于ieee1149.10标准的高带宽测试数据的crc校验方法,其特征在于,所述crc校验方式采用连续并行校验的方式包括:

4.如权利要求1所述...

【专利技术属性】
技术研发人员:黄新何堂泉杨竞波周雨宇何玉荣
申请(专利权)人:桂林电子科技大学
类型:发明
国别省市:

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