【技术实现步骤摘要】
本说明书涉及通信，尤其涉及一种时钟同步的方法和业务板。
技术介绍
1、现代通信网络中，时间同步技术作为一种通用技术得到广泛的应用。常用的时钟同步技术有ntp和ptp两种，它们的时间同步精度分别在ms和ns级别。在5g时代，无人驾驶、无人物流等行业应用都需要高精度时间同步，运营商在5g接入/汇聚/核心设备的开发指标中明确提出了单台设备cte不能超过+/-10ns，要满足这个要求，需要采用ptp时钟同步技术。
2、目前，ptp时钟同步技术有两种模式：
3、1、1588非混合模式：1588报文实现频率和时间同步
4、2、1588混合模式：synce实现频率同步，1588报文实现时间同步
5、在分布式系统中，一般都会有一个时钟板，时钟板上运行1588协议栈，通过获取本地设备和上游设备1588报文中的时间戳信息，计算出本地设备和上游设备的时间偏差，将偏差值同步到所有业务板上。
6、在分布式系统中，要保证高精度时间同步，时钟板和业务板之间的时间和频率信息需要互相同步，其中主控上的时钟板是唯一的，业务板可能有很多个(常见的有4/6/8/16)。要实现高精度时钟同步，背板上需要的信号数量为4*n(n为业务板数量)。
技术实现思路
1、为克服相关技术中存在的问题，本说明书提供了一种时钟同步的方法和业务板。
2、根据本说明书实施例的第一方面，提供一种时钟同步的方法，所述方法包括：
3、业务板通过自身的mux电路与主控板
4、所述mux电路与所述业务板的接收电路、发送电路和tsu模块连接用于根据第一信号和第二信号提供时钟信号。
5、其中，所述第一信号包括：line_clk信号，所述第二信号包括：txd_clk信号；
6、其中，line_clk信号用于发送打戳时钟和\或接收线路恢复时钟，所述txd_clk信号用于提供发送数据时钟和\或发送打戳时钟。
7、可选的，所述方法还包括：
8、在1588非混合模式中，所述line_clk信号用于为业务板提供打戳时钟，所述txd_clk信号用于提供发送数据时钟；
9、在1588混合模式中，所述line_clk信号用于接收线路恢复时钟，所述txd_clk信号用于发送数据时钟和打戳时钟。
10、其中，所述mux电路通过cpld或fpga建立。
11、通过上述实施例可以看出，通过mux电路通过背板与时钟板连接，可以在同样业务板数量的系统中，减少背板信号数量，简化背板设计，同时在不增加背板尺寸和连接器数量的前提下，能够增加系统支持的业务板数量，节省开发成本。
12、根据本说明书实施例的第二方面，提供一种业务板，所述业务板包括：mux电路，所述mux电路一侧通过背板与主控板中的时钟板连接，另一侧与业务板的接收电路、发送电路和tsu模块连接，所述mux电路包括：
13、接收模块，用于接收时钟板发送的第一信号和第二信号；
14、发送模块，用于根据第一信号和第二信号为接收电路、发送电路和tsu模块提供时钟信号。
15、其中，所述第一信号包括：line_clk信号，所述第二信号包括：txd_clk信号；
16、其中，line_clk信号用于发送打戳时钟和\或接收线路恢复时钟，所述txd_clk信号用于提供发送数据时钟和\或发送打戳时钟。
17、其中，在1588非混合模式中，所述发送模块，具体用于发送line_clk信号用于为业务板提供打戳时钟，发送txd_clk信号用于提供发送数据时钟；
18、在1588混合模式中，所述发送模块，具体用于发送txd_clk信号用于发送数据时钟和打戳时钟，所述接收模块，用于接收线路恢复时钟。
19、应当理解的是，以上的一般描述和后文的细节描述仅是示例性和解释性的，并不能限制本说明书。
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1.一种时钟同步的方法，其特征在于，所述方法应用于业务板，所述方法包括：
2.根据权利要求1所述的方法，其特征在于，所述第一信号包括：LINE_CLK信号，所述第二信号包括：TXD_CLK信号；
3.根据权利要求2所述的方法，其特征在于，所述方法还包括：
4.根据权利要求1所述的方法，其特征在于，所述MUX电路通过CPLD或FPGA构建。
5.一种业务板，其特征在于，所述业务板包括：MUX电路，所述MUX电路一侧通过背板与主控板中的时钟板连接，另一侧与业务板的接收电路、发送电路和TSU模块连接，所述MUX电路包括：
6.根据权利要求5所述的业务板，其特征在于，所述第一信号包括：LINE_CLK信号，所述第二信号包括：TXD_CLK信号；
7.根据权利要求5所述的业务板，其特征在于，
【技术特征摘要】
1.一种时钟同步的方法，其特征在于，所述方法应用于业务板，所述方法包括：
2.根据权利要求1所述的方法，其特征在于，所述第一信号包括：line_clk信号，所述第二信号包括：txd_clk信号；
3.根据权利要求2所述的方法，其特征在于，所述方法还包括：
4.根据权利要求1所述的方法，其特征在于，所述mux电路通过cpld或fpga构建。
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