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控制移位分组数据的位校正的装置制造方法及图纸

技术编号:4015696 阅读:267 留言:0更新日期:2012-04-11 18:40
本发明专利技术涉及控制移位分组数据的位校正的装置,提供一种在处理器中加入支持典型的多媒体应用所要求的分组数据上的操作的指令集的装置。在一个实施例中,本发明专利技术包括具有存储区(150)、解码器(165)及多个电路(130)的处理器。该多个电路提供若干指令的执行来操作分组数据。在这一实施例中,这些指令包含组装、分解、分组乘法、分组加法、分组减法、分组比较及分组移位。(*该技术在2016年保护过期,可自由使用*)

【技术实现步骤摘要】

本专利技术具体涉及计算机系统领域。更具体地,本专利技术涉及分组数据操作领域。
技术介绍
在典型的计算机系统中,将处理器实现为利用产生一种结果的指令在由大量的位 (如64)表示的值上操作。例如,执行加法指令将第一个64位值与第二个64位值相加并 作为第三个64位值存储该结果。然而,多媒体应用(诸如以计算机支持的协作为目的的应 用(CSC-电话会议与混合媒体数据处理的集成)、2D/3D图形、图象处理、视频压缩/解压、 识别算法与音频处理)要求处理可以用少量的位表示的大量数据。例如,图形数据通常需 要8或16位,声音数据通常需要8或16位。这些多媒体应用的各个需要一种或多种算法, 各需要若干操作。例如,算法可能需要加法、比较及移位操作。为了改进多媒体应用(以及具有相同特征的其它应用),先有技术处理器提供分 组数据格式。分组数据格式中通常用来表示单个值的位被分成若干固定长度的数据元素, 各元素表示单独的值。例如,可将一个64位寄存器分成两个32位元素,各元素表示一个单 独的32位值。此外,这些先有技术处理器提供并行分开处理这些分组数据类型中各元素的 指令。例如,分组的加法指令将来自第一分本文档来自技高网...

【技术保护点】
一种计算机系统,包括:包含第一寄存器的处理器;以及耦合在所述处理器上的存储区,其中存储有:在第一分组数据及第二分组数据上操作的组装指令,所述第一分组数据至少包含第一数据元素及第二数据元素,所述第二分组数据至少包含第三数据元素及第四数据元素,所述第一数据元素,所述第二数据元素、所述第三数据元素及所述第四数据元素均包含一组位,所述处理器响应接收所述组装指令,组装所述第一数据元素、所述第二数据元素、所述第三数据元素及所述第四数据元素的每一个的一部分以构成第三分组数据;在第四分组数据及第五分组数据上操作的分解指令,所述第四分组数据至少包含第五数据元素及第六数据元素,所述第五分组数据至少包含对应于所述第...

【技术特征摘要】
...

【专利技术属性】
技术研发人员:AD佩勒格Y雅里M米塔尔LM门内梅尔B艾坦AF格卢C杜龙E科瓦施W维特
申请(专利权)人:英特尔公司
类型:发明
国别省市:US[美国]

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