【技术实现步骤摘要】
增益均衡器和控制增益均衡器的可调增益的方法
[0001]本专利技术涉及增益均衡,更具体地,涉及增益均衡器和用于控制增益均衡器的可调增益的方法。
技术介绍
[0002]增益均衡器(gain equalizer)通常放置在并行信号路径中,用于补偿由一些路径设置和相移(phase
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shifting)操作引起的增益变化。最好设计一个具有精细增益步长分辨率(fine gain step resolution)、宽增益调谐范围和小相位变化的增益均衡器,以用于不同增益设置。实际上,当在增益均衡器中加入一些模块来实现上述设计要求时,增益均衡器的设计可能面临几个挑战。例如,这些块可能导致绝对增益值、频率上的增益平坦度、线性噪声相关性能等对工艺变化(process variation)敏感,并且可能会大大增加整体功耗,以确保上述设计要求可以在所有工艺角(process corner)下能够实现。
[0003]因此,需要一种新颖的增益均衡器架构和相关方法,其可以使增益均衡器满足设计要求而不引入任何副作用或以不太可能引入副作用的方式。
技术实现思路
[0004]本专利技术的一个目的是提供一种增益均衡器和一种用于控制增益均衡器的可调增益的方法,以优化增益均衡器的整体性能(包括关于不同增益设置的增益步长分辨率、增益调谐范围、最小的相位变化等),而不会恶化与增益精度、增益平坦度、线性度、噪声等相关的性能。
[0005]本专利技术的至少一个实施例提供了一种增益均衡器。增益均衡器包括第一共源极级(c ...
【技术保护点】
【技术特征摘要】
1.一种增益均衡器,其特征在于,包括:第一共源极级,被配置为将可调增益施加到输入信号,以生成放大信号,其中,所述第一共源极级包括:第一输入晶体管和第二输入晶体管,被配置为分别通过所述第一输入晶体管的栅极端和所述第二输入晶体管的栅极端接收输入信号;以及第一级联晶体管和第二级联晶体管,分别耦接所述第一输入晶体管和所述第二输入晶体管,用于分别通过所述第一级联晶体管的漏极端和所述第二级联晶体管的漏极端输出所述放大信号,以及第一开关阵列,耦接于所述第一级联晶体管的源极端和所述第二级联晶体管的源极端之间,其中所述可调增益是根据所述第一开关阵列的等效阻抗控制的。2.如权利要求1所述的增益均衡器,其特征在于,所述第一开关阵列包括多个开关,所述多个开关并联连接在所述第一级联晶体管的源极端和所述第二级联晶体管的源极端之间。3.如权利要求2所述的增益均衡器,其特征在于,所述第一开关阵列的等效阻抗是通过控制所述多个开关中的开关的导通或关断确定的。4.如权利要求2所述的增益均衡器,其特征在于,所述第一输入晶体管、第二输入晶体管、第一级联晶体管和第二级联晶体管中每个晶体管为N型晶体管,所述多个开关中的每个开关包括N型晶体管。5.如权利要求2所述的增益均衡器,其特征在于,所述第一输入晶体管、第二输入晶体管、第一级联晶体管和第二级联晶体管中每个晶体管为P型晶体管,所述多个开关中的每个开关包括P型晶体管。6.如权利要求1所述的增益均衡器,其特征在于,还包括:第二共源极级,包括:第三输入晶体管和第四输入晶体管,被配置为分别通过所述第三输入晶体管的栅极端和所述第四输入晶体管的栅极端接收所述输入信号;以及第三级联晶体管与第四级联晶体管,其中所述第三级联晶体管耦接于所述第三输入晶体管与所述第一级联晶体管的漏极端之间,所述第四级联晶体管耦接于所述第四输入晶体管与所述第二级联晶体管的漏极端之间;以及第二开关阵列,耦接于所述第三级联晶体管的源极端和所述第四级联晶体管的源极端之间,其中所述可调增益是还根据所述第二开关阵列的等效阻抗控制的。7.如权利要求6所述的增益均衡器,其特征在于,所述第一输入晶体管、第二输入晶体管、第一级联晶体管和第二级联晶体管中每个级联晶体管是N型晶体管,所述第一开关阵列中的各开关包括N型晶体管,所述第三输入晶体管、所述第四输入晶体管、所述第三级联晶体管和所述第四级联晶体管中每个晶体管为P型晶体管,以及所述第二开关阵列中的每个开关包括P型晶体管。8.如权利要求1所述的增益均衡器,其特征在于,所述第一开关阵列包括多个串联的开关子阵列,所述多个开关子阵列中的每个开关子阵列的等效阻抗是可调的。9.如权利要求8所述的增益均衡器,其特征在于,所述每个开关子阵列包括并联在所述每个开关子阵列的第一端和第二端之间的多个开关,所述多个开关子阵列经由每个开关子
阵列的所述第一端和所述第二端串联连接。10.如权利要求1所述的增益均衡器,其特征在于,还包括:变压器,耦接所述第一级联晶体管的漏极端和所述第二级联晶体管的漏极端,用于将所述放大信号转换为输出信号。11.一种增益均衡器可调增...
【专利技术属性】
技术研发人员:邓志明,仲潜,高立,
申请(专利权)人:联发科技股份有限公司,
类型:发明
国别省市:
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