本申请实施例中提供了一种操作指令处理方法、装置、设备及存储介质，涉及计算机技术领域，该方法包括：在数据存储模块中获取待处理交易数据；所述数据存储模块包括加载存储未命中队列单元和非缓存单元；通过所述加载存储未命中队列单元对多个所述交易数据进行分流处理，得到非缓存交易数据和其他交易数据；将所述非缓存交易数据发送至所述非缓存单元，以通过所述非缓存单元将所述非缓存交易数据写入内存模块，以及将所述其他交易数据写入所述内存模块。该方案使得非缓存交易数据和其他交易数据在写入内存模块的过程中相互不受影响，并且保证了执行资源的最大化利用，无需耗费大量的时间，进一步提高了数据传输效率。进一步提高了数据传输效率。进一步提高了数据传输效率。
【技术实现步骤摘要】
操作指令处理方法、装置、设备及存储介质
[0001]本申请涉及计算机
，具体地，涉及一种操作指令处理方法、装置、设备及存储介质。
技术介绍
[0002]随着计算机设备的快速发展，中央处理器（CPU，Central Processing Unit）作为一台计算机设备的运算和控制核心，其功能主要是完成对计算机指令的执行和对数据的处理，在计算复杂度不断增大的过程中，CPU的性能也变得越来越重要。其中，计算机设备上运行的计算机程序的本质是指令的执行过程，该指令可以包括Load/Store指令，为了提高计算机设备中CPU的性能，如何降低计算机指令的执行时间显得尤为重要。
[0003]目前，在CPU中指令的处理过程中，以Non
‑
Cacheable Store指令为例，通过先将Non
‑
Cacheable Store指令的Transaction（传输）经过取指、解码、然后分配至访存单元进行处理，并传输至访存单元中的DCACHE（Data Cache），在DCACHE中通过BIU单元将数据写出到内存中，然而该方案中当批量的数据进行传输时，一个总线载体仅传输了1byte的有效数据，造成了执行资源的浪费，且执行时间过长，导致数据传输效率较低。
技术实现思路
[0004]本申请实施例中提供了一种操作指令处理方法、装置、设备及存储介质。
[0005]本申请实施例的第一个方面，提供了一种操作指令处理方法，包括：在数据存储模块中获取待处理交易数据；所述数据存储模块包括加载存储未命中队列单元和非缓存单元；通过所述加载存储未命中队列单元对多个所述交易数据进行分流处理，得到非缓存交易数据和其他交易数据；将所述非缓存交易数据发送至所述非缓存单元，以通过所述非缓存单元将所述非缓存交易数据写入内存模块，以及将所述其他交易数据写入所述内存模块。
[0006]在本申请一个可选的实施例中，将所述非缓存交易数据依次发送至所述非缓存单元，包括：将所述非缓存交易数据按照优先级进行排序；按照所述非缓存交易数据的优先级顺序将所述非缓存交易数据依次发送至所述非缓存单元。
[0007]在本申请一个可选的实施例中，按照所述非缓存交易数据的优先级顺序将所述非缓存交易数据依次发送至所述非缓存单元，包括：循环执行指定操作，直至将所有所述非缓存交易数据全部发送至所述非缓存单元为止；所述指定操作包括：按照所述非缓存交易数据的优先级顺序从所述多个非缓存交易数据中确定当前非缓存交易数据，并将所述当前非缓存交易数据发送至所述非缓存单元；所述指定操作第
一次执行时，所述当前非缓存交易数据为初始非缓存交易数据，所述指定操作非第一次执行时，所述当前非缓存交易数据为所述指定操作前一次操作执行后的下一个非缓存交易数据；所述非缓存单元生成接收成功信号并发送至所述加载存储未命中队列单元；所述接收成功信号用于表征接收所述非缓存交易数据成功；判断所述当前非缓存交易数据是否为所有所述非缓存交易数据中的最后一个非缓存交易数据；当不为最后一个非缓存交易数据时，控制进入下一指定操作；当为最后一个非缓存交易数据时，控制不进入下一指定操作。
[0008]在本申请一个可选的实施例中，通过所述非缓存单元将所述非缓存交易数据写入内存模块，包括：所述非缓存单元接收所述加载存储未命中队列单元发送的第一非缓存交易数据；获取传输总线模块的载体承载宽度；当接收的第一非缓存交易数据的大小满足所述载体承载宽度时，通过所述传输总线模块将所述第一非缓存交易数据写入所述内存模块。
[0009]在本申请一个可选的实施例中，通过所述非缓存单元将所述非缓存交易数据写入内存模块，包括：当所述非缓存单元超过预设时间内未接收到非缓存交易数据时，获取所述非缓存单元目前接收的所有的第二非缓存交易数据；通过所述传输总线模块将所述第二非缓存交易数据写入所述内存模块。
[0010]在本申请一个可选的实施例中，通过所述非缓存单元将所述非缓存交易数据写入内存模块，包括：所述非缓存单元接收所述加载存储未命中队列单元发送的第三非缓存交易数据；获取传输总线模块的载体承载宽度；当接收的第三非缓存交易数据的大小超过所述载体承载宽度时，获取所述非缓存单元目前接收的所有的第四非缓存交易数据；通过所述传输总线模块将所述第四非缓存交易数据写入所述内存模块。
[0011]在本申请一个可选的实施例中，通过所述加载存储未命中队列单元对多个所述交易数据进行分流处理，得到非缓存交易数据和其他交易数据，包括：获取多个所述待处理交易数据的数据标识和数据属性；根据所述数据标识和所述数据属性，按照预设的数据分流规则，将所述多个所述交易数据进行分流处理，得到非缓存交易数据和其他交易数据。
[0012]本申请实施例的第二个方面，提供了一种操作指令处理装置，包括：获取模块，用于在数据存储模块中获取待处理交易数据；所述数据存储模块包括加载存储未命中队列单元和非缓存单元；分流模块，用于通过所述加载存储未命中队列单元对多个所述交易数据进行分流处理，得到非缓存交易数据和其他交易数据；写入模块，用于将所述非缓存交易数据发送至所述非缓存单元，以通过所述非缓存单元将所述非缓存交易数据写入内存模块，以及将所述其他交易数据写入所述内存模
Store指令的Transaction（传输）经过IFU取指单元取指、执行单元解码、然后分配至访存单元进行处理，并传输至访存单元中的DCACHE（Data Cache），在DCACHE中通过BIU单元将数据写出到内存单元MEM（Memory）中，从而完成指令的处理流程。
[0020]其中，取指单元的作用是从IRAM中按需获取指令，并将该指令发送给后续单元，后续单元例如可以是执行单元。
[0021]需要说明的是，随着计算机架构的不断发展，在RISC
‑
V是一个基于精简指令集（RISC）原则的第五代开源指令集架构（ISA），在RISC
‑
V架构集中，有四种写指令，分别包括SB（Store Byte）、SH（Store Half
‑
Word）、(F)SW（(Float) Store Word）、(F)SD（(Float) Store Double Word），其中，每个指令每次操作的数据量的大小也不相同，例如（1个字节）8bits、（2个字节）16bits、（4个字节）32bits、（8个字节）64bits，以将数据写入到MEM中。在实际应用场景中，SB指令使用的居多，一次只能操作一个字节，即8bits数据。
[0022]请参见图2所示，一个Non
‑
Cacheable Store指令的SB Transaction在DCACHE子单元中的完整传输过程可以包括五个步骤：
①
待写入的数据Transaction（大小为1byte，整个总线宽度为（BUS_DW宽度/8）bytes，将1byte写入MEM单元的数据使用（BUS_DW/8）bytes总线宽度的载体承载，
②
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【技术保护点】
【技术特征摘要】
1.一种操作指令处理方法，其特征在于，包括：在数据存储模块中获取待处理交易数据；所述数据存储模块包括加载存储未命中队列单元和非缓存单元；通过所述加载存储未命中队列单元对多个所述交易数据进行分流处理，得到非缓存交易数据和其他交易数据；将所述非缓存交易数据发送至所述非缓存单元，以通过所述非缓存单元将所述非缓存交易数据写入内存模块，以及将所述其他交易数据写入所述内存模块。2.根据权利要求1所述的方法，其特征在于，将所述非缓存交易数据发送至所述非缓存单元，包括：将所述非缓存交易数据按照优先级进行排序；按照所述非缓存交易数据的优先级顺序将所述非缓存交易数据依次发送至所述非缓存单元。3.根据权利要求2所述的方法，其特征在于，按照所述非缓存交易数据的优先级顺序将所述非缓存交易数据依次发送至所述非缓存单元，包括：循环执行指定操作，直至将所有所述非缓存交易数据全部发送至所述非缓存单元为止；所述指定操作包括：按照所述非缓存交易数据的优先级顺序从所述多个非缓存交易数据中确定当前非缓存交易数据，并将所述当前非缓存交易数据发送至所述非缓存单元；所述指定操作第一次执行时，所述当前非缓存交易数据为初始非缓存交易数据，所述指定操作非第一次执行时，所述当前非缓存交易数据为所述指定操作前一次操作执行后的下一个非缓存交易数据；所述非缓存单元生成接收成功信号并发送至所述加载存储未命中队列单元；所述接收成功信号用于表征接收所述非缓存交易数据成功；判断所述当前非缓存交易数据是否为所有所述非缓存交易数据中的最后一个非缓存交易数据；当不为最后一个非缓存交易数据时，控制进入下一指定操作；当为最后一个非缓存交易数据时，控制不进入下一指定操作。4.根据权利要求1所述的方法，其特征在于，通过所述非缓存单元将所述非缓存交易数据写入内存模块，包括：所述非缓存单元接收所述加载存储未命中队列单元发送的第一非缓存交易数据；获取传输总线模块的载体承载宽度；当接收的第一非缓存交易数据的大小满足所述载体承载宽度时，通过所述传输总线模块将所述第一非缓存交易数...
【专利技术属性】
技术研发人员：胡振波，彭剑英，黄颖然，郭淑曼，
申请(专利权)人：芯来智融半导体科技上海有限公司，
类型：发明
国别省市：
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