【技术实现步骤摘要】
【国外来华专利技术】极坐标发射器的数字功率放大器能效最大化系统和方法
[0001]相关申请的交叉引用
[0002]本申请要求申请号为16/241,842,申请日为2019年1月7日,名称为“极坐标发射器的数字功率放大器能效最大化系统和方法”的美国专利申请的优先权,并将其全部内容援引于此。
技术介绍
[0003]高速集成电路技术的最新进展实现了与物联网(IoT)有关的各种创新性多功能应用。对于种类繁多的无线通信应用而言,极为重要的一点是收发器的功耗,尤其电池供电情形下的收发器功耗。
[0004]极坐标发射器为针对调制射频信号的生成提出的高能效方案。此类发射器中使用的高效功率放大器旨在最大程度减小功耗。然而,基于功耗最小化考量的功率放大器选择常常需要在非线性度的增大与放大器性能之间做出权衡取舍。
[0005]在极坐标调制器中,作为第一步,先将承载信息的数字信号以正交调制技术编码,并表征于同相正交(IQ)平面内。正交调制采用笛卡尔坐标x和y。在考虑正交调制时,x轴下称“I”(同相)轴,y轴下称“Q”(正交)轴。
[0006]极坐标调制器通常可包括坐标系转换器,如根据正交调制数字信号生成极坐标相位采样值和极坐标幅度采样值的同相正交至幅度/相位(IQ
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A/P)转换器。正如极坐标与笛卡尔坐标类似一样,极坐标调制也类似于正交调制。极坐标调制采用极坐标r(幅度)和Θ(相位)。正交调制架构向极坐标调制架构的转换也可通过多种已知技术进行。在数学上,这一过程依赖三角几何学。相位Θ的正切等于正交分量(Q)值除以同相分量(I)值 ...
【技术保护点】
【技术特征摘要】
【国外来华专利技术】1.一种极坐标发射器,其特征在于,包括:数字功率放大单元,包括:第一电路,用于接收相位调制载波信号,并且用于以PMOS控制信号和NMOS控制信号具有不同的占空比的方式来生成所述PMOS控制信号和所述NMOS控制信号;以及放大电路,所述放大电路具有输出端,并且包括PMOS晶体管和NMOS晶体管,其中,所述放大电路用于以所述PMOS晶体管接收所述PMOS控制信号,以及以所述NMOS晶体管接收所述NMOS控制信号,其中,所述第一电路用于以所述放大电路的所述NMOS晶体管和所述PMOS晶体管同时导电的时间最大程度减小的方式,将所述PMOS控制信号和所述NMOS控制信号彼此对齐,其中,所述放大电路进一步用于响应来自所述第一电路的所述PMOS控制信号和所述NMOS控制信号而在所述放大电路的所述输出端生成放大调制载波信号。2.如权利要求1所述的极坐标发射器,其特征在于,所述放大调制载波信号具有大约50%的占空比。3.如权利要求1所述的极坐标发射器,其特征在于,所述第一电路用于以所述PMOS控制信号和所述NMOS控制信号防止所述PMOS晶体管和所述NMOS晶体管同时导电的方式,将所述PMOS控制信号和所述NMOS控制信号彼此对齐。4.如权利要求1所述的极坐标发射器,其特征在于,所述PMOS控制信号的占空比大于所述NMOS控制信号的占空比。5.如权利要求1所述的极坐标发射器,其特征在于,所述数字功率放大单元的所述第一电路包括:逻辑电路,用于接收所述相位调制载波信号,并且用于以第一逻辑信号和第二逻辑信号相对于彼此具有不同的上升时间和下降时间的方式来生成所述第一逻辑信号和所述第二逻辑信号。6.如权利要求5所述的极坐标发射器,其特征在于,所述逻辑电路用于以所述第一逻辑信号的上升时间超过所述第二逻辑信号的上升时间并且以所述第二逻辑信号的下降时间超过所述第一逻辑信号的下降时间的方式来生成所述第一逻辑信号和所述第二逻辑信号。7.如权利要求6所述的极坐标发射器,其特征在于,所述相位调制载波信号包括第一相位调制载波信号和第二相位调制载波信号,其中,所述逻辑电路包括第一逻辑PMOS晶体管和第一逻辑NMOS晶体管,所述第一逻辑PMOS晶体管和所述第一逻辑NMOS晶体管中的每一个均用于接收所述第一相位调制载波信号,其中,所述逻辑电路还包括第二逻辑PMOS晶体管和第二逻辑NMOS晶体管,所述第二逻辑PMOS晶体管和所述第二逻辑NMOS晶体管中的每一个均用于接收所述第二相位调制载波信号。8.如权利要求7所述的极坐标发射器,其特征在于,所述逻辑电路构造为使得所述第一逻辑PMOS晶体管响应于所述第一相位调制载波信号的导电慢于所述第二逻辑PMOS晶体管响应于所述第二相位调制载波信号的导电,从而使得所述第一逻辑信号的上升时间超过所述第二逻辑信号的上升时间。9.如权利要求7所述的极坐标发射器,其特征在于,所述逻辑电路构造为使得所述第二逻辑NMOS晶体管响应于所述第二相位调制载波信号的导电慢于所述第一逻辑NMOS晶体管响应于所述第一相位调制载波信号的导电,从而使得所述第二逻辑信号的下降时间超过所
述第一逻辑信号的下降时间。10.如权利要求5所述的极坐标发射器,其特征在于,所述逻辑电路包括MOSFET晶体管,所述MOSFET晶体管当中的至少一个MOSFET晶体管用于在导电时,向所述逻辑电路的所述MOSFET晶体管当中的至少一个其他MOSFET晶体管提供串联电阻,其中,当存在所述串联电阻时,对所述第一逻辑信号和所述第二逻辑信号相对于彼此具有不同的上升时间和不同的下降时间具有贡献。11.如权利要求5所述的极坐标发射器,其特征在于,所述数字功率放大单元的所述第一电路还包括:与所述逻辑电路连接的驱动电路,其中,所述驱动电路用于接收所述第一逻辑信号和所述第二逻辑信号,并用于生成具有不同的占空比的所述PMOS控制信号和所述NMOS控制信号,以使得根据所述第一逻辑信号和所述第二逻辑信号相对于彼此的不同的上升时间和不同的下降时间,所述PMOS控制信号的占空比超过所述NMOS控制信号的占空比。12.如权利要求1所述的极坐标发射器,其特征在于,还包括数字功率放大器,所述数字功率放大器包括:用于接收所述相位调制载波信号的多个数字功率放大单元,其中,所述多个数字功率放大单元包括所述数字功率放大单元。13.如权利要求12所述的极坐标发射器,其特征在于,所述极坐标发射器与所述极坐标接收器共享资源,...
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