【技术实现步骤摘要】
存储器存取系统和存储器存取方法
本专利技术涉及一种存储器存取系统和存储器存取方法。
技术介绍
单一电子装置可配置有多个微控制单元(microcontrolunit,MCU)以及分别对应于不同微控制单元的多个存储器装置,用以执行不同的任务。图1是配置了多个微控制单元以及闪存(flashmemory)的电子装置50的示意图。电子装置50包括微控制单元11以及微控制单元21、其中微控制单元11可耦接至对应的闪存装置12,并且微控制单元21可耦接至对应于微控制单元21的闪存装置22。微控制单元与闪存装置之间可通过串行外设接口闪存接口(serialperipheralinterfaceflashinterface,SPIFI)来进行数据传输。举例来说,微控制单元11与闪存装置12可通过串行外设接口闪存接口31来与彼此进行通信。另一方面,微控制单元之间的通信则需借由集成电路总线(inter-integratedcircuitbus,I2Cbus)实现。举例来说,微控制单元11可通过集成电路总线32通信连接至微控制单元21,从而通过微控制单元21存取闪存装置22的数据。然而,集成电路总线的传输速率较慢。因此,由微控制单元11使用集成电路总线32来存取对应于微控制单元21的闪存装置22,并不是十分有效率。“
技术介绍
”段落只是用来帮助了解本
技术实现思路
,因此在“
技术介绍
”段落所揭露的内容可能包含一些没有构成本领域技术人员所知道的现有技术。在“
技术介绍
”段落所揭露的内容,不代表该内容或者本专利技术一个或多个实施例所要解决 ...
【技术保护点】
1.一种存储器存取系统,其特征在于,所述存储器存取系统包括易失性存储器、非易失性存储器、处理器以及可编程逻辑器件,其中:/n所述可编程逻辑器件耦接所述处理器、所述易失性存储器以及所述非易失性存储器,其中所述可编程逻辑器件在所述存储器存取系统启动时将储存于所述非易失性存储器中的数据储存至所述易失性存储器;以及/n所述处理器经由所述可编程逻辑器件存取来自所述易失性存储器的所述数据。/n
【技术特征摘要】
1.一种存储器存取系统,其特征在于,所述存储器存取系统包括易失性存储器、非易失性存储器、处理器以及可编程逻辑器件,其中:
所述可编程逻辑器件耦接所述处理器、所述易失性存储器以及所述非易失性存储器,其中所述可编程逻辑器件在所述存储器存取系统启动时将储存于所述非易失性存储器中的数据储存至所述易失性存储器;以及
所述处理器经由所述可编程逻辑器件存取来自所述易失性存储器的所述数据。
2.根据权利要求1所述的存储器存取系统,其特征在于,所述存储器存取系统还包括第二处理器,所述第二处理器耦接至所述可编程逻辑器件,其中所述第二处理器经由所述可编程逻辑器件存取来自所述易失性存储器的第二数据。
3.根据权利要求2所述的存储器存取系统,其特征在于,所述第二处理器为数字微镜装置芯片以及图像解析芯片的其中之一,并且所述第二数据为所述第二处理器的固件。
4.根据权利要求2所述的存储器存取系统,其特征在于,所述易失性存储器包括对应于所述处理器的第一分区以及对应于所述第二处理器的第二分区。
5.根据权利要求1所述的存储器存取系统,其特征在于,所述可编程逻辑器件接收来自所述处理器的更新数据以更新所述非易失性存储器中的所述数据。
6.根据权利要求5所述的存储器存取系统,其特征在于,所述可编程逻辑器件将储存于所述非易失性存储器中的经更新的所述数据储存至所述易失性存储器。
7.根据权利要求1所述的存储器存取系统,其特征在于,所述处理器通过串行外设接口闪存接口以及并行总线的其中之一与所述可编程逻辑器件进行数据传输。
8.根据权利要求1所述的存储器存取系统,其特征在于,所述可编程逻辑器件储存对应于所述非易失性存储器的第一设定以及对应于第二非易失性存储器的第二设定,所述处理器可经由以所述第一设定或所述第二设定配置的所述可编程逻辑器件来对所述非易失性存储器进行存取。
9.根据权利要求1所述的存储器存取系统,其特征在于,所述可编程逻辑器件储存对应于所述易失性存储器的第一设定以及对应于第二易失性存储器的第二设定,所述处理器可经由以所述第一设定或所述第二设定配置的所述可编程逻辑器件来对所述易失性存储器进行存取。
10.根据权利要求1所述的存储器存取系统,其特征在于,所述可编程逻辑器件储存对应于所述易失性存储器的第一设定以及对应于所述非易失性存储器的第二设定,所述处理器可经由以所述第一设定或所述第二设定配置的所述可编程逻辑器件来对所述易失性存储器以及所述非易失性存储器进行存取。
11.一种存储器存取方法,适...
【专利技术属性】
技术研发人员:庄景盛,
申请(专利权)人:中强光电股份有限公司,
类型:发明
国别省市:中国台湾;71
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