本发明专利技术涉及一种ＦＰＧＡ仿真装置及其方法，其中装置在目前装置基础上在激励报文生成模块（１４）输入端新增特征字生成模块（１３）；其中方法包括：预先配置含特征字的报文参数并保存至文件中；读取文件获取报文参数自动生成插入对应特征字的激励报文；通过接口模块输出激励报文或接收经由待测ＦＰＧＡ逻辑模块（２）与激励报文对应的响应报文；基于特征字进行报文比较并输出结果。这种装置与现有技术相比，取得了基于特征字的ＦＰＧＡ设计仿真对于效率上进步，可以按照各个测试用例直接仿真求得结果，节省了仿真时间，解决了ＦＰＧＡ验证困难的问题，减少了系统的软硬件设计难度，提高了系统整体设计效率等等。
【技术实现步骤摘要】
本专利技术涉及数据通信，具体涉及FPGA仿真技术。
技术介绍
随着数据通信技术的发展，特别是高带宽高速度的数据通信技术的出现，在数据通信芯片设计上，大规模，高速度，高复杂度的FPGA设计层出不穷，对于FPGA逻辑设计的正确性验证提出了很大的考验，特别是大规模的FPGA设计，其完成的逻辑功能既多又复杂，这样一样就得设计出相应的复杂FPGA验证装置来对FPGA进行仿真验证。现在，用于FPGA仿真的仿真器包括①中国专利技术专利申请“一种软硬件协同仿真/验证系统及矢量模式仿真/验证方法”，申请号200610020631.5，它是软硬件协同仿真的方法，并且须在FPGA内部做一个为了仿真而定制的适配器模块，这个模块本身的正确性与否还需要另外仿真的。又如②PCT专利申请“METHOD AND APPARATUS FOR CO-VERIFICATION OFDIGITAL DESIGNS”，国际公开号WO2005048062，它是一个把处理器逻辑放在FPGA中的设计，是专门为这样的FPGA设计的仿真器设计方法。但是，目前还没有基于特征字的FPGA仿真器或还没有基于特征字的FPGA仿真器被公开。另，本专利技术申请中用到的专业术语及一些重要缩写FPGAField Programmable Gate Array现场可编程门阵列，一种可编程的芯片。PLIProgramming language interface它是verilog-HDL硬件描述语言定义的一个C语言与verilog-HDL语言的程序接口。DUTDesign Under Test待测设计。signature特征字签名。BFMBus Function Module总线功能模型，一个模仿总线行为的模块。ASCII码American standard code for information interchange美国标准交换信息字符集。
技术实现思路
本专利技术需要解决的技术问题是提供一种FPGA仿真装置及其方法，能够基于特征字进行仿真。本专利技术的上述第一个技术问题这样解决，提供一种FPGA仿真方法，利用FPGA仿真装置，包括1.1)预先配置报文参数并保存至文件中，所述报文参数包括对应单个报文中特征字的个数及每个特征字具体位置、长度和内容；1.2)读取所述文件获取所述报文参数自动生成一个或多个激励报文并在每个激励报文中按所述报文参数要求插入对应特征字；1.3)通过各自对应接口模块输出所述激励报文至待测FPGA逻辑模块或接收其响应报文；1.4)基于特征字对所述激励报文及其经由待测FPGA逻辑模块的对应响应报文进行比较并输出结果。。按照本专利技术提供的仿真方法，所述报文参数还包括包长、时间间隔和报文分隔符。按照本专利技术提供的仿真方法，所述激励报文包括包长、间隔、私有协议封装、协议封装、带有特征字的报文内容和报文校验多个单元。按照本专利技术提供的仿真方法，所述步骤1.2)包括向所述激励报文中填充对应包长，间隔及配置好的协议信息。按照本专利技术提供的仿真方法，所述步骤1.2)包括特征字格式变换并向所述激励报文中填充对应16进制ASCII码格式特征字。按照本专利技术提供的仿真方法，所述步骤1.2)还包括判断所述报文参数的合法性，对不符合FPGA逻辑模块要求的不生成对应激励报文。按照本专利技术提供的仿真方法，所述步骤1.4)具体包括7.1)把所述激励报文及其经由待测FPGA逻辑模块输出的响应报文都读入缓存；7.2)判断所述激励报文与响应报文的长度是否相等，是，进入下一步，否则进入步骤7.5)；7.3)读出响应报文中报文头内的私有协议，得出待征字相关的信息；7.4)逐一判断输入报文中的待检测各特征字是否没被找到，是，输出错误信息；否则进一步判断被找到的特征字在响应报文中的位置是否与激励报文中的位置不一样，是，输出错误信息；若无任何错误信息输出直接跳过步骤7.5)和7.6)输出仿真测试成功，否则进入下一步；7.5)汇总错误信息并将各个信息要点编号保存；7.6)根据所述错误信息和编号输出具体仿真测试失败报表。本专利技术的上述另一个技术问题这样解决，提供一种FPGA仿真装置，包括总线接口，测试连接待测FPGA逻辑模块，用于提供报文输入/出接口；激励报文生成模块，输出连接总线接口，用于生成激励报文；报文比较模块，输入连接总线接口和激励报文生成模块，用于比较激励报文及其经由待测FPGA逻辑模块输出的响应报文；特征字生成模块，输出连接激励报文生成模块，用于给激励报文生成模块提供16进制ASCII码特征字并最终由激励报文生成模块生成含特征字的激励报文。。按照本专利技术提供的仿真装置，该装置还包括与所述特征字生成模块输入端依次电连接的配置读取模块和配置输入模块。按照本专利技术提供的仿真装置，该装置还包括与所述报文比较模块输出端依次电连接的验证结果分析模块和验证结果输出模块。按照本专利技术提供的仿真装置，所述总线接口包括 总线接口输入模块总线接口输入模块是FPGA逻辑的接口，它是BFM模块，通过PLI接口将保存好的文本形式的报文读取出来，再模仿FPGA的总线动作将报文输入到FPGA逻辑DUT中去；总线接口输出模块从总线接口输入模块输出的信号由本模块接收，转换成报文的格式并保存成文本文件。本专利技术提供的FPGA仿真装置及其方法，引入了特征字生成和处理并且设计了自动结果比较输出、使FPGA的验证能够精确定位且方便快捷，可以做许多上板之前的调试工作，减小上板调试的难度；另一方面可以制造出可以在完全系统上的测试用的报文，节省了时间，降低了后期系统开发的难度和提高了系统的可靠性，与现有技术相比，取得了基于特征字的FPGA设计仿真对于效率上进步，可以按照各个测试用例直接仿真求得结果，节省了仿真时间，解决了FPGA验证困难的问题，减少了系统的软硬件设计难度，提高了系统整体设计效率等等。附图说明下面结合附图和具体实施例进一步对本专利技术进行详细说明。图1是本专利技术的基于特征字的FPGA仿真器结构图；图2是本专利技术的配置输入文档结构图；图3是本专利技术的激励报文结构图；图4是本专利技术的激励报文生成模块流程图；图5是本专利技术的出入报文比较模块流程图；图6是本专利技术的验证结果分析模块流程图。具体实施例方式如图1所示，本专利技术基于特征字的FPGA仿真器1包括配置输入模块11它是各项报文配置的参数输入器，人工输入这些参数之后本模块把它保存为一个整理好的文本文件以待后期查询之用。配置读取模块12它把配置输入模块11产生文本文件存储的各项参数读取出来，传送给特征字生成模块13。特征字生成模块13它把配置读取模块12传送来的特征字签名按照设计需求分割处理等等，然后把处理完毕后的特征字签名转化为16进制的ASCII码发给激励报文生成模块14。激励报文生成模块14特征字生成模块13中的特征字签名传送过来之后，首先本模块检查各项参数是否符合设计配置的参数要求，如不符合给出错误信息，让重新输入。然后根据各项参数填充报文的包长，间隔，协议，及包内容填充，特征字也按照配置的特征字位置和长度填充。最后加上包的校验字，保存成文本以供后面模块使用。总线接口输入模块15总线接口输入模块15是FPGA逻辑的接口，它是BFM模块，通过PLI接口将保存好的文本形式的报文读取出来，再模仿FPGA的总线动作将报文输入本文档来自技高网...
【技术保护点】
一种ＦＰＧＡ仿真方法，其特征在于，利用ＦＰＧＡ仿真装置（１），包括： １．１）预先配置报文参数并保存至文件中，所述报文参数包括对应单个报文中特征字的个数及每个特征字具体位置、长度和内容； １．２）读取所述文件获取所述报文参数自动生成一个或多个激励报文并在每个激励报文中按所述报文参数要求插入对应特征字； １．３）通过各自对应接口模块输出所述激励报文至待测ＦＰＧＡ逻辑模块（２）或接收其响应报文； １．４）基于特征字对所述激励报文及其经由待测ＦＰＧＡ逻辑模块（２）的对应响应报文进行比较并输出结果。
【技术特征摘要】
【专利技术属性】
技术研发人员：李新双，
申请(专利权)人：中兴通讯股份有限公司，
类型：发明
国别省市：94[中国|深圳]
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