【技术实现步骤摘要】
来自多个远程芯片的数据卸载加速
技术介绍
专用集成电路(ASIC)芯片通常包括边带接口从端口,用于设备配置、管理以及运行时状态和监视功能。该接口可以通过专有的物理/逻辑协议或诸如外围组件互连快速(PCIe)的行业准则定义。诸如微处理器或基板管理控制器(BMC)的处理器可以通过该边带ASIC接口发起事务,以访问和操纵可寻址设备,诸如ASIC中的控制和状态寄存器(CSR)和存储器映射数据结构。附图说明本公开的特征通过示例的方式示出,并且在以下附图中不受限制,在附图中,类似的标号指示类似的元件,在附图中:图1描绘了根据本公开的一个或多个示例的系统架构,在该系统架构内可以实现用于将数据从多个远程芯片卸载到处理器的数据卸载加速器;图2描绘了根据本公开的一个或多个示例的系统架构,在该系统架构内可以实现用于将数据从多个远程芯片卸载到处理器的数据卸载加速器;图3描绘了根据本公开的一个或多个示例的系统架构,在该系统架构内可以实现用于将数据从多个远程芯片卸载到处理器的数据卸载加速器;图4描绘了根据本公开的一个或多个示例 ...
【技术保护点】
1.一种用于将数据从多个远程芯片卸载到处理器的方法,所述方法包括:/n将用于从所述多个远程芯片取回所述数据的多个地址的规范接收到数据卸载加速器的地址缓冲器库中;/n将用于发起对来自所述多个远程芯片的所述数据的捕获的命令接收到所述数据卸载加速器的卸载控制设备中;/n将来自所述多个远程芯片的所述数据并行地捕获到所述数据卸载加速器的数据缓冲器库中;以及/n经由所述卸载控制设备来中断所述处理器,以将所述数据的至少一部分传递到所述处理器。/n
【技术特征摘要】
20190307 US 16/295,8231.一种用于将数据从多个远程芯片卸载到处理器的方法,所述方法包括:
将用于从所述多个远程芯片取回所述数据的多个地址的规范接收到数据卸载加速器的地址缓冲器库中;
将用于发起对来自所述多个远程芯片的所述数据的捕获的命令接收到所述数据卸载加速器的卸载控制设备中;
将来自所述多个远程芯片的所述数据并行地捕获到所述数据卸载加速器的数据缓冲器库中;以及
经由所述卸载控制设备来中断所述处理器,以将所述数据的至少一部分传递到所述处理器。
2.根据权利要求1所述的方法,其中捕获来自所述多个远程芯片的所述数据包括:捕获来自所述多个远程芯片中的所述远程芯片中的每个远程芯片内的多个控制和状态寄存器的遥测数据。
3.根据权利要求1所述的方法,包括:
将用于从所述多个远程芯片取回所述数据的第一部分的、所述多个地址中的第一部分的规范接收到所述地址缓冲器库中;
将用于从所述多个远程芯片取回所述数据的第二部分的、所述多个地址中的第二部分的规范接收到所述地址缓冲器库中;
将所述数据的所述第一部分捕获到所述数据缓冲器库中;
将所述数据的所述第二部分捕获到所述数据缓冲器库中;以及
基于与将所述数据的所述第二部分传递到所述处理器相比的至少一个不同的准则,将所述数据的所述第一部分传递到所述处理器。
4.根据权利要求3所述的方法,包括:
将所述多个地址的所述第一部分的所述规范接收到所述地址缓冲器库的第一地址缓冲器中;
将所述多个地址的所述第二部分的所述规范接收到所述地址缓冲器库的第二地址缓冲器中;
将所述数据的所述第一部分捕获到所述数据缓冲器库的第一数据缓冲器中;以及
将所述数据的所述第二部分捕获到所述数据缓冲器库的第二数据缓冲器中,其中用于将所述数据的所述第一部分和所述数据的所述第二部分传递到所述处理器的所述至少一个不同的准则包括不同的速率或不同的带宽中的一者或两者。
5.根据权利要求1所述的方法,其中将来自所述多个远程芯片的所述数据并行捕获到所述数据缓冲器库中包括:
从所述数据卸载加速器的事务处理逻辑向多个远程芯片并行地发送针对所述数据的多个请求;
由所述事务处理逻辑从所述多个远程芯片并行地接收包含所述数据的多个响应;以及
将所述数据从所述事务处理逻辑并行地转发到所述数据缓冲器库中。
6.根据权利要求1所述的方法,包括将数据并行地写入所述多个远程芯片。
7.根据权利要求6所述的方法,其中将所述数据并行地写入所述多个远程芯片包括:在捕获所述数据之前初始化所述多个远程芯片。
8.根据权利要求1所述的方法,包括:
从所述多个远程芯片接收后续数据,
将所捕获的所述数据和后续数据进行比较;以及
标记与所捕获的所述数据不同的所述后续数据。
9.根据权利要求8所述的方法,包括将与所捕获的所述数据不同的所述后续数据传递到所述处理器。
10.根据权利要求1所述的方法,包括:
将所述数据与一个或多个准则进行比较;
基于所述数据中的至少一些数据满足所述一个或多个...
【专利技术属性】
技术研发人员:N·罗伯森,E·托马斯,D·马西奥洛斯基,E·安格拉达,
申请(专利权)人:慧与发展有限责任合伙企业,
类型:发明
国别省市:美国;US
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