【技术实现步骤摘要】
一种加/脱密数据独立二通道判决系统及其应用
本专利技术属于计算机信息安全
，具体涉及一种加/脱密数据独立二通道判决系统及其应用。
技术介绍
随着计算机应用的普及、互联网及移动存储设备的发展，终端智能程度的提高，存储容量的增大，人们越来越喜欢将一些隐私数据以文件的形式保存在终端中。为了保护用户的隐私，即保证终端中存储的文件的安全，对文件进行加密、解密等处理显得格外重要。如何有效地实现文件进行统一安全存放、集中管理和使用，就成了电子文件目前面临的严峻挑战。现有的网络传输中的数据加/脱密方法是利用加/脱密的算法和加/脱密的密钥对目标数据进行加/脱密，在数据接收方收到该加/脱密数据后通过加/脱密的算法和加/脱密的密钥对该数据进行解密或加密，从而达到传输网络数据的目的，此种做法的特点在于如果是相同的明文数据就有相同的密文数据，但是在加/脱密运算结果出错时，容易导致磁盘阵列数据无法恢复。
技术实现思路
为了解决上述技术问题，本专利技术提供了一种加/脱密数据独立二通道判决系统及其应用。为了达到上述目的，本专利技术的技术方案如下：本专利技术提供一种加/脱密数据独立二通道判决系统...
【技术保护点】
1.一种加/脱密数据独立二通道判决系统，其特征在于，包括嵌入式处理器、协议处理芯片（FPGA0）、第一算法处理芯片（FPGA1）和第二算法处理芯片（FPGA2），所述嵌入式处理器分别与协议处理芯片（FPGA0）、第一算法处理芯片（FPGA1）、第二算法处理芯片（FPGA2）双向电连接，用于对协议处理芯片（FPGA0）进行策略配置和密钥管理、以及对第一算法处理芯片（FPGA1）和第二算法处理芯片（FPGA2）进行密钥配置；所述协议处理芯片（FPGA0）分别与第一算法处理芯片（FPGA1）、第二算法处理芯片（FPGA2）双向电连接，用于将数据包从协议处理芯片（FPGA0）发送到...
【技术特征摘要】
1.一种加/脱密数据独立二通道判决系统，其特征在于，包括嵌入式处理器、协议处理芯片（FPGA0）、第一算法处理芯片（FPGA1）和第二算法处理芯片（FPGA2），所述嵌入式处理器分别与协议处理芯片（FPGA0）、第一算法处理芯片（FPGA1）、第二算法处理芯片（FPGA2）双向电连接，用于对协议处理芯片（FPGA0）进行策略配置和密钥管理、以及对第一算法处理芯片（FPGA1）和第二算法处理芯片（FPGA2）进行密钥配置；所述协议处理芯片（FPGA0）分别与第一算法处理芯片（FPGA1）、第二算法处理芯片（FPGA2）双向电连接，用于将数据包从协议处理芯片（FPGA0）发送到第一算法处理芯片（FPGA1）、第二算法处理芯片（FPGA2）中进行加密/脱密运算后返回。2.根据权利要求1所述的加/脱密数据独立二通道判决系统，其特征在于，所述嵌入式处理器运行嵌入式Linux操作系统。3.根据权利要求1所述的加/脱密数据独立二通道判决系统，其特征在于，所述协议处理芯片（FPGA0）集成有加密组件和脱密组件，所述加密组件和脱密组件由输入端至输出端均依次电连接有FC接口、FC协议解析模块、SM4算法调度模块、加/脱密数据独立二通道判决模块、FC协议封装模块、以及FC接口，所述加密组件和脱密组件的SM4算法调度模块分别与密钥管理模块双向电连接，所述密钥管理模块与第一算法处理芯片（FPGA1）、第二算法处理芯片（FPGA2）双向电连接。4.根据权利要求1所述的加/脱密数据独立二通道判决系统，其特征在于，所述第一算法处理芯片（FPGA1）、第二算法处理芯片（FPGA2）中均分别集成有多个算法处理模块。5.一种加密数据独立二通道判决...
【专利技术属性】
技术研发人员：辛建平，高克，
申请(专利权)人：无锡市同威科技有限公司，
类型：发明
国别省市：江苏,32
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