The present invention provides a transmission circuit that uses the transmission circuit to possibly facilitate error correction of burst errors without increasing the processing load in a plurality of frames composed of a plurality of OTN frame signals. The transmitter circuit comprises: transmitting side signal recognition unit for detecting MFAS and identification of N OTN frame signal sequence; sequence conversion frame unit, which is used for response data signal sequence to the identified sequence to transform the multi frame internal layout; focus on sending unit, which is used for data signal sequence conversion convergence is equal to that of the OTN frame signal length and produce N quasi OTN frame signal; and a transmitting unit for transmitting by the N quasi OTN frame signal composed of the multi frame.
【技术实现步骤摘要】
【国外来华专利技术】发送电路、接收电路、光传送系统以及用于发送多帧的方法
本专利技术涉及发送电路、接收电路、光传送系统以及用于发送多帧的方法,且具体来说涉及发送包括多个OTN(光学传输网络)帧信号的发送电路、接收电路、光传送系统以及用于发送多帧的方法。
技术介绍
随着近年来数据通信容量的增加,在光学通信中,光学波长的多路复用以及传送速度的加速正在发展。在WDM(波分复用)传送中,使用由ITU-T(国际电信联盟电信标准化部门)G.709推荐的OTN的光学通信已成为主流。在ITU-TG.709中,定义与传送速度无关的4080字节/子帧×4行的OTN帧。此OTN帧包括开销和用于补偿传送路径中的质量下降的FEC码(前向纠错码)。在WDM传送中,可由于光纤的传送特性而生成波长与自干扰之间的干扰,从而导致生成突发错误。在ITU-TG.709中,在子帧中在数据信号的序列转换之后生成错误校正码,且在错误校正码生成期间的数据信号的序列被转换(交错),借此错误分散在子帧内部以应付突发错误。在PTL1等中公开交错。此外,在PTL2等中公开一种使用错误校正码来应付突发错误的方法。然而,由于传送速度的增加,错误可校正的突发错误的时间长度变短。虽然针对每一子帧生成错误校正码,子帧的大小是固定的,且因此随着传送速度的增加,每帧时隙相对变短。尽管,例如,OTN帧的最低速度OTU1帧具有2.7Gbps的传送速度以及49微秒的每帧时隙,最高速度OTU4帧具有111.8Gbps的传送速度和1.2微秒的每帧时隙。OTU4帧的时隙近似为OTU1帧的时隙的1/50,且因此,在OTU1中,错误被分散且错误校正可被执行,但 ...
【技术保护点】
一种发送多帧的发送电路,所述多帧包括N个OTN(光学传输网络)帧信号,所述N个OTN(光学传输网络)帧信号中的每一个容纳MFAS(多帧对准信号)和多个数据信号,所述发送电路包括:发送侧信号识别装置,所述发送侧信号识别装置用于检测所述MFAS,并且识别所述OTN帧信号的次序i(1≤i≤N);多帧内序列转换装置,所述多帧内序列转换装置用于根据所识别的次序i来在所述多帧内转换所述多个数据信号的序列;发送侧重布置装置,所述发送侧重布置装置用于获取多帧单元中序列转换的数据信号,将序列转换的数据信号汇集成相应地等于所述OTN帧信号的长度的长度,并且生成被顺序添加有MFAS的N个准OTN帧信号;以及发送装置,所述发送装置用于发送包括N个所生成的准OTN帧信号的多帧。
【技术特征摘要】
【国外来华专利技术】2015.01.14 JP 2015-0050551.一种发送多帧的发送电路,所述多帧包括N个OTN(光学传输网络)帧信号,所述N个OTN(光学传输网络)帧信号中的每一个容纳MFAS(多帧对准信号)和多个数据信号,所述发送电路包括:发送侧信号识别装置,所述发送侧信号识别装置用于检测所述MFAS,并且识别所述OTN帧信号的次序i(1≤i≤N);多帧内序列转换装置,所述多帧内序列转换装置用于根据所识别的次序i来在所述多帧内转换所述多个数据信号的序列;发送侧重布置装置,所述发送侧重布置装置用于获取多帧单元中序列转换的数据信号,将序列转换的数据信号汇集成相应地等于所述OTN帧信号的长度的长度,并且生成被顺序添加有MFAS的N个准OTN帧信号;以及发送装置,所述发送装置用于发送包括N个所生成的准OTN帧信号的多帧。2.根据权利要求1所述的发送电路,其中,所述多帧内序列转换装置顺序地布置被容纳在N个信号的第i数据信号区中的第iOTN帧信号中的N个连续数据信号,并且所述发送侧重布置装置将指示第i次序的MFAS添加到信号,其中,按照OTN帧信号的MFAS次序来布置所有OTN帧信号的第i数据信号,并且生成第i准OTN帧信号。3.根据权利要求1或2所述的发送电路,进一步包括:发送侧存储装置,所述发送侧存储装置用于按照根据所述多帧内序列转换装置中的序列转换的次序来保持所述多帧内部的所有数据信号,其中,所述发送侧重布置装置从所述发送侧存储装置读取多帧单元中序列转换的数据信号,并且汇集所读取的数据信号。4.根据权利要求1到3中任一项所述的发送电路,进一步包括:错误校正码添加装置,所述错误校正码添加装置用于生成错误校正码,将所述错误校正码添加到所述OTN帧信号,并且将添加有所述错误校正码的OTN帧信号输出到所述多帧内序列转换装置,其中,所述多帧内序列转换装置在多帧内转换所述多个数据信号和所述错误校正码的序列。5.根据权利要求4所述的发送电路,其中,所述OTN帧信号包括多个子帧,所述发送电路进一步包括:子帧间序列转换装置,所述子帧间序列转换装置用于基于所述子帧中的每一子帧的预定次序来替换OTN帧信号的多个数据信号的序列,并且将所替换的序列输出到所述错误校正码添加装置;以及子帧...
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