瞬态抑制二极管的制造方法和瞬态抑制二极管技术

本发明专利技术提出了一种瞬态抑制二极管的制造方法和一种瞬态抑制二极管，其中，瞬态抑制二极管的制造方法包括：在衬底上生长掺杂硅层；在所述掺杂硅层和所述衬底上刻蚀多个深沟槽，且多个所述深沟槽中的每个所述深沟槽的底部均位于所述衬底内；在多个深沟槽中的每个所述深沟槽中生长氧化层；在多个所述深沟槽中的任意两个相邻的深沟槽之间进行离子注入和/或扩散，以形成P型区域或N型区域；在所述P型区域或所述N型区域上刻蚀接触孔，以在所述接触孔内制备金属层。通过本发明专利技术的技术方案，可以降低瞬态抑制二极管的寄生电容、减少瞬态抑制二极管对电路的干扰，降低高频电路信号的衰减，提高TVS的反向特性，提高器件可靠性并降低器件成本。

【技术实现步骤摘要】

本专利技术涉及瞬态抑制二极管
，具体而言，涉及一种瞬态抑制二极管的制造方法和一种瞬态抑制二极管。
技术介绍
瞬态抑制二极管(TVS)是一种用来保护敏感半导体的器件，使敏感半导体免遭瞬态电压浪涌破坏的一种固态半导体器件，它具有箝位系数小、体积小、响应快、漏电流小和可靠性高等优点，因而在电压瞬变和浪涌防护上得到了广泛的应用。静电放电(ESD)以及其他一些以电压浪涌形式随机出现的瞬态电压，通常存在于各种电子器件中，且半导体器件日益小型化、高密度和多功能的特点，使得电子器件越来越容易受到电压浪涌的影响，甚至导致致命的伤害。因此，低电容TVS适用于高频电路的保护器件，所以，减少瞬态抑制二极管的寄生电容对电路的干扰，降低高频电路信号的衰减，提高TVS的反向特性，提高器件可靠性，成为必要解决的问题。但目前的瞬态抑制二极管(TVS)的等效电路示意图如图1所示：该结构的输入/输出电容就相当于一个齐纳二极管的电容，这种瞬态抑制二极管(TVS)的等效寄生电容仍然很大，对电路的干扰仍然很大，且高频电路信号的衰减很大，TVS的反向特性和可靠性仍然很低。因此，如何降低瞬态抑制二极管的寄生电容、减少瞬态抑制二极管对电路的干扰，降低高频电路信号的衰减，提高TVS的反向特性，提高器件可靠性并降低器件成本，成为亟待解决的问题。
技术实现思路
本专利技术正是基于上述问题，提出了一种新的技术方案，可以降低瞬态抑制二极管的寄生电容、减少瞬态抑制二极管对电路的干扰，降低高频电路信号的衰减，提高TVS的反向特性，提高器件可靠性并降低器件成本。有鉴于此，本专利技术的一方面提出了一种瞬态抑制二极管的制造方法，包括：在衬底上生长掺杂硅层；在所述掺杂硅层和所述衬底上刻蚀多个深沟槽，且多个所述深沟槽中的每个所述深沟槽的底部均位于所述衬底内；在多个深沟槽中的每个所述深沟槽中生长氧化层；在多个所述深沟槽中的任意两个相邻的深沟槽之间进行离子注入和/或扩散，以形成P型区域或N型区域；在所述P型区域或所述N型区域上刻蚀接触孔，以在所述接触孔内制备金属层。在该技术方案中，通过在掺杂硅层和衬底上刻蚀多个深沟槽，且使每个深沟槽的底部均位于衬底内，可以使每个深沟槽与其他深沟槽相互隔离，然后在任意两个相邻的深沟槽之间进行离子注入和/或扩散，以形成P型区域或N型区域，并在P型区域或N型区域上刻蚀接触孔，以完成金属层的填充，就可以使瞬态抑制二极管的电路图等效为多个相互并联的支电流路，且每个支路上的均为相互串联且导通方向相反的齐纳二极管和肖特基二极管，这样，当任意方向有高压时，都有一条电流支路上的齐纳二极管在反方向击穿方面起到放电保护作用，另一条电流支路上的肖特基二极管进入反向阻断状态；另外，这种电路结构包括多个并联电流支路，且每个电流支路上均串联了肖特基二极管和齐纳二极管，同时，由于肖特基二极管的电容又远小于齐纳二极管，因而可以大幅地减小瞬态抑制二极管的输入/输出电容，进而实现减少瞬态抑制二极管对电路的干扰，降低高频电路信号的衰减，提高TVS的反向特性，提高器件可靠性并降低器件成本。在上述技术方案中，优选地，当多个所述深沟槽中的任一深沟槽的一侧为所述P型区域时，则所述任一深沟槽的另一侧为所述N型区域；以及当多个所述深沟槽中的任一深沟槽的一侧为所述N型区域时，则所述任一深沟槽的另一侧为所述P型区域。在该技术方案中，通过确保任一深沟槽的两侧的离子区域不同，即任一深沟槽的两侧的离子区域分别为P型区域和N型区域，可以确保瞬态抑制二极管中的多个相互并联的支电流路中的每个支路上的均为相互串联且导通方向相反的齐纳二极管和肖特基二极管，同时，由于肖特基二极管的电容又远小于齐纳二极管，因而可以大幅地减小瞬态抑制二极管的输入/输出电容，进而实现减少瞬态抑制二极管对电路的干扰，降低高频电路信号的衰减，提高TVS的反向特性，提高器件可靠性并降低器件成本。在上述技术方案中，优选地，还包括：在刻蚀所述接触孔之前，在所述掺杂硅层上生长第一介质层，以在所述第一介质层中为所述P型区域或所述N型区域刻蚀所述接触孔。在该技术方案中，通过在第一介质层中为所P型区域或N型区域刻蚀接触孔，便于在接触孔中填充金属层，以使任一深沟槽的两侧的齐纳二极管和肖特基二极管的阳极可以通过金属层相连接，从而使得瞬态抑制二极管中的多个相互并联的支电流路中的每个支路上的均为相互串联且导通方向相反的齐纳二极管和肖特基二极管。在上述技术方案中，优选地，为所述P型区域或所述N型区域刻蚀所述接触孔后，在所述第一介质层和所述接触孔的表面制备第二介质层。在该技术方案中，通过在第一介质层和接触孔的表面制备第二介质层，即完成了等效电容较小的瞬态抑制二极管的制作。在上述技术方案中，优选地，所述衬底为P型衬底或N型衬底。在上述技术方案中，优选地，所述氧化层为氧化硅层。在上述技术方案中，优选地，所述深沟槽采用干法刻蚀或湿法刻蚀形成。在该技术方案中，所述刻蚀方法(包括氧化物刻蚀和沟槽刻蚀)可以分为干法刻蚀和湿法刻蚀，其中，干法刻蚀包括光辉发、气相腐蚀、等离子体腐蚀等，且干法刻蚀易实现自动化、处理过程未引入污染、清洁度高；湿法刻蚀是一个纯粹的化学反应，是利用溶液与预刻蚀材料之间的化学反应来去除未被掩蔽膜材料掩蔽的部分进而达到刻蚀的目的，且湿法刻蚀的重复性好、成本低、使用的设备简单，因此沟槽的刻蚀可以根据实际情况采用干法刻蚀或湿法刻蚀。在上述技术方案中，优选地，采用干法刻蚀在所述P型区域或所述N型区域上所述刻蚀接触孔。本专利技术的另一方面提出了一种瞬态抑制二极管，包括：所述瞬态抑制二极管由如上述技术方案中任一项所述的瞬态抑制二极管的制造方法制作而成。在该技术方案中，通过采用如上述技术方案中任一项所述的瞬态抑制二极管的制造方法，可以制造出寄生电容较小的瞬态抑制二极管，以减少瞬态抑制二极管对电路的干扰，降低高频电路信号的衰减，提高TVS的反向特性，提高器件可靠性并降低器件成本。通过本专利技术的技术方案，可以降低瞬态抑制二极管的寄生电容、减少瞬态抑制二极管对电路的干扰，降低高频电路信号的衰减，提高TVS的反向特性，提高器件可靠性并降低器件成本。附图说明图1示出了相关技术中瞬态抑制二极管(TVS)的等效电路的示意图；图2示出了根据本专利技术的一个实施例的瞬态抑制二极管的制造方法的流程示意图；图3至图10示出了根据本专利技术的另一个实施例的瞬态抑制二极管的制造方法的原理示意图，其中，图3至图10中附图标记与部件名称之间的对应关系为：1N型硅片(衬底)，2P型掺杂硅层，3深沟槽，4氧化层，5P型区域，6N型区域，7介质层，8接触孔，9金属层。图11示出了根据本专利技术的一个实施例的瞬态抑制二极管(TVS)的等效电路的示意图。具体实施方式为了可以更清楚地理解本专利技术的上述目的、特征和优点，下面结合附图和具体实施方式对本专利技术进行进一步的详细描述。需要说明的是，在不冲突的情况下，本申请的实施例及实施例中的特征可以相互组合。在下面的描述中阐述了很多具体细节以便于充分理解本专利技术，但是，本专利技术还可以采用其他不同于在此描述的其他方式来实施，因此，本专利技术的保护范围并不受下面公开的具体实施例的限制。图2示出了根据本专利技术的一个实施例的瞬态抑制二本文档来自技高网...

【技术保护点】
一种瞬态抑制二极管的制造方法，其特征在于，包括：在衬底上生长掺杂硅层；在所述掺杂硅层和所述衬底上刻蚀多个深沟槽，且多个所述深沟槽中的每个所述深沟槽的底部均位于所述衬底内；在多个深沟槽中的每个所述深沟槽中生长氧化层；在多个所述深沟槽中的任意两个相邻的深沟槽之间进行离子注入和/或扩散，以形成P型区域或N型区域；在所述P型区域或所述N型区域上刻蚀接触孔，以在所述接触孔内制备金属层。

【技术特征摘要】
1.一种瞬态抑制二极管的制造方法，其特征在于，包括：在衬底上生长掺杂硅层；在所述掺杂硅层和所述衬底上刻蚀多个深沟槽，且多个所述深沟槽中的每个所述深沟槽的底部均位于所述衬底内；在多个深沟槽中的每个所述深沟槽中生长氧化层；在多个所述深沟槽中的任意两个相邻的深沟槽之间进行离子注入和/或扩散，以形成P型区域或N型区域；在所述P型区域或所述N型区域上刻蚀接触孔，以在所述接触孔内制备金属层。2.根据权利要求1所述的瞬态抑制二极管的制造方法，其特征在于，当多个所述深沟槽中的任一深沟槽的一侧为所述P型区域时，则所述任一深沟槽的另一侧为所述N型区域；以及当多个所述深沟槽中的任一深沟槽的一侧为所述N型区域时，则所述任一深沟槽的另一侧为所述P型区域。3.根据权利要求1所述的瞬态抑制二极管的制造方法，其特征在于，还包括：在刻蚀所述接触孔之前，在所述掺杂硅层上生长第一介...

【专利技术属性】
技术研发人员：李理，马万里，赵圣哲，
申请(专利权)人：北大方正集团有限公司，深圳方正微电子有限公司，
类型：发明
国别省市：北京;11