【技术实现步骤摘要】
输入级ESD保护电路
本专利技术涉及集成电路静电放电保护
,更具体涉及一种输入级ESD保护电路。
技术介绍
静电放电(ElectronicStaticDischarge,ESD)现象是日常生活中常见的物理现象,当带有电荷的物体去触碰芯片管脚或者芯片自己带上静电之后去接触其它低阻的物体时,电荷会在不等电势的物体之间发生转移。电荷的转移过程是瞬时大电流的过程,对于集成电路芯片来讲,由ESD事件带来的瞬时大电流脉冲常常会导致芯片中半导体器件的失效。无论是哪一种模式的ESD冲击,其瞬时的峰值电流都能达到几个甚至数十安培的量级,大大超过了集成电路中半导体器件的电流正常工作范围。为芯片提供片上ESD防护是半导体业界关于可靠性设计的重点和难点,全芯片的ESD保护策略要求针对任何管脚间的正向和负向ESD冲击模式,保护电路都能有效为静电电荷提供低阻的泄放通路。输入级ESD保护电路主要针对输入压焊点与其它不同管脚之间的ESD冲击提供有效的电荷泄放通路,因为大部分芯片的输入压焊点之后连接的第一个功能电路模块为输入级反相器,所以,保护输入级反相器的栅氧化层是输入级ESD保护电路设计的主要关注点。图1为传统工艺下常见的输入级ESD保护电路的结构示意图,图1中,在压焊点对地的正向ESD冲击下,静电电荷通过二极管D1与电源钳位ESD保护电路泄放到地,在此情况下,电荷泄放通路上流经的泄放电阻最大,造成压焊点上的钳位电压最大,所以此情况是输入级ESD保护电路设计面临的最坏情况。在传统工艺中,由于栅氧化层的厚度较厚,输入级反相器的栅氧化层通常能承受一定的高压,加之图1中电阻Rb对输入级 ...
【技术保护点】
一种输入级ESD保护电路,其特征在于,包括二极管模块、电源钳位ESD保护电路、镇流模块、传输门模块、反相器驱动模块;所述二极管模块用于在压焊点与其它芯片引脚之间发生ESD冲击时,有效将静电电荷引导到设计好的泄放通路上,在芯片正常工作时,提供数据通路和电源线VDD之间的隔离;所述电源钳位ESD保护电路用于探测所述电源线VDD以及压焊点上出现的过压事件,当有ESD冲击造成过压现象时,所述电源钳位ESD保护电路发出有效信号,触发泄放晶体管导通,断开压焊点与输入级反相器栅氧化层之间的电连接,并增大输入级反相器与所述电源线VDD之间的连接电阻,确保静电电荷通过设计好的泄放通路泄放,在没有过压事件被探测到时,确保数据的无衰减传输,并保证泄放晶体管处于严格的关断状态;所述反相器驱动模块用于根据所述电源钳位ESD保护电路给出的信号驱动所述传输门模块和所述镇流模块,使两个模块中的传输门晶体管在最坏情况的ESD事件发生时,完全关断,在数据传输时,完全开启;所述镇流模块用于根据所述反相器驱动模块发出的驱动信号,动态的改变输入级反相器PMOS晶体管Mp的源极与所述电源线VDD之间的电阻,当ESD事件发生时,增 ...
【技术特征摘要】
1.一种输入级ESD保护电路,其特征在于,包括二极管模块、电源钳位ESD保护电路、镇流模块、传输门模块、反相器驱动模块;所述二极管模块用于在压焊点与其它芯片引脚之间发生ESD冲击时,有效地将静电电荷引导到设计好的泄放通路上,在芯片正常工作时,提供数据通路和电源线VDD之间的隔离;所述电源钳位ESD保护电路用于探测所述电源线VDD以及压焊点上出现的过压事件,当有ESD冲击造成过压现象时,所述电源钳位ESD保护电路发出有效信号,触发泄放晶体管导通,断开压焊点与输入级反相器栅氧化层之间的电连接,并增大输入级反相器与所述电源线VDD之间的连接电阻,确保静电电荷通过设计好的泄放通路泄放,在没有过压事件被探测到时,确保数据的无衰减传输,并保证泄放晶体管处于严格的关断状态;所述反相器驱动模块用于根据所述电源钳位ESD保护电路给出的信号驱动所述传输门模块和所述镇流模块,使两个模块中的传输门晶体管在最坏情况的ESD事件发生时,完全关断,在数据传输时,完全开启;所述镇流模块用于根据所述反相器驱动模块发出的驱动信号,动态地改变输入级反相器PMOS晶体管Mp的源极与所述电源线VDD之间的电阻,当ESD事件发生时,增大输入级反相器PMOS晶体管的Mp的源极与所述电源线VDD之间的电阻,确保静电电荷通过设计好的泄放通路泄放,在芯片正常操作时,大幅减小输入级反相器PMOS晶体管Mp的源极与所述电源线VDD之间的电阻,确保电压不衰减;所述传输门模块用于根据所述反相器驱动模块发出的驱动信号,在过压事件发生时,断开压焊点与输入级反相器的栅氧化层间的电连接,同时,强制把输入级反相器的输入电压偏置到零,在芯片正常操作时,确保数据的正常传输。2.根据权利要求1所述的输入级ESD保护电路,其特征在于,所述电源钳位ESD电路包括泄放晶体管Mbig、电阻R、R2,二极管D3、D4、D5、D6,PMOS晶体管Mp1,NMOS晶体管Mfb,反相器INV4、INV5;所述泄放晶体管Mbig为NMOS晶体管,其栅极连接所述反相器驱动模块;所述电阻R的一端、所述PMOS晶体管Mp1的源极、所述泄放晶体管Mbig的漏极均与所述电源线VDD连接;所述电阻R的另一端与所述二极管D3的输入端、所述PMOS晶体管Mp1的栅极、所述NMOS晶体管Mfb的漏极连接;所述PMOS晶体管Mp1的漏极、所述NMOS晶体管Mfb的栅极、所述电阻R2的一端均与所述反相器IN...
【专利技术属性】
技术研发人员:王源,陆光易,曹健,贾嵩,张兴,
申请(专利权)人:北京大学,
类型:发明
国别省市:北京;11
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