多线程纹理解码制造技术

技术编号:10427066 阅读:149 留言:0更新日期:2014-09-12 17:10
一种用于在多线程处理器中执行纹理解码的方法包括在多个硬件线程中实质上同时解码VP8帧的至少两个宏块。每一硬件线程每次解码一个宏块。所述方法还可包括将来自所述VP8帧的所述至少两个宏块的一宏块指派给所述多线程处理器的一硬件线程。

【技术实现步骤摘要】
【国外来华专利技术】多线程纹理解码
本专利技术大体上涉及数据处理系统,且更具体地说,涉及多线程纹理解码。
技术介绍
VP8为受到科技企业协会支持的开源视频压缩格式。具体地说,VP8为由WebM文件使用的视频压缩格式。WebM为专用于开发用于全球信息网的高质量开放媒体格式的新开放媒体项目。VP8格式最初由0n2技术(0n2Technologies)公司开发作为视频压缩/解压缩工具的VPx家族的后继者。VP8格式已通过以解码经VP8压缩的视频流时的低计算复杂性实现高压缩效率而取得工业支持。
技术实现思路
根据本专利技术的一方面,描述一种用于在多线程处理器中执行纹理解码的方法。所述方法包括在多个硬件线程中实质上同时解码VP8帧的至少两个宏块。每一硬件线程每次处理一个宏块。所述方法还可包括将所述VP8帧的宏块指派给所述多线程处理器的每一硬件线程。在另一方面中,描述一种用于执行多线程纹理解码的装置。所述装置包括至少一个多线程处理器及耦合到所述至少一个多线程处理器的存储器。所述多线程处理器经配置以在多个硬件线程中实 质上同时解码VP8帧的至少两个宏块。每一硬件线程每次解码一个线程。所述装置还可包括将所述VP8帧的宏块指派给多线程处理器的每一硬件线程的控制器。在另一方面中,描述一种用于执行多线程纹理解码的计算机程序产品。所述计算机程序产品包括非暂时性计算机可读媒体,所述非暂时性计算机可读媒体具有记录于其上的程序代码。所述计算机程序产品具有用以在多个硬件线程中实质上同时解码VP8帧的至少两个宏块的程序代码。每一硬件线程每次处理一个宏块。所述计算机程序产品还可包括用以将所述VP8帧呃宏块指派给多线程处理器的硬件线程的程序代码。在另一方面中,描述一种用于多线程纹理解码的装置。所述装置包括用于将VP8帧的至少两个宏块中的一宏块指派给一硬件线程的装置。每一硬件线程每次处理一个宏块。所述装置还包括用于在多个硬件线程中实质上同时解码所述VP8帧的所述宏块的装置。下文将描述本专利技术的额外特征及优点。所属领域的技术人员应了解,本专利技术可容易用作修改或设计用于进行本专利技术的相同目的的其它结构的基础。所属领域的技术人员还应认识到,这些等效建构不脱离如所附权利要求书所阐述的本专利技术的教示。当结合附图进行考虑时,从以下描述将较好地理解相信为本专利技术的特性的新颖特征(所述所述特征及所述特性均涉及本专利技术的组织及操作方法)连同另外目标及优点。然而,应明确地理解,所述图中每一者仅出于说明及描述的目的而被提供且无意界定本专利技术的限度。【附图说明】本专利技术的特征、性质及优点将从下文在结合图式进行考虑时所阐述的[实施方式]而变得更显而易见,在所述图式中,相同参考字符始终对应地识别。图1为根据本专利技术的一方面的包括纹理解码逻辑的多处理器系统的框图。图2为根据本专利技术的另一方面的说明图1的纹理解码逻辑的框图。图3为根据本专利技术的另一方面的说明来自帧的宏块的并行纹理解码的框图。图4说明根据本专利技术的一方面的用于多线程纹理解码的方法。图5为根据本专利技术的另一方面的说明无线装置的方面的框图,所述无线装置包括可操作以执行用于多线程纹理解码的指令的处理器。图6为展示可供有利地使用本专利技术的一方面的无线通信系统的框图。【具体实施方式】下文结合附加图式而阐述的[实施方式]意在描述各种配置,且无意表示可供实践本文所描述的概念的仅有配置。[实施方式]出于提供对各种概念的透彻理解的目的而包括特定细节。然而,对于所属领域的技术人员将显而易见,可在没有这些特定细节的情况下实践这些概念。在一些例子中,以框图形式展示众所周知结构及组件以避免混淆这些概念。解码根据VP8格式而编码的视频流通常用单个线程执行以执行预测、离散余弦变换(discrete cosine transform, DCT)/ 沃尔什 _ 哈达马德变换(Walsh-Hadamardtransform, WHT)反转,及以光栅扫描次序的重构。具体地说,VP8规格通常禁止宏块滤波,直到帧的宏块中的每一者被重构为止。即,VP8解码被指定为基于帧边界而发生。针对经VP8格式编码的流的纹理解码而指定的单线程处理阻止多线程处理器以及多处理器在VP8解码期间实现高性能。根据本专利技术的一方面,并行地(同时地)解码VP8帧的至少两个宏块(MB),在每一硬件线程中解码一个宏块。经VP8编码的宏块的并行解码可改进高速缓存效率。图1展示根据本专利技术的一方面的包括纹理解码逻辑200的多处理器系统100的框图。专用集成电路(ASIC) 102包括支持多线程纹理解码的各种处理单元。对于图1所示的配置,ASIC102包括DSP核心118A及118B、处理器核心120A及120B、十字开关116、控制器110、内部存储器112,以及外部接口单元114。DSP核心118A及118B以及处理器核心120A及120B支持例如视频、音频、图形、游戏及其类似者的各种功能。每一处理器核心可为RISC(精简指令集计算)机器、微处理器,或某其它类型的处理器。控制器110控制々31(:102内的处理单元的操作。内部存储器112存储由ASIC102内的处理单元使用的数据及程序代码。外部接口单元114与在ASIC102外部的其它单元建立接口连接。大体上,ASIC102可包括少于、多于及/或不同于图1所示的处理单元的处理单元。包括于ASIC102中的处理单元的数目及处理单元的类型取决于例如由多处理器系统100支持的通信系统、应用及功能的各种因素。纹理编码技术可通过各种手段实施。举例来说,这些技术可以硬件、固件、软件或其组合予以实施。对于硬件实施,纹理编码技术可实施于一或多个ASIC、DSP、DSPD, PLD、FPGA、处理器、控制器、微控制器、微处理器、电子装置、经设计成执行本文所描述的功能的其它电子单元或其组合内。纹理编码技术的某些方面可用执行所描述功能的软件模块(例如,程序、函数,等等)来实施。软件程序代码可存储于存储器(例如,图1中的存储器101及/或112)中且由处理器(例如,DSP核心118A及/或118B)执行。所述存储器可实施于所述处理器内或所述处理器外部。ASIC102进一步耦合到存储纹理解码指令230的存储器101。对于图1所示的配置,每一处理核心执行纹理解码指令230。在一配置中,ASIC102可包括纹理解码逻辑200,如图2进一步所说明。图2为根据本专利技术的一方面的说明图1的纹理解码逻辑200的框图。代表性地,经剖析包234由前端线程240接收。在此配置中,前端线程240将来自经剖析包234的帧的宏块提供给任务队列242。从任务队列242,根据任务大小将宏块指派给工作者线程集区246的工作者线程248(248-1、......、248_N)。在此配置中,每一工作者线程248逐宏块地执行完整纹理解码。即,每一工作者线程248逐宏块地执行预测、逆变换、重构及回路滤波。因此,工作者线程248集体地执行宏块的并行/同时纹理解码,例如,如图3所示。另外,每一线程根据任务大小而每次解码数个宏块。[0021 ] 如图2进一步所说明,根据本专利技术的一方面,任务管理器250维持宏块之间的相依性。在本专利技术的此方面中,任务管理器250将一或多个宏块的任务指派给具有被解码的相依邻近者的工作者线程248。一旦工作者线程本文档来自技高网...

【技术保护点】
一种用于多线程处理器中的纹理解码的方法,其包含:通过多个硬件线程实质上同时地解码VP8帧的至少两个宏块,每一硬件线程处理一宏块。

【技术特征摘要】
【国外来华专利技术】2012.01.20 US 13/354,3641.一种用于多线程处理器中的纹理解码的方法,其包含: 通过多个硬件线程实质上同时地解码VP8帧的至少两个宏块,每一硬件线程处理一宏块。2.根据权利要求1所述的方法,其中所述至少两个宏块来自不同行。3.根据权利要求1所述的方法,其进一步包含将未经滤波像素存储于行缓冲器及列缓冲器中的至少一者中。4.根据权利要求1所述的方法,其进一步包含: 将所述至少两个宏块的经重构像素存储于行缓冲器及列缓冲器中的至少一者内。5.根据权利要求1所述的方法,其中解码进一步包含: 在每一硬件线程中重构一个宏块;且接着 对所述经重构宏块进行滤波。6.根据权利要求1所述的方法,其中通过单个硬件线程解码的宏块的数目是基于高速缓存线大小。7.根据权利要求1所述的方法,其中解码包含同时重构所述至少两个宏块中的每一者且对其进行滤波。8.根据权利要求1所述的方法,其中解码包含同时对所述VP8帧的所述至少两个宏块中的每一者进行纹理解码。9.根据权利要求1所述的方法,其进一步包含将所述多线程处理器集成到移动电话、机顶盒、音乐播放器、视频播放器、娱乐单元、导航装置、计算机、手持式个人通信系统PCS单元、便携式数据单元及固定位置数据单元中的至少一者中。10.一种用于多线程纹理解码的装置,其包含: 存储器;以及 至少一个多线程处理器,其耦合到所述存储器,所述至少一个多线程处理器经配置以通过多个硬件线程实质上同时解码VP8帧的至少两个宏块,每一硬件线程处理一宏块。11.根据权利要求10所述的装置,其中所述至少两个宏块来自不同行。12.根据权利要求10所述的装置,其中所述至少一个多线程处理器经进一步配置以: 将未经滤波像素存储于行缓冲器及列缓冲器中的至少一者中;且 将所述至少两个宏块...

【专利技术属性】
技术研发人员:周博肖舒杜俊晨苏海勒·亚利尔
申请(专利权)人:高通股份有限公司
类型:发明
国别省市:美国;US

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