含双栅增强型HEMT器件的集成系统技术方案

技术编号:8163492 阅读:172 留言:0更新日期:2013-01-07 20:46
一种含双栅增强型HEMT器件的集成系统,包括基座以及安装在基座上的双栅四端III族氮化物增强型HEMT器件,该器件包括异质结构以及通过异质结构中的二维电子气形成电连接的源、漏极,该异质结构包括:设置于源、漏极之间的第一半导体,形成于第一半导体表面的第二半导体,设于第二半导体表面的主栅,形成于第二半导体和主栅表面的介质层,设于介质层表面的顶栅;以及,用于使主、顶栅实现同步信号控制的分压补偿电路等,前述电路包括串联和/或并联设置在分别与源极和主、顶栅电连接的各基座接出端之间的分立电容和/或分立电阻。本发明专利技术可以对增强型HEMT器件中的“电流崩塌效应”进行有效控制,并可以将双栅电极四端器件等同于三端器件应用于集成系统中。?

【技术实现步骤摘要】

本专利技术特别涉及一种包含双栅增强型高电子迁移率晶体管器件(Enhancement-mode High Electron Mobility Transistor , E-mode HEMT)的集成系统。
技术介绍
由于压电极化和自发极化效应,在III族氮化物半导体异质结构上(Heterostructure),如AlGaN/GaN,能够形成高浓度的二维电子气。另外,III族氮化物半导体,具有高的绝缘击穿电场强度以及良好的耐高温特性。III族氮化物异质结构制备的HEMT,不仅可以应用于高频器件方面,而且适合应用于高电压、大电流的功率开关器件。应用到大功率开关电路中时,为了电路的设计简单和安全性方面考虑,一般要求开关器件为常关型,即增强型器件(E-M0DE)。现有的III族氮化物半导体E-MODE HEMT器件应用于高压大功率开关器件时,漏极输出电流往往跟不上栅电极控制信号的变化,即导通瞬态延迟比较大,此即为III族氮化物半导体HEMT器件的“电流崩塌现象”,对器件的实用性具有严重的影响。现有的对“电流崩塌现象”的解释之一是“虚栅模型”。“虚栅模型”认为在器件关断态时,有电子注入到栅附近的半导体表面或内部,从而被表面态或缺陷捕获形成一带负电荷的区域(虚栅),带负电荷的虚栅由于静电感应会降低栅漏、栅源连接区的沟道电子浓度,当器件开启时,栅下的沟道虽然可以很快积累大量的电子,但是由于虚栅电荷不能及时释放,虚栅下的沟道电子浓度较低,所以漏端输出电流较小,只有虚栅电荷充分释放后,漏端电流才能恢复到直流状态的水平。目前,常用的抑制“电流崩塌”的方法有对半导体进行表面处理,降低表面态或界面态密度;通过场板结构降低栅电极靠近漏极一端的电场强度,降低电子被表面态和缺陷捕获的概率,抑制电流崩塌。但以上所述抑制电流崩塌的方法在大电流、大电压的情况下效果并不理想。为了抑制“电流崩塌效应”,本案专利技术人曾提出了一种具有叠层双栅结构的新型III族氮化物E-MODE HEMT器件,通过对栅下局部区域进行F离子注入形成负电荷区实现增强型器件,其藉由顶栅和主栅的相互配合对沟道中二维电子气进行调控,使E-MODEHEMT(Enhancement-mode High Electron Mobility Transistor,增强型高电子迁移率晶体管)漏极输出电流与栅端电压的变化保持一致,从根本上抑制“电流崩塌效应”。然而,该新型叠层双栅HEMT器件与传统的源、漏、栅三端HEMT器件不同,是一个四端器件。但目前电力电子电路中的功率开关器件都是以三端的形式工作,四端器件应用到电路中需要对电路设计做进一步的修改,因此会增加系统的复杂度。
技术实现思路
本专利技术的目的在于提出一种集成方案,可以将叠层双栅四端HEMT器件集成到电路中,并使之以三端形式工作。为实现上述专利技术目的,本专利技术采用了如下技术方案一种含双栅增强型HEMT器件的集成系统,包括 基座, 以及,安装在基座上的双栅四端III族氮化物增强型HEMT器件,包括异质结构以及通过异质结构中的二维电子气形成电连接的源极与漏极, 其中,所述异质结构包括 第一半导体,其设置于源极和漏极之间, 第二半导体,其形成于第一半导体表面,并具有宽于第一半导体的带隙,且第二半导体表面设有主栅,所述主栅位于源极与漏极之间靠近源极一侧,并与第二半导体形成金属-半导体接触, 介质层,其形成于第二半导体和主栅表面,并设置在源极与漏极之间,且介质层表面设 有顶栅,所述顶栅对主栅形成全覆盖,且至少所述顶栅的一侧边缘部向漏极或源极方向延伸设定长度距离; 所述源极、漏极、主栅和顶栅分别与分布在基座上的复数个基座接出端电连接; 进一步的,该含双栅增强型HEMT器件的集成系统还包括 用于使所述主栅和顶栅实现同步信号控制的分压补偿电路,所述分压补偿电路包括串联和/或并联设置在分别与源极、主栅和顶栅电连接的各基座接出端之间的电容和/或电阻。进一步的,所述分压补偿电路包括 并联设置在与源极连接的基座接出端和与主栅连接的基座接出端之间的至少一第一电容和/或至少一第一电阻, 并联设置于与主栅连接的基座接出端和与顶栅连接的基座接出端之间的至少一第二电容和/或至少一第二电阻。作为优选方案之一,所述源极、主栅和顶栅分别与一第一基座接出端、一第四基座接出端及一第三基座接出端电连接,第一电容和第一电阻并联设于第一基座接出端与第四基座接出端之间,所述第二电容和第二电阻并联设于第四基座接出端及第三基座接出端之间。作为优选方案之一,所述第一电容、第二电容、第一电阻和第二电阻均米用分立器件。作为优选方案之一,所述源极与漏极分别与电源的低电位和高电位连接。 作为优选方案之一,所述主栅设于第二半导体的F离子区表面,所述F离子区是第二半导体内的局部区域经F离子注入处理后所形成的具有设定厚度的负电荷区。更进一步的讲,所述负电荷区是通过F离子注入,并经过一定温度、时间的退火,形成的稳定负电荷区,从而降低势垒高度,将栅下方沟道内的二维电子气耗尽。负电荷区也可以是高温热氧化区或者凹槽等可以实现增强型器件的结构。作为优选方案之一,所述第一半导体和第二半导体均采用III族氮化物半导体。作为优选方案之一,所述顶栅的两侧边缘分别向源极和漏极方向延伸设定长度距离, 或者,所述顶栅仅以其一侧边缘部向源极或漏极方向延伸设定长度距离。作为优选方案之一,在所述HEMT器件处于导通状态时,所述顶栅控制信号的电位高于主栅控制信号的电位。在所述HEMT器件工作时,所述主栅和顶栅所加电压的幅值和相位通过补偿分压电路由同一信号控制。作为优选方案之一,所述漏极与一第二基座接出端电连接。附图说明图I是本专利技术双栅E-MODE HEMT的剖面结构示意 图2是普通E-MODE HEMT器件的局部结构示意 图3是本专利技术双栅E-MODE HEMT器件的局部结构示意 图4是本专利技术实施例中E-MODE HEMT器件的剖视结构示意 图5是本专利技术实施例中E-MODE HEMT器件的俯视结构示意图。具体实施例方式参阅图2,普通E-MODE HEMT器件电流崩塌的原因是在器件处于关断状态时,在栅金属两侧AlGaN层3与绝缘介质层7以及它们的界面处会积累负电荷,形成界面负电荷积累区21,由于静电感应作用,这些负电荷会减少甚至完全耗尽其下方沟道区的二维电子气,形成沟道耗尽区22。当器件开启时(从关断态向导通态转换),栅极下方沟道内二维电子气受栅电极电压控制而上升,但是电荷积累区21的负电荷由于处于较深能级不能及时释出,因此其对应沟道内的二维电子气还是较少,所以器件不能完全导通,随着时间的增加,界面电荷积累区的负电荷逐渐从深能级释放出来,其对应沟道内电子浓度上升,器件逐渐向完全导通状态转变,根据目前研究结果,负电荷从深能级释放出来的时间大约为微秒 秒的量级。为克服上述普通E-MODE HEMT器件的电流崩塌现象,本案专利技术人提出了一种III族氮化物双栅四端E-MODE HEMT器件(以下简称双栅E-MODE HEMT器件),参阅图I,该器件的源极8、漏极9位于两侧,在靠近源极8—侧的第二半导体3 (如,AlGaN层)表面有一栅电极,称为主栅4,主栅下方有一经过F离子注入的负电荷区6,主栅上方有一绝缘介质本文档来自技高网
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【技术保护点】
一种含双栅增强型HEMT器件的集成系统,包括:基座(30),以及,封装在基座(30)上的双栅四端Ⅲ族氮化物增强型HEMT器件,包括异质结构以及通过异质结构中的二维电子气(2DEG)形成电连接的源极(12)与漏极(11),其中,所述异质结构包括:第一半导体(13),其设置于源极(12)和漏极(11)之间,第二半导体(14),其形成于第一半导体(13)表面,并具有宽于第一半导体(13)的带隙,且第二半导体(14)表面设有主栅(16),所述主栅(16)位于源极(12)与漏极(11)之间靠近源极(12)一侧,并与第二半导体(14)形成金属?半导体接触,介质层(17),其形成于第二半导体(14)和主栅(16)表面,并设置在源极(12)与漏极(11)之间,且介质层(17)表面设有顶栅(18),所述顶栅(18)对主栅(16)形成全覆盖,且至少所述顶栅(18)的一侧边缘部向漏极(11)或源极(12)方向延伸设定长度距离;所述源极(12)、漏极(11)、主栅(16)和顶栅(18)分别与分布在基座(30)上的复数个基座接出端电连接;其特征在于,它还包括:用于使所述主栅(16)和顶栅(18)实现同步信号控制的分压补偿电路,所述分压补偿电路包括串联和/或并联设置在分别与源极(12)、主栅(16)和顶栅(18)电连接的各基座接出端之间的电容和/或电阻。...

【技术特征摘要】

【专利技术属性】
技术研发人员:于国浩蔡勇张宝顺
申请(专利权)人:中国科学院苏州纳米技术与纳米仿生研究所
类型:发明
国别省市:

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