【技术实现步骤摘要】
非易失存储设备和访问非易失存储设备的方法
本专利技术涉及计算机领域,尤其涉及计算机领域中的非易失存储设备和访问非易失存储设备的方法。
技术介绍
随着信息技术的发展,特别是互联网的普及,各种类型的数据量迅速增长,尤其是视频数据的增多,给现有存储系统带来很大压力,所以迫切需要大容量、高性能的存储系统来有效保存和快速访问这些数据。传统的机械硬盘虽然技术成熟、成本低、容量大,但是性能存在瓶颈,而且功耗较大,已经逐渐让位于固态硬盘。固态硬盘使用半导体非易失存储器来保存数据,在性能、功耗、可靠性方面具有明显优势。固态硬盘有多种形态,按照对外接口的不同可分为三类:采用串口硬盘(SerialAdvancedTechnologyAttachment,简称“SATA”)接口或者串行SCSI接口(SerialAttachedSCSI,简称“SAS”,其中,小型计算机系统接口(SmallComputerSystemInterface,简称“SCSI”))的固态硬盘、采用外围设备互连快速通道(PeripheralComponentInterfaceExpress,简称“PCIe”)接口标准的固态硬盘以及采用内存接口的固态硬盘。其中,采用内存接口的固态硬盘称为闪存条。前面两类固态硬盘虽然技术很成熟,但是因为体积较大且存储密度不高,无法满足日益增长的数据量的存储需求,而且协议开销更大,增加了访问延时。而闪存条兼容现有的内存控制器和内存条插槽,兼具固态硬盘的大容量和内存的快速访问特点,因此越来越得到业界的重视。虽然闪存条具有这些优点,但是仍存在一个问题需要解决。由于内存接口的速率很高,例 ...
【技术保护点】
1.一种非易失存储设备,其特征在于,所述非易失存储设备包括接口模块、控制模块、读缓存和存储芯片,所述接口模块用于:接收主机发送的第一读请求信号,所述第一读请求信号包括所述存储芯片的地址;当所述第一读请求信号请求的读数据没有保存在所述读缓存中时,指示所述控制模块从所述存储芯片中读取所述读数据;在所述主机结束当前读操作周期之前,向所述主机发送第一中断信号和预定数据,所述预定数据用于使所述主机结束所述读操作周期,所述第一中断信号用于指示所述主机在所述读操作周期之后执行中断处理程序。
【技术特征摘要】
1.一种非易失存储设备,其特征在于,所述非易失存储设备包括接口模块、控制模块、读缓存和存储芯片,所述接口模块用于:接收主机发送的第一读请求信号,所述第一读请求信号包括所述存储芯片的地址;当所述第一读请求信号请求的读数据没有保存在所述读缓存中时,指示所述控制模块从所述存储芯片中读取所述读数据;在所述主机结束当前读操作周期之前,向所述主机发送第一中断信号和预定数据,所述预定数据用于使所述主机结束所述读操作周期,所述第一中断信号用于指示所述主机在所述读操作周期之后执行中断处理程序。2.如权利要求1所述的非易失存储设备,其特征在于,所述控制模块用于:根据所述接口模块的指示从所述存储芯片中读取所述读数据,并将所述读数据存储在所述读缓存中;所述接口模块还用于:在所述主机退出所述中断处理程序之后,接收所述主机发送的第二读请求信号,所述第二读请求信号包括所述存储芯片的地址;将所述控制模块存储在所述读缓存中的所述读数据发送至所述主机。3.如权利要求1或2所述的非易失存储设备,其特征在于,所述非易失存储设备还包括写缓存,所述接口模块还用于:接收所述主机发送的第一写请求信号和所述第一写请求信号请求写入的写数据,所述第一写请求信号包括所述存储芯片的地址;当所述写缓存中没有多余空间保存所述写数据时,丢弃所述写数据,并指示所述控制模块将所述写缓存中的已有数据保存到所述存储芯片中;在所述主机结束当前写操作周期之前,向所述主机发送第二中断信号,所述第二中断信号用于指示所述主机在当前写操作周期之后执行所述中断处理程序。4.如权利要求3所述的非易失存储设备,其特征在于,所述控制模块还用于:根据所述接口模块的指示将所述写缓存中的已有数据保存到所述存储芯片中,以使得所述写缓存留出多余空间保存所述写数据;所述接口模块还用于:在所述主机退出所述中断处理程序之后,接收所述主机发送的第二写请求信号;接收所述主机发送的所述写数据,并将所述写数据保存在所述写缓存中。5.如权利要求3所述的非易失存储设备,其特征在于,所述第一中断信号和/或所述第二中断信号用于指示所述主机确定延时时间,以便于所述主机在所述中断处理程序中根据所述延时时间进行延时。6.如权利要求5所述的非易失存储设备,其特征在于,所述接口模块包括延时时间寄存器,所述第一中断信号和/或所述第二中断信号用于指示所述主机从所述延时时间寄存器中获取所述延时时间。7.如权利要求5所述的非易失存储设备,其特征在于,所述非易失存储设备的集成电路间总线I2C上连接通用输入/输出GPIO芯片,所述第一中断信号和/或所述第二中断信号用于指示所述主机根据所述GPIO芯片确定所述延时时间。8.如权利要求5所述的非易失存储设备,其特征在于,所述接口模块包括第一状态寄存器,所述第一中断信号和/或所述第二中断信号用于指示所述主机根据所述第一状态寄存器确定所述延时时间,所述第一状态寄存器用于指示所述存储芯片的状态。9.如权利要求5所述的非易失存储设备,其特征在于,所述接口模块包括第一状态寄存器,所述第一状态寄存器用于指示所述存储芯片的状态,所述非易失存储设备的I2C总线上连接电可擦可编程只读存储器EEPROM芯片,所述EEPROM芯片用于指示所述状态和所述延时时间的对应关系,所述第一中断信号和/或所述第二中断信号用于指示所述主机根据所述第一状态寄存器和所述EEPROM芯片确定所述延时时间。10.如权利要求1,2,4-9中任一项所述的非易失存储设备,其特征在于,所述接口模块包括第二状态寄存器,所述第二状态寄存器用于指示所述主机根据所述第二状态寄存器确定在所述中断处理程序进行延时。11.如权利要求10所述的非易失存储设备,其特征在于,所述非易失存储设备的I2C总线上连接温度传感器,所述第二状态寄存器用于指示所述温度传感器表示的所述非易失存储设备的温度没有超出门限。12.如权利要求10所述的非易失存储设备,其特征在于,所述非易失存储设备通过内存接口和所述主机相连接,所述第二状态寄存器用于指示所述内存接口的地址和控制信号校验没有出错。13.如权利要求1,2,4-9,11,12中任一项所述的非易失存储设备,其特征在于,...
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