This application discloses an integrated circuit for configuring and reconfiguring a partially reconfigured area of a shift register (CSR). The integrated circuit includes a CSR chain that is partitioned into a set of CSR parts to reconfigure the region. The multiplexer circuit is added to the end of each PR region to allow the PR region to be bypassed or connected to the next PR region. Each PR area is connected to the PR circuit that promotes the CSR configuration of the corresponding PR area. The PR circuit includes a regional start circuit and a regional control circuit. The area start circuit starts the configuration of the CSR PR area. The region control circuit generates a local reconfiguration control signal to control the configuration operation of the CSR PR region started.
【技术实现步骤摘要】
用于配置和重新配置部分重新配置区域的方法和装置本申请是2016年5月20日提交的名称为“用于配置和重新配置部分重新配置区域的方法和装置”的中国专利申请201610338070.7的分案申请。本申请要求2015年5月28日提交的美国专利申请No.14/723,876的优先权,其全部内容以引用方式并入本文。
技术介绍
在复杂的嵌入式系统中常常包括诸如可编程逻辑器件(PLD)这样的可重新配置的集成电路器件。PLD通常由很多有时被称为逻辑阵列块(LAB)或可配置的逻辑块(CLB)的逻辑元件组成,这些块有时被称为逻辑元件。此类逻辑元件可以包括:查找表(LUT)或乘积项、进位输出链、寄存器和其它元件。多个逻辑元件或LAB可以被连接到水平和垂直导线,水平和垂直导线延伸PLD的核心逻辑区域的长度,并且连接到输入-输出(IO)和外围块。随着器件容量和复杂性增加,部分重新配置已经变成PLD中重要的特征。缩短配置时间以更快地改进PLD的需求以及重新配置运行中的PLD以减少或消除系统停机时间的需求推动此类特征。一般来说,PLD配置可以包括核心逻辑配置和IO配置。一般来说,由于配置元件和结构的差异,所以IO配置与核心逻辑配置不同。例如,IO配置可以包括一组串联连接的配置移位寄存器(总体被称为配置移位寄存器链)。然而,配置移位寄存器仅能够以常规完整器件配置或重新配置进行完整地配置(例如,以与PLD的核心逻辑区域相同的方式进行配置)。因此,重新配置配置移位寄存器的任何部分可能需要将PLD断电(或者以其它方式使其停用或使其处于挂起状态)。结果,每次PLD的配置可能需要从头重新开始,这费力并且费 ...
【技术保护点】
1.一种集成电路,所述集成电路包括:可编程的现场可编程门阵列电路即FPGA电路的第一区域,所述第一区域被配置为在第一时间经由部分重新配置被重新配置;可编程的FPGA电路的第二区域,所述第二区域被配置为在所述第一时间经由所述部分重新配置不被重新配置;去耦器电路,其经由信号线将所述第一区域连接到所述第二区域,其中所述去耦器电路被配置为经由所述信号线选择性地将所述第二区域去耦接或者耦接到所述第一区域;以及部分重新配置控制器电路,其被配置为控制所述去耦器电路。
【技术特征摘要】
2015.05.28 US 14/723,8761.一种集成电路,所述集成电路包括:可编程的现场可编程门阵列电路即FPGA电路的第一区域,所述第一区域被配置为在第一时间经由部分重新配置被重新配置;可编程的FPGA电路的第二区域,所述第二区域被配置为在所述第一时间经由所述部分重新配置不被重新配置;去耦器电路,其经由信号线将所述第一区域连接到所述第二区域,其中所述去耦器电路被配置为经由所述信号线选择性地将所述第二区域去耦接或者耦接到所述第一区域;以及部分重新配置控制器电路,其被配置为控制所述去耦器电路。2.根据权利要求1所述的集成电路,其中所述部分重新配置控制器电路被配置为至少部分基于来自一个或更多串联连接的寄存器的输出来控制所述去耦器电路。3.根据权利要求1所述的集成电路,其中所述部分重新配置控制器电路包括被配置为响应至少一个硬件或软件触发器的逻辑电路,其中触发器是被有效或无效以执行所述部分重新配置的信号。4.根据权利要求1所述的集成电路,其中所述第一区域被配置为耦接到输入/输出电路。5.根据权利要求4所述的集成电路,其中通过所述第一区域的所述部分重新配置,所述输入/输出电路的操作被配置以改变。6.根据权利要求1所述的集成电路,其中所述部分重新配置控制器电路被配置为传输一个或更多局部重新配置控制信号以控制所述第一区域的重新配置操作。7.根据权利要求6所述的集成电路,其中所述重新配置操作包括以下中的至少一个:将所述第一区域与输入/输出电路隔离;以及通过一个或更多配置移位寄存器管理重新配置数据的传输。8.根据权利要求6所述的集成电路,其中所述一个或更多局部重新配置控制信号源自作为控制信号传输到所述去耦器电路的公共信号。9.一种系统,其包括:布置在集成电路上的可编程的现场可编程门阵列电路即FPGA电路;处理器,其被配置为从所述可编程的FPGA电路接收数据并且处理数据;可编程的FPGA电路的第一区域;可编程的FPGA电路的第二区域;部分重新配置控制器电路,其被配置为基于控制信号选择性地禁用或启用要从所述第一区域提供到所述第二区域的部分重新配置数据,其中所述部分重新配置控制器电路被配置为选择性地传输所述控制信号;以及去耦器电路,其被配置为:从所述部分重新配置控制器电路接收所述控制信号;和禁用或启用所述去耦器电路,使得所述部分重新配置数据从所述第一区域被传输到或者不被传输到所述第二区域。10....
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