三维存储器制造方法技术

本发明专利技术公开了一种三维存储器制造方法，包括：在衬底上形成由交替布置的多个第一介质层和多个第二介质层构成的介质层堆叠；刻蚀介质层堆叠以形成多个沟道区；在所述沟道区之间，刻蚀介质层堆叠以形成暴露衬底的槽；以及执行侧向刻蚀，使得所述槽的侧壁的曲率至少局部减少。依照本发明专利技术的三维存储器制造方法，刻蚀接触槽之后增加额外的侧向刻蚀使得槽侧壁平直，提高器件可靠性。

【技术实现步骤摘要】
三维存储器制造方法
本专利技术涉及一种三维存储器制造方法，特别是涉及一种三维与非门存储器单元晶体管的制造方法。
技术介绍
为了改善存储器件的密度，业界已经广泛致力于研发减小二维布置的存储器单元的尺寸的方法。随着二维(2D)存储器件的存储器单元尺寸持续缩减，信号冲突和干扰会显著增大，以至于难以执行多电平单元(MLC)操作。为了克服2D存储器件的限制，业界已经研发了具有三维(3D)结构的存储器件，通过将存储器单元三维地布置在衬底之上来提高集成密度。典型的3DNAND存储器制造过程中，形成了沟道区之后，为了形成共源区并引出，需要刻蚀堆叠的介质层直至暴露衬底。在此过程之中，由于存储器核心(core)区与虚设(dummy)区所需的控制栅极数目不同，因此介质层堆叠高度不同，例如虚设区内介质层堆叠中所含的氮化硅层数较少。如此，在刻蚀共源区引出孔过程中，相同时间内刻蚀剂对于虚设区的刻蚀程度大于核心区，造成了如图1所示的弓形刻蚀形貌。这种形貌对于后续共源区接触结构的金属填充将带来不利影响，例如过早闭合或者留下孔洞。一种传统的解决方案是在刻蚀槽的刻蚀剂中添加碳氟比较大的刻蚀气体例如CH3F、CH2F2，利用过量的C与Si反应形成的SiC基材料在槽侧壁形成保护层以获得较为平整的形貌。然而，这种刻蚀气体的选择会对于核心区的槽形貌产生较大的影响，具体的，上述碳氟比较大的刻蚀气体除了会加强侧壁保护性之外，也同时会在纵向形成保护壁，导致核心区底部的槽宽度变窄。
技术实现思路
因此，本专利技术的目的在于克服上述缺陷，平衡核心区与虚设区之间刻蚀速率差，提高虚设区接触槽的侧壁平整度，提高器件可靠性。为此，本专利技术提供了一种三维存储器制造方法，包括：在衬底上形成由交替布置的多个第一介质层和多个第二介质层构成的介质层堆叠；刻蚀介质层堆叠以形成多个沟道区；在所述沟道区之间，刻蚀介质层堆叠以形成暴露衬底的槽；以及执行侧向刻蚀，使得所述槽的侧壁的曲率至少局部减少。在本专利技术的一个优选方案中规定，侧向刻蚀工艺为各向同性的湿法腐蚀或者干法刻蚀。在本专利技术的一个优选方案中规定，执行侧向刻蚀同时或之后进一步包括：选择性刻蚀去除多个第一介质层，形成横向凹陷。在本专利技术的一个优选方案中规定，形成横向凹陷之后进一步包括，在由横向凹陷中形成栅极绝缘层和栅极导电层构成的栅极堆叠。在本专利技术的一个优选方案中规定，执行侧向刻蚀之后进一步包括：在衬底中形成共源区；在多个槽中、在共源区上形成源极接触。在本专利技术的一个优选方案中规定，形成共源区同时或者之后掺杂。在本专利技术的一个优选方案中规定，形成多个沟道区的步骤进一步包括：刻蚀介质层堆叠形成多个沟道孔；在沟道孔的侧壁形成第二介质层堆叠；在第二介质层堆叠上形成沟道层。在本专利技术的一个优选方案中规定，形成介质层堆叠之前进一步包括，在沟道孔底部形成外延层。在本专利技术的一个优选方案中规定，外延层的顶部超过介质层堆叠中最底部的第一介质层的顶部。依照本专利技术的三维存储器制造方法，刻蚀接触槽之后增加额外的侧向刻蚀使得槽侧壁平直，提高器件可靠性。本专利技术所述目的，以及在此未列出的其他目的，在本申请独立权利要求的范围内得以满足。本专利技术的实施例限定在独立权利要求中，具体特征限定在其从属权利要求中。附图说明以下参照附图来详细说明本专利技术的技术方案，其中：图1至图5分别显示了根据本专利技术实施例的半导体器件制造工艺各个步骤的剖面示意图；以及图6显示了根据本专利技术实施例的半导体器件制造工艺的示意性流程图。具体实施方式以下参照附图并结合示意性的实施例来详细说明本专利技术技术方案的特征及其技术效果，公开了可有效提高3DNAND存储器件虚设区槽侧壁平整度的新型三维存储器制造方法。需要指出的是，类似的附图标记表示类似的结构，本申请中所用的术语“第一”、“第二”、“上”、“下”等等可用于修饰各种器件结构。这些修饰除非特别说明并非暗示所修饰器件结构的空间、次序或层级关系。如图6和图1所示，形成基础结构。提供衬底1，其材质可以包括体硅(bulkSi)、体锗(bulkGe)、绝缘体上硅(SOI)、绝缘体上锗(GeOI)或者是其他化合物半导体衬底，例如SiGe、Si:C、SIGeC、GaN、GaAs、InP等等，以及这些物质的组合。为了与现有的IC制造工艺兼容，衬底1优选地为含硅材质的衬底，例如Si、SOI、SiGe、Si:C、SiGeC等。采用包括LPCVD、PECVD、HDPCVD、UHVCVD、MOCVD、MBE、ALD、蒸发、溅射、热氧化、化学氧化等常规工艺，在衬底1上依次形成第一介质层2A和第二介质层2B的交替堆叠。层2A和层2B的材质相互不同以提供较大的刻蚀选择性，例如选自氧化硅、氮化硅、氮氧化硅、非晶碳、类金刚石无定形碳(DLC)、氧化锗、氧化铝的任一个或其组合。在一个优选实施例中，第一介质层2A的材质例如为氮化硅，同时兼做保护衬底的刻蚀停止层，第二介质层2B的材质例如为氧化硅，用于最终器件栅极堆叠结构之间的绝缘隔离材料。在本专利技术一个优选实施例中，介质层堆叠中最底部的第二介质层2B的厚度大于其余的第二介质层，用于提高底部选择晶体管与上方存储器单元晶体管串之间的绝缘隔离效果。采用旋涂、喷涂、丝网印刷、低温CVD等工艺，在整个器件顶部形成保护层3，其材质例如低温氧化硅、TEOS、或其他低k材料，包括但不限于有机低k材料(例如含芳基或者多元环的有机聚合物)、无机低k材料(例如无定形碳氮薄膜、多晶硼氮薄膜、氟硅玻璃、BSG、PSG、BPSG)、多孔低k材料(例如二硅三氧烷(SSQ)基多孔低k材料、多孔二氧化硅、多孔SiOCH、掺C二氧化硅、掺F多孔无定形碳、多孔金刚石、多孔有机聚合物)。保护层3用作各个单元之间的绝缘体，因此需要采用这些低k材料以减小寄生电容。优选地，保护层3顶部还包括硬掩模层或抗反射涂层(均未示出)。采用光刻形成光刻胶图形(未示出)，以光刻胶图形为掩模，对介质层堆叠2A/2B执行各向异性干法刻蚀，形成暴露衬底1的多个沟道孔，例如排列成矩阵形式。优选采用各向异性刻蚀工艺，例如(采用CxHyFz等氟代烃刻蚀气体，并采用碳氟比较大的刻蚀气体，例如CH3F、CH2F2)等离子干法刻蚀或反应离子刻蚀等各向异性干法刻蚀工艺。优选地，执行微量过刻蚀，例如深入衬底1表面0.2至1nm，以保证完全去除衬底1表面的各种缺陷例如原生氧化物、裂缝、污染物颗粒等。进一步优选地，采用湿法腐蚀工艺(例如TMAH针对Si)刻蚀衬底1表面形成多个周期性微凹陷或微凸起(未示出)以用作后续CVD沉积或外延生长的成核结构，进一步提高薄膜生长质量。随后，湿法腐蚀或者干法氧化去除光刻胶图形以暴露保护层3的顶部。沟道孔在俯视图中的形状可以为矩形、方形、菱形、圆形、半圆形、椭圆形、三角形、五边形、五角形、六边形、八边形等等各种几何形状。另外，沟道区的各沟道孔既可以垂直于衬底表面，也可以与衬底表面成其它角度。通过MOCVD、MBE、ALD等工艺，在沟道孔底部外延生长抬升的半导体层1E，也称作外延层1E，用作底部选择晶体管的沟道区。外延层1E的材质可以与衬底1相同以提高薄膜生长质量，也可以晶格常数与衬底1相近但是有差别以利用晶格失配提供的应力提高载流子迁移率从而提高驱动能力。外延层1E的顶部优选地至少超过介质层堆叠中最底部的本文档来自技高网...

【技术保护点】
1.一种三维存储器制造方法，包括：在衬底上形成由交替布置的多个第一介质层和多个第二介质层构成的介质层堆叠；刻蚀介质层堆叠以形成多个沟道区；在所述沟道区之间，刻蚀介质层堆叠以形成暴露衬底的槽；以及执行侧向刻蚀，使得所述槽的侧壁的曲率至少局部减少。

【技术特征摘要】
1.一种三维存储器制造方法，包括：在衬底上形成由交替布置的多个第一介质层和多个第二介质层构成的介质层堆叠；刻蚀介质层堆叠以形成多个沟道区；在所述沟道区之间，刻蚀介质层堆叠以形成暴露衬底的槽；以及执行侧向刻蚀，使得所述槽的侧壁的曲率至少局部减少。2.如权利要求1所述的三维存储器制造方法，其中，侧向刻蚀过程中，第二介质层的刻蚀速率大于第一介质层的刻蚀速率。3.如权利要求2所述的三维存储器制造方法，其中，侧向刻蚀工艺为各向同性的湿法腐蚀或者干法刻蚀。4.如权利要求1所述的三维存储器制造方法，其中，执行侧向刻蚀的同时或之后进一步包括：选择性刻蚀去除第一介质层，形成横向凹陷；形成横向凹陷之后进一步包括，在横向凹陷中形成由栅极绝缘层和栅极导电层构成的栅极堆叠。5.如权...

【专利技术属性】
技术研发人员：郭玉芳，乐陶然，刘欢，程强，陈世平，邵克坚，陈保友，
申请(专利权)人：长江存储科技有限责任公司，
类型：发明
国别省市：湖北,42