This disclosure deals with fault characterization in digital mode conversion. Technology and related circuits are disclosed and can be used to characterize the failure performance of a digital analog (DAC) converter circuit in a fast and repeatable manner, for example, to provide an AC (AC) fault value specification. There is a relationship between the DAC output offset caused by the fault and the input event rate of the DAC circuit. The relationship between the event rate (such as the update rate) and the DAC output offset can be used to predict the offset value at least, at least in part, based on the update rate, or to estimate the corresponding fault pulse region. In particular, the value of the fault pulse region can be obtained by using the hardware integrated circuit, without the need to use the digital time series of the fault event waveform.
【技术实现步骤摘要】
数模转换中故障表征优先权声明本专利申请要求享有于2017年1月11日提交的题为“数模转换中故障表征”的Enrightetal.的美国临时专利申请序列号62,445,209(代理人案卷号3867.360PRV)的优先权的利益,其全部内容通过引用的方式并入本文。
本文档一般而非限制地涉及数模转换,更具体地涉及数模转换器(DAC)电路操作中的故障现象。
技术介绍
DAC电路可表现出导致瞬变输出脉冲的动态行为,并且这种脉冲可以被称为故障现象。这种故障现象可能与输出电平(如DAC输出码寄存器变化),取样保持电路效应或数字馈通的编程变化有关,DAC电路输入的数字访问导致或有助于瞬变输出脉冲DAC输出(有或没有寄存器写入对应于输出电平变化)。
技术实现思路
本专利技术人已经开发了可用于以快速且可重复的方式表征故障性能的技术和相关电路,例如用于提供交流(AC)最大故障值规范。此外,本专利技术人还确定了故障引起的DAC输出偏移值与DAC电路输入事件率之间的关系。事件速率(例如更新速率)与DAC输出偏移之间的关系可以用于至少部分地基于更新速率来预测偏移值。特别地,可以通过使用硬件集成电路来获得表示故障脉冲区域的值。指定的持续时间可用于集成单个故障事件或多个复制故障事件。这样的综合事件可以与等效的重复事件或相应的事件进行比较,其中故障不存在或者这样的故障被已知量修改。作为说明性示例,可以在不更新(例如,对应于数字馈通或采样-保持电容行为,如果被触发)的DAC寄存器写入和具有更新的DAC寄存器写入之间确定集成区域的差异(包括贡献对应于输出更新)。如果使用硬件集成方法,则故障区域的测量 ...
【技术保护点】
1.一种用于表征与数模转换器(DAC)电路相关的瞬变行为的方法,所述方法包括:产生一系列DAC电路输入事件,从而在DAC电路的输出端产生相应瞬变;使用积分器电路,对来自相应瞬变的贡献求和以确定代表所述瞬变的DAC电路输出偏移值。
【技术特征摘要】
2017.01.11 US 62/445,209;2018.01.05 US 15/863,3131.一种用于表征与数模转换器(DAC)电路相关的瞬变行为的方法,所述方法包括:产生一系列DAC电路输入事件,从而在DAC电路的输出端产生相应瞬变;使用积分器电路,对来自相应瞬变的贡献求和以确定代表所述瞬变的DAC电路输出偏移值。2.权利要求1所述的方法,其中产生一系列事件包括以指定的重复率产生这样的事件;和其中所述DAC电路输出偏移值对应于所述指定的重复率。3.权利要求2所述的方法,包括使用所述输出偏移值来估计代表性瞬变故障区域值。4.权利要求2所述的方法,其中所述一系列事件包括一系列DAC电路寄存器写入。5.权利要求4所述的方法,其中所述DAC电路寄存器写入包括缺少输出电平偏移的DAC电路输出更新。6.权利要求4所述的方法,其中所述DAC电路寄存器写入包括DAC电路输出更新,所述DAC电路输出更新包括DAC电路输出中的直流(DC)值阶跃变化。7.权利要求6所述的方法,其中所述DAC电路寄存器写入包括输出更新,所述输出更新包括在第一时段期间的第一极性DC值阶跃变化和在第二时段期间的第二相反极性DC值阶跃变化。8.权利要求7所述的方法,包括将输入极性交换到所述积分器电路,使得在所述第一时段期间使用第一输入极性,并且在所述第二时段期间使用第二相反的输入极性。9.权利要求1所述的方法,其中所述一系列事件包括一系列的DAC电路寄存器写入,所述DAC电路寄存器写入包括与DAC电路输出更新命令相关的寄存器写入的第一部分、和与DAC电路输出更新命令不关联的寄存器写入的第二部分;和其中该方法包括对应于不关联的输出更新命令的DAC电路寄存器写入去除所述输出偏移值的基线贡献,以确定对应于DAC电路输出更新事件的输出偏移值。10.权利要求1所述的方法,包括:其中所述积分器电路位于包括DAC电路的共享集成电路内;和其中该方法包括将表示瞬变的输出偏移值与指定的阈值进行比较,以根据最低有效位(LSB)贡献的计数来确定输出偏移值;和对应于所述计数来应...
【专利技术属性】
技术研发人员:P·恩怀特,M·闵西卡,F·唐尼,
申请(专利权)人:亚德诺半导体集团,
类型:发明
国别省市:百慕大群岛,BM
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