The present invention provides a high voltage IGBT device with a built-in ballast resistance, which consists of a first conductive type semiconductor P+ collecting area, a metal collector, a second conductive type semiconductor buffer layer, a second conductive type semiconductor N drift zone, a first conductive type semi guide P type base area, a heavy doping first conductive type half type. The conductor P+ doping area, the second conductive type semiconductor built-in ballast resistance zone and the heavily doped second conductive type semiconductor N+ emission area, second conductive type semiconductor built-in resistor zone instead of the second conductive type semiconductor N+ emitter region extending laterally below the gate structure, thus making the second conductive type semiconductor inside. At the same time, the short circuit capacity of the device is improved by using the positive temperature characteristics at high temperature at high temperature, and the thermal stability of the device is enhanced at the same time. One
【技术实现步骤摘要】
一种具有内置镇流电阻的高压IGBT器件
本专利技术属于功率半导体器件
,具体涉及一种具有内置镇流电阻的高压IGBT(InsulatedGateBipolarTransistor)器件。
技术介绍
绝缘栅双极晶体管(InsulatedGateBipolarTransistor,IGBT)由于既具有MOSFET输入阻抗高、驱动电路简单、开关速度快的优点,又具有双极晶体管电流密度大、饱和压降低的优点,现已成为电力电子领域的主流功率开关器件之一;广泛应用于高压、大电流领域,如风力发电、轨道交通、智能电网等。IGBT在实际应用中,会遇到负载短路情况,此时IGBT同时承受高压和大电流的考验,短时间内芯片温度骤升、热量集聚,最终导致器件发生烧毁。高压IGBT由于应用环境对短路承受能力有更严格的要求,为了给外部保护电路留有响应时间,在短路情况下将IGBT器件关断,一般要求器件本身的短路承受时间不低于10us。所以短路承受时间大小tsc,成为衡量器件短路承受能力的标准,tsc越大,表明器件抗短路能力越强。IGBT在短路情况下,器件两端承受大电压使得输出电流达到饱和,此时的电流称为短路饱和电流。IGBT在短路条件下的关断失效,主要原因是短路饱和电流过大,关断时引发高功耗、寄生晶闸管开启、电流聚集和泄漏电流过大等。目前在高压IGBT器件领域,基于发射极载流子增强技术的器件结构,如高电导率IGBT(HiGT)、平面增强型IGBT(EPIGBT)和介质阻挡层IGBT(DBIGBT)等,通过优化IGBT中的发射极一侧的载流子分布,降低器件短路饱和电流和关断损耗,从而降低失效几率 ...
【技术保护点】
1.一种具有内置镇流电阻的高压IGBT器件,其特征在于:其元胞结构包括第一导电类
【技术特征摘要】
1.一种具有内置镇流电阻的高压IGBT器件,其特征在于:其元胞结构包括第一导电类型半导体P+集电区(6)、位于第一导电类型半导体P+集电区(6)背面的金属集电极(7)、第一导电类型半导体P+集电区(6)上方的第二导电类型半导体缓冲层(5)、第二导电类型半导体缓冲层(5)上方的第二导电类型半导体N-漂移区(4);所述第二导电类型半导体N-漂移区(4)顶层中间区域为第一导电类型半导体P型基区(9),第一导电类型半导体P型基区(9)中具有防止寄生三极管开启的重掺杂第一导电类型半导体P+掺杂区(10)、第二导电类型半导体内置镇流电阻区(12)和重掺杂第二导电类型半导体N+发射区(11),第二导电类型半导体内置镇流电阻区(12)和重掺杂第二导电类型半导体N+发射区(11)位于重掺杂第一导电类型半导体P+掺杂区(10)上方的左右两侧,重掺杂第二导电类型半导体N+发射区(11)和第一导电类型半导体P型基区(9)通过金属发射极(8)短接;所述第二导电类型半导体N-漂移区(4)顶层第一导电类型半导体P型基区(9)两侧区域为降低JFET电阻的第二导电类型半导体JEFT注入区(3);所述IGBT器件还包括栅极结构,栅极结构由相互接触的多晶硅栅电极(2)和栅氧化层(13)构成,其中栅氧化层(13)与第二导电类型半导体JEFT注入区(3)、第一导电类型半导体P型基区(9)、第二导电类型半导体内置镇流电阻区(12)和重掺杂第二导电类型半导...
【专利技术属性】
技术研发人员:李泽宏,彭鑫,吴玉舟,殷鹏飞,任敏,高巍,张金平,张波,
申请(专利权)人:电子科技大学,
类型:发明
国别省市:四川,51
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