A technology for using a direct through body (TBV) to provide capacitance on a chip is disclosed. According to some embodiments, TBV can be formed in the semiconductor layer, and the dielectric layer can be formed between the TBV and the surrounding semiconductor layer. The TBV can be used as an electrode (such as an anode) for a TBV capacitor, and the dielectric layer can be used as the dielectric body of the TBV capacitor. In some embodiments, the semiconductor layer is used as another electrode of the TBV capacitor (for example, the cathode). Therefore, in some embodiments, the semiconductor layer can include low resistivity material, while in some other embodiments, can only provide the local TBV along the side wall (one or more) low resistivity region, for example through those (one or more) in the selective doping position. In other embodiments, the conduction layer formed between the dielectric layer and the semiconductor layer is used as another electrode of the TBV capacitor (for example, the cathode).
【技术实现步骤摘要】
【国外来华专利技术】芯片上直通本体过孔电容器及其形成技术
本专利技术涉及芯片上直通本体过孔电容器及其形成技术。
技术介绍
直通硅过孔(through-siliconvia,TSV)是穿过硅(Si)衬底(例如,Si晶片或管芯)从其上表面传递到其相对的下表面的垂直电连接。通常,通过首先刻蚀Si衬底以限定从上表面传递到相对的下表面的直通孔来形成TSV。然后将诸如铜(Cu)的导电材料沉积在直通孔中,以提供衬底的上表面和下表面之间的电连接。TSV可以用于将在单个芯片中的多个有源电路层(例如,堆叠的芯片)或多个管芯互连,由此形成三维集成电路(3DIC)或其他三维封装。附图说明图1A是根据本公开的实施例的集成电路(IC)的横截面视图。图1B是根据本公开的实施例的、图1A的IC的在其半导体层中形成开口之后的横截面视图。图1C是根据本公开的实施例的、图1B的IC的在开口中形成衬垫层之后的横截面视图。图1D是根据本公开的实施例的、图1C的IC的在开口中形成直通本体过孔(TBV)之后的横截面视图。图2A是根据本公开的另一实施例的集成电路(IC)的横截面视图。图2B是根据本公开的实施例的、图2A的IC的在其半导体层中形成开口之后的横截面视图。图2C是根据本公开的实施例的、图2B的IC的在开口中形成衬垫层之后的横截面视图。图2D是根据本公开的实施例的、图2C的IC的在开口中形成直通本体过孔(TBV)之后的横截面视图。图3A是根据本公开的另一实施例的集成电路(IC)的横截面视图。图3B是根据本公开的实施例的、图3A的IC的在其半导体层中形成一个或多个开口之后的横截面视图。图3C是根据本公开的实施例的、图 ...
【技术保护点】
一种包含电容器的集成电路,所述集成电路包括:半导体层;设置在所述半导体层内并且提供所述电容器的第一电极的第一直通本体过孔(TBV);以及设置在所述第一TBV和所述半导体层之间的第一电介质层;其中,所述电容器的第二电极由以下中的任一项提供:所述半导体层的接近所述第一TBV的低电阻部分;或者设置在所述半导体层和所述第一TBV之间的传导层。
【技术特征摘要】
【国外来华专利技术】1.一种包含电容器的集成电路,所述集成电路包括:半导体层;设置在所述半导体层内并且提供所述电容器的第一电极的第一直通本体过孔(TBV);以及设置在所述第一TBV和所述半导体层之间的第一电介质层;其中,所述电容器的第二电极由以下中的任一项提供:所述半导体层的接近所述第一TBV的低电阻部分;或者设置在所述半导体层和所述第一TBV之间的传导层。2.根据权利要求1所述的集成电路,其中:所述半导体层是在其中设置所述第一TBV的体块衬底;并且所述体块衬底被掺杂以提供所述低电阻部分,所述低电阻部分提供所述电容器的第二电极。3.根据权利要求1所述的集成电路,其中:所述半导体层是在其中设置第一TBV的多层衬底的体块层;并且所述多层衬底被掺杂以提供所述低电阻部分,所述低电阻部分提供所述电容器的第二电极。4.根据权利要求3所述的集成电路,其中:所述多层衬底是绝缘体上半导体(SOI)结构;并且所述半导体层是所述SOI结构的半导体层。5.根据权利要求1所述的集成电路,其中:所述半导体层是在其中设置所述第一TBV的体块衬底;以及所述电容器的第二电极由所述传导层提供。6.根据权利要求1所述的集成电路,其中:所述半导体层是在其中设置所述第一TBV的多层衬底的体块层;以及所述电容器的第二电极由所述传导层提供。7.根据权利要求6所述的集成电路,其中:所述多层衬底是绝缘体上半导体(SOI)结构;并且所述半导体层是所述SOI结构的半导体层。8.根据权利要求1所述的集成电路,其中:所述第一TBV设置在形成于所述半导体层中的第一直通孔内,所述第一直通孔穿过所述半导体层从其第一表面延伸到其第二表面;所述第一电介质层与所述第一直通孔的侧壁共形。9.根据权利要求1所述的集成电路,其中:所述第一TBV设置在形成于所述半导体层中的第一直通孔内,所述第一直通孔穿过所述半导体层从其第一表面延伸到其第二表面;以及所述集成电路还包括:设置在所述第一直通孔内在所述第一电介质层和所述半导体层之间并且与所述第一直通孔的侧壁共形的隔离层,其中:所述传导层设置在所述第一直通孔内在所述第一电介质层和所述隔离层之间,并且与所述隔离层共形;以及所述第一电介质层与所述传导层共形。10.根据权利要求1所述的集成电路,其中:所述第一TBV设置在形成于所述半导体层中的第一直通孔内,所述第一直通孔穿过所述半导体层从其第一表面延伸到其第二表面;以及所述集成电路还包括:设置在所述半导体层的第一表面或第二表面之上并且与所述传导层电连接的第一金属互连;以及设置在所述半导体层的第一表面或第二表面之上并且与所述第一TBV电连接的第二金属互连,其中,所述第二金属互连与所述传导层电绝缘。11.根据权利要求1所述的集成电路,还包括:设置在所述半导体层内与所述第一TBV邻近的第二TBV;形成于所述半导体层中的p+抽头部分;以及设置在所述半导体层的第一表面或第二表面之上并且与所述第二TBV和所述p+抽头部分电连接的金属互连。12.根据权利要求1所述的集成电路,还包括设置在所述半导体层内与所述第一TBV邻近的第二TBV,其中:所述第二TBV与所述第一TBV电连接并且与所述半导体层电隔离;以及所述电容器的第二电极由所述传导层提供。13.根据权利要求1所述的集成电路,还包括设置在所述半导体层内与所述第一TBV邻近的第二TBV,其中:所述第二TBV设置在形成于所述半导体层中的第二直通孔内,所述第二直通孔穿过所述半导体层从其第一表面延伸到其第二表面;以及所述第一电介质层设置在所述第二TBV和所述半导体层之间,并且与所述第二直通孔的侧壁共形。14.一种形成包含电容器的集成电路的方法,所述方法包括:在半导体层中形成第一直通本体过孔(TBV),所述第一TBV提供所述电容器的第一电极;在所述第一TBV和所述半导体层之间形成第一电介质层;以及通过以下中的任一项提供所述电容器的第二电极:在所述半导体层中接近所述第一TBV形成低电阻部分;或者在所述半导体层和所述第一TBV之间形成传导层。15.根据权利要求14所述的方法,其中:所述半导体层是在其中设置所述第一TBV的体块...
【专利技术属性】
技术研发人员:陈轶伟,K福亚,N尼德希,林睿彥,石坤桓,杨晓东,WM哈费茨,C蔡,
申请(专利权)人:英特尔公司,
类型:发明
国别省市:美国,US
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