一种显示面板及显示装置制造方法及图纸

技术编号:15725775 阅读:40 留言:0更新日期:2017-06-29 16:16
本发明专利技术公开了一种显示面板及显示装置,包括:设置在显示区域的多个呈阵列排布的像素单元,以及至少设置在显示区域的栅极驱动电路;其中,栅极驱动电路包括多个级联的移位寄存器单元,每一级移位寄存器单元分别与一行像素单元连接,且每一级移位寄存器单元在显示区域内至少包含三个移位寄存器单元子电路。由于每一级移位寄存器单元为与其对应连接的一行像素单元提供栅极驱动信号,通过将每一级移位寄存器单元包含的至少三个移位寄存器单元子电路设置在显示区域内,可以实现各移位寄存器单元子电路对同一行像素单元的分段扫描,因此,减小了移位寄存器单元对与其连接的一行像素单元中各像素单元的负载差异,延长了各像素单元的有效充电时间。

【技术实现步骤摘要】
一种显示面板及显示装置
本专利技术涉及显示
,尤其涉及一种显示面板及显示装置。
技术介绍
现有技术中,显示装置一般包含位于显示区域的多个像素单元,以及位于水平方向和垂直方向边框区域的栅极驱动电路和源极驱动器。其中,源极驱动器用于向多个像素单元提供数据信号。栅极驱动电路包括多个级联的移位寄存器单元,每个移位寄存器单元对应一行像素单元,由多个移位寄存器单元实现对多个像素单元的逐行扫描驱动,以控制数据信号写入像素单元,进而实现图像显示。由于现有技术中一般将移位寄存器单元对应设置于一行像素单元一侧的边框区域中,即采用单边栅极驱动方法实现对像素单元的扫描,如图1所示。单边栅极驱动的方法使得移位寄存器单元对与其距离较近的像素单元的负载较小,像素单元的有效充电时间长;对与其距离较远的像素单元的负载较大,像素单元的有效充电时间短。可以看出,较大的负载会影响移位寄存器单元对与其距离较远的像素单元的输出,使得移位寄存器单元对其距离较近的像素单元的输出不同于与其距离较远的像素单元的输出。为了减小移位寄存器单元对同一行各像素单元的负载差异,在现有技术中,如图2所示,通常在每行像素单元的两侧分别设置一个移位寄存器单元,即采用双边栅极驱动方法实现对像素单元的扫描。这样设置,可以使一行中各像素单元距离移位寄存器单元均较近,从而减小了由像素单元与移位寄存器单元之间的距离差异过大造成的负载差异。然而,随着显示技术的发展,显示装置表现出尺寸越来越大,分辨率和刷新率越来越高的发展趋势。越来越大的显示装置尺寸、越来越高的分辨率和刷新率使得移位寄存器单元与各像素单元之间的距离增大,导致移位寄存器单元对与其距离较远的像素单元的负载更大,像素单元的有效充电时间更短。此时,单边栅极驱动方法和双边栅极驱动方法均不能有效减小移位寄存器单元对与其连接的一行像素单元中各像素单元的负载差异。因此,如何减小移位寄存器单元对与其连接的一行像素单元中各像素单元的负载差异,延长各像素单元的有效充电时间,是目前本领域技术人员亟需解决的技术问题。
技术实现思路
有鉴于此,本专利技术实施例提供一种显示面板及显示装置,用以解决现有技术中存在的如何减小移位寄存器单元对与其连接的一行像素单元中各像素单元的负载差异,延长各像素单元的有效充电时间的问题。因此,本专利技术实施例提供的一种显示面板,包括:设置在显示区域的多个呈阵列排布的像素单元,以及至少设置在所述显示区域的栅极驱动电路;其中,所述栅极驱动电路包括多个级联的移位寄存器单元,每一级所述移位寄存器单元分别与一行所述像素单元连接,且每一级所述移位寄存器单元在所述显示区域内至少包含三个移位寄存器单元子电路。在一种可能的实现方式中,在本专利技术实施例提供的上述显示面板中,所述栅极驱动电路全部设置于所述显示区域内。在一种可能的实现方式中,在本专利技术实施例提供的上述显示面板中,每一级所述移位寄存器单元包含的各所述移位寄存器单元子电路分别与一个所述像素单元对应连接;或,每一级所述移位寄存器单元包含的各所述移位寄存器单元子电路分别与多个所述像素单元对应连接。在一种可能的实现方式中,在本专利技术实施例提供的上述显示面板中,各所述像素单元分别与至少两个所述移位寄存器单元子电路对应连接;与同一所述像素单元连接的各所述移位寄存器单元子电路用于输出不同的栅极驱动信号。在一种可能的实现方式中,在本专利技术实施例提供的上述显示面板中,各所述像素单元分别与一个所述移位寄存器单元子电路对应连接;各所述移位寄存器单元子电路具有至少两类信号输出端,每类所述信号输出端用于输出不同的栅极驱动信号。在一种可能的实现方式中,在本专利技术实施例提供的上述显示面板中,每一级所述移位寄存器单元包含的各所述移位寄存器单元子电路分别通过不同的扫描信号线与对应的所述像素单元连接。在一种可能的实现方式中,在本专利技术实施例提供的上述显示面板中,每一级所述移位寄存器单元包含的各所述移位寄存器单元子电路通过同一扫描信号线与对应的所述像素单元连接。在一种可能的实现方式中,在本专利技术实施例提供的上述显示面板中,同一列所述像素单元连接的各所述移位寄存器单元子电路公用同一组时钟信号线。在一种可能的实现方式中,在本专利技术实施例提供的上述显示面板中,所述栅极驱动电路中的各所述移位寄存器单元子电路公用同一组所述时钟信号线。本专利技术实施例提供的一种显示装置,包括上述显示面板。本专利技术有益效果如下:本专利技术实施例提供的显示面板及显示装置,包括:设置在显示区域的多个呈阵列排布的像素单元,以及至少设置在显示区域的栅极驱动电路;其中,栅极驱动电路包括多个级联的移位寄存器单元,每一级移位寄存器单元分别与一行像素单元连接,且每一级移位寄存器单元在显示区域内至少包含三个移位寄存器单元子电路。由于每一级移位寄存器单元为与其对应连接的一行像素单元提供栅极驱动信号,通过将每一级移位寄存器单元包含的至少三个移位寄存器单元子电路设置在显示区域内,可以实现采用显示区域内的至少三个移位寄存器单元子电路为同一行像素单元中与其对应连接的各像素单元提供栅极驱动信号,即可以实现采用各移位寄存器单元子电路对同一行像素单元进行分段扫描,因此,减小了各级移位寄存器单元中各移位寄存器单元子电路与其对应连接的各像素单元之间的距离,从而减小了各移位寄存器单元子电路对各像素单元的负载,进而减小了移位寄存器单元对与其对应连接的一行像素单元中的各像素单元的负载差异,延长了各像素单元的有效充电时间。附图说明图1为现有技术中单边栅极驱动方法的负载和有效充电时间的示意图;图2为现有技术中双边栅极驱动方法的负载和有效充电时间的示意图;图3a为本专利技术实施例提供的显示面板的结构示意图之一;图3b为图3a中虚线部分M放大后的结构示意图;图4为本专利技术实施例提供的显示面板中负载和有效充电时间的示意图;图5为现有技术中具有芯片绑定结构的显示面板的结构示意图;图6为现有技术中具有栅阵列结构的显示面板的结构示意图;图7为本专利技术实施例提供的显示面板的结构示意图之二;图8至图11分别为本专利技术实施例提供的移位寄存器单元子电路与像素单元的对应关系示意图;图12和图13分别为本专利技术实施例提供的同一级移位寄存器单元包含的各移位寄存器单元子电路之间的连接关系示意图;图14为本专利技术实施例提供的具备图12所示的移位寄存器单元的显示面板中实现多种刷新率的示意图;图15为为本专利技术实施例提供的具备图12所示的移位寄存器单元的显示面板中实现多种扫描方向的示意图;图16为现有技术中分区驱动显示面板的示意图。具体实施方式下面结合附图,对本专利技术实施例提供的显示面板及显示装置的具体实施方式进行详细的说明。本专利技术实施例提供的一种显示面板,如图3a和图3b所示,包括:设置在显示区域AA的多个呈阵列排布的一般包含红色子像素R、绿色子像素G和蓝色子像素B的像素单元P,以及至少设置在显示区域AA的栅极驱动电路;其中,栅极驱动电路包括多个级联的移位寄存器单元,每一级移位寄存器单元分别与一行像素单元连接,且每一级移位寄存器单元在显示区域AA内至少包含三个移位寄存器单元子电路CIR。在本专利技术实施例提供的上述显示面板中,由于每一级移位寄存器单元为与其对应连接的一行像素单元提供栅极驱动信号,通过将每一级移位寄存器单元包含的至少三个移位寄存器单元子电路CIR设本文档来自技高网
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一种显示面板及显示装置

【技术保护点】
一种显示面板,其特征在于,包括:设置在显示区域的多个呈阵列排布的像素单元,以及至少设置在所述显示区域的栅极驱动电路;其中,所述栅极驱动电路包括多个级联的移位寄存器单元,每一级所述移位寄存器单元分别与一行所述像素单元连接,且每一级所述移位寄存器单元在所述显示区域内至少包含三个移位寄存器单元子电路。

【技术特征摘要】
1.一种显示面板,其特征在于,包括:设置在显示区域的多个呈阵列排布的像素单元,以及至少设置在所述显示区域的栅极驱动电路;其中,所述栅极驱动电路包括多个级联的移位寄存器单元,每一级所述移位寄存器单元分别与一行所述像素单元连接,且每一级所述移位寄存器单元在所述显示区域内至少包含三个移位寄存器单元子电路。2.如权利要求1所述的显示面板,其特征在于,所述栅极驱动电路全部设置于所述显示区域内。3.如权利要求1所述的显示面板,其特征在于,每一级所述移位寄存器单元包含的各所述移位寄存器单元子电路分别与一个所述像素单元对应连接;或,每一级所述移位寄存器单元包含的各所述移位寄存器单元子电路分别与多个所述像素单元对应连接。4.如权利要求3所述的显示面板,其特征在于,各所述像素单元分别与至少两个所述移位寄存器单元子电路对应连接;与同一所述像素单元连接的各所述移位寄存器单元子电路用于输出不同的栅极驱动信号。5.如权...

【专利技术属性】
技术研发人员:李全虎
申请(专利权)人:京东方科技集团股份有限公司
类型:发明
国别省市:北京,11

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