【技术实现步骤摘要】
具有减小的瞬时电压降的低电阻电力头本申请要求于2015年12月2日提交的第62/262,166号美国临时专利申请的优先权权益和2016年4月11日提交的第15/096,273号美国专利申请的优先权权益,上述美国专利申请的公开内容通过引用全部包含于此。
本公开涉及半导体装置。更具体地,本公开涉及一种提供减小的瞬时电压降(IVD)的电力头(powerheader)。
技术介绍
当静态随机存取存储器(SRAM)之内的给定块或区域处于未使用的状态时,门控电源对于降低电路泄漏是必不可少的。流过门控电源的电力网的电流产生在电力头的负载侧的逻辑装置处经受的瞬时电压降(IVD)。IVD由流过电力网中任意电阻的电流产生。IVD对与硅至金属(硅-金属)界面相关联的电阻是尤其显著的。因为电力头的负载侧经受的电压会显著小于芯片供应电压,所以IVD限制SRAM的性能。另外,硅-金属界面因电迁移而内在地向金属(和通孔)施压,并因为硅-金属界面相对大而使电流降低。在高速SRAM设计中,当使用门控电源时,预充电电路呈现出特殊的挑战。SRAM的位线被同时预充电,这造成相对高的电流流过预充电装置并且产生大的IVD。因此,与电力头的IVD组合的大位线电容趋向于限制SRAM的高频性能。此外,预充电装置趋向于在物理上全部对准(aligned),这导致从电力网的相对小部分中得到极大量的电流。
技术实现思路
实施例提供了一种电力头,所述电力头包括:第一导线;以及包括源极区和漏极区的第一电力使能控制装置,第一电力使能控制装置的漏极区通过仅硅的连接结合到第一导线,第一电力使能控制装置的源极区结合到电源。另一实 ...
【技术保护点】
一种电力头,所述电力头包括:第一导线;以及第一电力使能控制装置,包括源极区和漏极区,第一电力使能控制装置的漏极区通过仅硅的连接结合到第一导线,第一电力使能控制装置的源极区结合到电源。
【技术特征摘要】
2015.12.02 US 62/262,166;2016.04.11 US 15/096,2731.一种电力头,所述电力头包括:第一导线;以及第一电力使能控制装置,包括源极区和漏极区,第一电力使能控制装置的漏极区通过仅硅的连接结合到第一导线,第一电力使能控制装置的源极区结合到电源。2.根据权利要求1所述的电力头,其中,第一导线包括结合到至少一个第一静态随机存取存储器单元的第一位线,电力头还包括第一预充电控制装置,第一预充电控制装置包括源极区和漏极区,第一预充电控制装置的漏极区结合到第一位线,其中,第一电力使能控制装置的漏极区经由第一导线通过仅硅的连接结合到第一预充电控制装置的源极区。3.根据权利要求2所述的电力头,其中,第一预充电控制装置还包括控制端子以及在第一预充电控制装置的源区与漏区之间的沟道,第一预充电控制装置的控制端子接收第一控制信号,以控制通过第一预充电控制装置的源极区与漏极区之间的沟道的导电,其中,第一电力使能控制装置还包括控制端子和第一电力使能控制装置的源极区与漏极区之间的沟道,第一电力使能控制装置的控制端子接收第二控制信号,以控制通过第一电力使能控制装置的源极区与漏极区之间的沟道的导电。4.根据权利要求2所述的电力头,所述电力头还包括:第二位线,结合到至少一个第二静态随机存取存储器单元;第二预充电控制装置,结合到第二位线,第二预充电控制装置包括源极区和漏极区,第二预充电控制装置的漏极区结合到第二位线;以及第二电力使能控制装置,包括源极区和漏极区,第二电力使能控制装置的漏极区是第二预充电控制装置的源极区,第二电力使能控制装置的源极区结合到电源。5.根据权利要求4所述的电力头,其中,第二预充电控制装置还包括控制端子以及在第二预充电控制装置的源极区与漏极区之间的沟道,第二预充电控制装置的控制端子接收第三控制信号,以控制通过第二预充电控制装置的源极区与漏极区之间的沟道的导电,其中,第二电力使能控制装置还包括控制端子以及在第二电力使能控制装置的源极区与漏极区之间的沟道,第二电力使能控制装置的控制端子接收第四控制信号,以控制通过第二电力使能控制装置的源极区与漏极区的沟道的导电。6.根据权利要求1所述的电力头,所述电力头还包括逻辑电路,逻辑电路包括第一控制装置,第一控制装置包括源极区和漏极区,第一控制装置的源极区通过仅硅的连接结合到第一电力使能控制装置的漏极区。7.根据权利要求1所述的电力头,所述电力头还包括驱动器电路,驱动器电路包括第一控制装置,第一控制装置包括源极区和漏极区,第一控制装置的源极区通过仅硅的连接结合到第一电力使能控制装置的漏极区。8.一种电力头,所述电力头包括:第一电路,包括第一控制装置,第一控制装置包括源极区和漏极区;第一电力使能控制装置,包括源极区和漏极区,第一电力使能控制装置的漏极区是第一控制装置的源极区,第一电力使能控制装置的源极区结合到电源。9.根据权利要求8所述的电力头,其中,第一电路包括逻辑电路或缓...
【专利技术属性】
技术研发人员:简·迈克尔·赫伯尔,迈克尔·布拉干扎,
申请(专利权)人:三星电子株式会社,
类型:发明
国别省市:韩国,KR
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