Embodiments of the present disclosure relate to an integrated circuit (IC) core. In an embodiment, the IC core may include a semiconductor substrate, a plurality of active components disposed on the first side of the semiconductor substrate, and a plurality of passive components disposed on the second side of the semiconductor substrate. In an embodiment, the second side can be arranged to be opposite to the first side. In some embodiments, the passive component may include a capacitor and / or resistor, while in some embodiments the active component may include a transistor. Other embodiments can be introduced and / or requested to protect.
【技术实现步骤摘要】
【国外来华专利技术】具有背侧无源部件的集成电路管芯及其相关方法
本公开内容的实施例总体上涉及集成电路领域,并且更具体来说,涉及与具有背侧无源部件的集成电路管芯相关联的装置和方法。
技术介绍
集成电路(IC)管芯的输入/输出密度持续增加,而IC管芯尺寸则持续下降。在IC管芯设计中的一个考虑是IC管芯面积的有效使用;但是,在目前技术状态下,由于将部件置于半导体衬底不同侧上所带来的信号断接问题,无源部件和有源部件二者都被布置在IC管芯的半导体衬底的单个侧面上。本文提供的背景说明是出于总体呈现公开内容的上下文的目的。除非在本文中以其他方式指出的,在这一部分中所描述的材料并非是对于本申请中的权利要求而言的现有技术,并且并不承认是通过包含在这一部分中而成为现有技术。附图说明通过结合附图的以下详细说明将容易理解实施例。为了便于说明,类似的附图标记指代类似的结构元件。通过示例而并非是通过附图中图示的限制的方式示出了实施例。除非以其他方式明确指出的,这些附图并非是按比例的。图1示意性地示出了根据本公开内容的各个实施例的包括IC管芯的示例集成电路(IC)组件的剖面侧视图,该IC管芯具有布置在其上的背侧无源部件。图2是根据本公开内容的各个实施例的集成电路(IC)管芯制造工艺的示意性流程图。图3-4是根据本公开内容的各个实施例的示出在图2的IC管芯制造工艺中的阶段的选择的操作的示意性剖面图。图5是根据本公开内容的各个实施例的集成电路(IC)管芯制造工艺的示意性流程图。图6-7是根据本公开内容的各个实施例的示出在图5的IC管芯制造工艺中的阶段的选择的操作的示意性剖面图。图8是根据本公开内容的各个实施例 ...
【技术保护点】
一种集成电路(IC)管芯,包括:半导体衬底;布置在所述半导体衬底的第一侧上的多个有源部件;布置在所述半导体衬底的第二侧上的多个无源部件,其中所述第二侧被布置为与所述第一侧相对,并且其中所述多个无源部件是从由电容器或电阻器所构成的组中选择的。
【技术特征摘要】
【国外来华专利技术】1.一种集成电路(IC)管芯,包括:半导体衬底;布置在所述半导体衬底的第一侧上的多个有源部件;布置在所述半导体衬底的第二侧上的多个无源部件,其中所述第二侧被布置为与所述第一侧相对,并且其中所述多个无源部件是从由电容器或电阻器所构成的组中选择的。2.根据权利要求1所述的IC管芯,进一步包括多个贯穿衬底过孔(TSV),所述多个贯穿衬底过孔被布置在所述半导体衬底中并且被配置为在所述多个无源部件中的一个或多个无源部件与所述半导体衬底的所述第一侧之间传输电信号。3.根据权利要求1所述的IC管芯,进一步包括:布置在所述半导体衬底的所述第一侧上的一层或多层电绝缘材料,其中所述一层或多层电绝缘材料包封所述多个有源部件;布置在所述一层或多层电绝缘材料中的多个管芯级别的互连;以及布置在所述一层或多层电绝缘材料中的电布线特征,其中所述电布线特征被配置为将所述管芯级别的互连与所述多个有源部件电耦合。4.根据权利要求3所述的IC管芯,其中,所述一层或多层电绝缘材料是一个或多个第一电绝缘材料层,所述电布线特征是第一电布线特征,所述IC管芯进一步包括:布置在所述半导体衬底的所述第二侧上的一个或多个重分布层(RDL),其中所述一个或多个重分布层包括:布置在所述半导体衬底的所述第二侧上的一个或多个第二电绝缘材料层,其中所述一个或多个第二电绝缘材料层包封所述多个无源部件;布置在所述一个或多个第二电绝缘材料层中的多个输入/输出(I/O)互连结构;以及布置在所述一个或多个第二电绝缘材料层中的第二电布线特征,其中所述第二电布线特征被配置为将所述多个I/O互连结构与所述多个无源部件电耦合。5.根据权利要求1所述的IC管芯,其中,所述多个无源部件包括多个金属-绝缘体-金属(MIM)电容器,其中所述多个MIM电容器中的每一个包括第一金属层、布置在所述第一金属层上的电容器电介质层、以及布置在所述电容器电介质层上的第二金属层。6.根据权利要求1所述的IC管芯,其中,所述多个无源部件包括多个沟槽电容器,其中所述多个沟槽电容器中的每一个包括:布置在形成于所述半导体衬底中的一个或多个沟槽上的第一金属层,布置在所述第一金属层上的电容器电介质层,以及布置在所述电容器电介质层上的第二金属层。7.根据权利要求5或6中任一项所述的IC管芯,其中,所述第一金属层和所述第二金属层分别与布置在一个或多个重分布层(RDL)中的第一互连结构和第二互连结构电耦合,所述一个或多个重分布层被布置在所述半导体衬底的所述第二侧上。8.根据权利要求5或6中任一项所述的IC管芯,其中,所述第一金属层与布置在所述半导体衬底中的TSV电耦合,其中所述TSV将所述半导体衬底的所述第一侧与所述半导体衬底的所述第二侧电耦合。9.根据权利要求8所述的IC管芯,其中,所述第二金属层与所述IC管芯的电布线结构电耦合,其中所述电布线结构是从由以下项构成的组中选择的:布置在所述半导体衬底中的附加TSV,其中所述附加TSV将所述衬底的所述第一侧与所述半导体衬底的所述第二侧电耦合;或者布置在一个或多个重分布层(RDL)中的互连结构,所述一个或多个重分布层布置在所述半导体衬底的所述第二侧上。10.根据权利要求1所述的IC管芯,其中,所述多个无源部件包括多个薄膜电阻器,其中每个薄膜电阻器包括第一端子和第二端子。11.根据权利要求10所述的IC管芯,其中,所述第一端子和所述第二端子分别与布置在一个或多个重分布层(RDL)中的第一互连结构和第二互连结构电耦合,所述一个或多个重分布层布置在所述半导体衬底的所述第二侧上。12.根据权利要求10所述的IC管芯,其中,所述第一端子与布置在所述半导体衬底中的TSV电耦合,其中所述TSV将所述半导体衬底的所述第一侧与所述半导体衬底的所述第二侧电耦合。13.根据权利要求12所述的IC管芯,其中,所述第二端子与所述IC管芯的电布线结构电耦合,其中所述电布线结构是从由以下项构成的组中选择的:布置在所述半导体衬底中的附加TSV,其中所述附加TSV将所述衬底的所述第一侧与所述半导体衬底的...
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