存储装置和监控方法制造方法及图纸

技术编号:15238364 阅读:107 留言:0更新日期:2017-04-29 02:43
本发明专利技术涉及存储装置和监控方法。根据实施例,存储装置具有控制器,该控制器构成为:在能够与主机通信的状态下,当检测出能够测定信号品质的状况时,测定与所述主机通信的信号的眼图形,将测定结果存储于存储介质。

【技术实现步骤摘要】

在此所述的实施例,一般涉及存储装置和监控方法。
技术介绍
即使是符合接口标准的存储装置(以下,有时也称为设备(device)),也存在与主机之间通信的信号的品质下降而通信不畅的情况。通常,作为监控接口信号的品质的方式,有EOM(EyeOpeningMonitor开眼监控)方式。在EOM方式中,由示波器来测定信号的眼图形(eyepattern,也称为眼图(eyediagram)、开眼(eyeopening)),基于该波形判断信号品质。但是,在实际的通信中进行EOM时,不能排除设备接收到成为测定对象外的信号。适于测定的信号是以由接口规定的频率进行通信的所有信号,不适的信号是除此以外的信号。例如,在SATA(串行高级技术附件,SerialAdvancedTechnologyAttachment)标准的接口的情况下,为了建立通信而进行OOB(outofBand,带外)信号发送(signaling),但在该信号发送中所使用的COMRESET、COMWAKE这种信号,是以基于SATA标准的通信频率的信号为起始之前的前段的信号,为与SATA标准的通信频率的频带不同频带的频率,不适于EOM。此外,在称为DC闲置(DCidle)状态的无信号状态时,也不能进行EOM。进而,近年来,也正在出现希望确保数据中心等的机密性的主机,因此,无法为了检查硬盘驱动器而出借主机,无法在主机与设备实际正在通信的状态下测定接口信号的情况很多。因此,将主机和设备的工作模式从可能存在不适于EOM的信号的通常的通信模式转移到仅存在适于EOM的信号而不存在不适于EOM的信号的测试模式之后进行EOM。但是,在测试模式下的测定中,实际上仅在主机和设备之间的通常的通信状态下才发生的接口问题(所谓的基于主机和设备的通信良好性的问题,例如是指仅在主机侧的信号品质差和/或主机、设备两侧的细微条件相合的情况下才发生的问题)的解析是不可能的。例如存在SATA接口从省电模式恢复等的特殊情形下发生的问题。在测试模式中,无法覆盖这样的特殊情形。信号品质下降的原因有主机侧的信号品质差和/或主机与设备双方的细微条件相合等各种各样,因此,若不在实际正在通信的状态下测定信号的品质,则不能正确弄清通信不畅的原因。作为存储装置的一例,已知有硬盘驱动器,但存储装置的例子不限于此,也可以为固态驱动器或者混合驱动器等,上述的说明适用于所有存储装置。作为存储装置的接口的一例说明了SATA,但接口的例子不限于此,也可以为SAS、SCSI、IDE、PATA等,上述的说明适用于存储装置的所有接口。
技术实现思路
本专利技术的实施方式,提供容易对主机和存储装置的实际的通信状态的信号品质进行解析的存储装置和监控方法。实施方式的存储装置具有控制器,该控制器构成为:在能够与主机通信的状态下,当检测出能够测定信号品质的状况时,测定与所述主机通信的信号的眼图形,将测定结果存储于存储介质。附图说明图1是例示性地表示硬盘驱动器的构成的框图。图2是例示性地表示通过EOM生成的眼图形。图3是例示性地表示通常的OOB序列的波形图。图4是例示性地表示进行实施例的EOM的OOB序列的波形图。图5是例示性地表示EOM的流程的流程图。具体实施方式参照附图说明以下各实施例。图1是表示作为存储装置的实施例的硬盘驱动器的构成的典型框图。硬盘驱动器(以下,也称为HDD)10和主机12由SATA电缆14连接。在HDD10中,盘22通过主轴马达(SPM)24高速旋转。主轴马达24通过从驱动IC26供给的电流(或者电压)驱动。头28搭载于臂30的前端,头28与盘22相对地配置。臂30通过由音圈马达(VCM)32驱动来使头28沿盘22的径向移动,寻找目标位置。音圈马达32由来自驱动IC26的驱动电流或驱动电压来控制。在图1中,说明具备一张盘22的硬盘驱动器,但也可以层叠地配置多张盘。驱动IC26按照主控制器34内的伺服控制器36的控制,驱动主轴马达24和音圈马达32。头IC38也称为头放大器,将头28的引导元件的输出信号进行放大。头IC38将从主控制器34(更详细地,主控制器34内的读/写通道40)输出的写数据转换为写电流,并将该写电流输出到头28的写元件。主控制器34由多个要素集成于一个芯片而成的系统LSI来实现。主控制器34具备读/写(R/W)通道40、硬盘控制器(HDC)42、伺服控制器36、以及存储器单元44。存储器单元44具备闪存存储器和RAM。闪存存储器为可改写的非易失性半导体存储器,在其存储区域的一部分预先保存如下程序:用于实现包含HDC42和伺服控制器36的主控制器34的功能的控制程序(固件);和用于检查接口信号的品质的控制程序。RAM的存储区域的至少一部分,作为HDC42和伺服控制器36用的作业区域而使用。存储器单元44也可以集成在主控制器34以外的其他芯片上。读/写通道40处理与对盘22的读/写相关的信号。例如,读/写通道40对由头IC38放大后的头28的引导元件的输出进行解码。读/写通道40从引导元件的输出信号提取伺服数据,供给到伺服控制器36。读/写通道40对从HDC42传送的写数据进行编码,并将该编码后的写数据传送到头IC38。HDC42经由接口50与主机12连接。主机12将HDD10作为自己的存储装置而利用。HDC42也作为将信号传送给主机12并且接收从主机12传送的信号的接口控制器发挥作用。伺服控制器36经由驱动IC26来控制主机马达24和音圈马达32。为了将头28定位在盘22上的目标磁道的目标位置,伺服控制器36基于由读/写通道40提取的伺服数据来控制音圈马达32。控制音圈马达32与控制具备音圈马达32的臂30是等效的。HDC42和伺服控制器36分别具有未图示的微处理器单元(MPU)。这些MPU通过执行HDC42和伺服控制器36用的各自的控制程序,实现作为HDC42和伺服控制器36的功能。这些控制程序保存在存储单元44的闪存存储器中。也可以是单个MPU以时间分割的方式执行这些控制程序。接口50包括与主机12的发送器(Tx)16连接的接收器(Rx)52和与主机12的接收器(Rx)18连接的发送器(Tx)54。由接收器52接收到的信号供给到通信错误检测器56和信号分离器(或者选择器)58。通信错误检测器56检测接收信号的错误。该检测器56进行检测的错误的对象为表示无法进行接收数据的纠错的CRC错误和无法识别控制信号的错误。如后叙述,在SATA中,在链接层进行8位(bit)/10位(bit)转换,并将在通常的数据模式的转换中确定为不使用的字符模式分配给控制字符串(primitive,原语)。因此,当接口信号的波形发生失真时,有时会发生无法识别原语的错误,也称之为10位(bit)错误。通信错误检测器56的输出被供给到信号分离器58和后述的HOLD发生器64。信号分离器(demultiplexer)58基于通信错误检测器56的输出,从第1或第2输出端输出从接收器52输入的信号。从信号分离器56的第1输出端输出的信号被供给到不适信号检测器62和EOM装置80,从信号分离器58的第2输出端输出的信号经由HDC42供给到R/W通道40的写通道。本文档来自技高网
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【技术保护点】
一种存储装置,能够与主机连接,其中,所述存储装置包括控制器,该控制器构成为:在能够与所述主机通信的状态下,当检测出能够测定信号品质的状况时,测定与所述主机通信的信号的眼图形,将测定结果存储于存储介质。

【技术特征摘要】
2015.10.15 US 62/2421261.一种存储装置,能够与主机连接,其中,所述存储装置包括控制器,该控制器构成为:在能够与所述主机通信的状态下,当检测出能够测定信号品质的状况时,测定与所述主机通信的信号的眼图形,将测定结果存储于存储介质。2.根据权利要求1所述的存储装置,其中,所述控制器进一步构成为:当检测出与所述主机通信的通信错误时,测定所述眼图形。3.根据权利要求1所述的存储装置,其中,所述存储装置按照SATA接口与所述主机连接,所述控制器进一步构成为:当检测出纠错处理错误或原语的接收错误时、或者当在接收预定时间以外接收到COMRESET时,测定所述眼图形。4.根据权利要求3所述的存储装置,其中,所述控制器进一步构成为:当检测出纠错处理错误或原语的接收错误时、或者当在接收预定时间以外接收到COMRESET时,向所述主机发送HOLD,使所述主机成为待机状态,然后测定所述眼图形。5.根据权利要求1所述的存储装置,其中,所述存储装置按照SATA接口与所述主机连接,所述控制器进一步构成为:在与所述主机进行带外信号发送的期间,使在从所述主机接收到ALIGN之后应该发送的SYNC的发送延迟,在延期的期间,测定所述眼图形。6.根据权利要求1所述的存储装置,其中,所述控制器进一步构成为分成多次来测定所述眼图形。7.根据权利要求1所述的存储装置,其中,所述控制器具备检测与所述主机通信的超时的超时计数器,眼图形的测定时间对应于所述超时的时间。8.根据权利要求1所述的存储装置,其中,所述控制器进一步构成为:在所述测定结果异常的情况下,中断所述眼图形的测定,将存储在所述存储介质中的测定结果废弃。9.根据权利要求1所述的存储装置,其中,所述控制器进一步构成为:当接收到不适...

【专利技术属性】
技术研发人员:河合游森卫
申请(专利权)人:株式会社东芝
类型:发明
国别省市:日本;JP

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